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91305YGI-T

更新时间： 2024-11-05 20:50:51

品牌	Logo	应用领域
艾迪悌 - IDT		驱动光电二极管逻辑集成电路
页数	文件大小	规格书
8页	119K
描述
PLL Based Clock Driver, 91305 Series, 4 True Output(s), 0 Inverted Output(s), PDSO8, 4.40 MM, 0.65 MM PITCH, MO-153, TSSOP-8

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91305YGI-T 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	TSSOP
包装说明：	TSSOP,	针数：	8
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.89	系列：	91305
输入调节：	STANDARD	JESD-30 代码：	R-PDSO-G8
JESD-609代码：	e0	长度：	4.4 mm
逻辑集成电路类型：	PLL BASED CLOCK DRIVER	湿度敏感等级：	1
功能数量：	1	反相输出次数：
端子数量：	8	实输出次数：	4
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	240	认证状态：	Not Qualified
座面最大高度：	1.2 mm	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	3 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	20	宽度：	3 mm
Base Number Matches：	1

91305YGI-T 数据手册

ICS91305I

Integrated

Circuit

Systems, Inc.

High Performance Communication Buffer

General Description

Features

The ICS91305I is a high performance, low skew, low jitter

clock driver. It uses a phase lock loop (PLL) technology

to align, in both phase and frequency, the REF input with

theCLKOUTsignal. Itisdesignedtodistributehighspeed

clocks in communication systems operating at speeds

from 10 to 133 MHz.

•

Zero input - output delay

Frequency range 10 - 133 MHz (3.3V)

5V tolerant input REF

High loop filter bandwidth ideal for Spread

Spectrum applications.

•

Less than 200 ps Jitter between outputs

Skew controlled outputs

Skew less than 250 ps between outputs

Available in 8 pin 150 mil SOIC & 173 mil

TSSOP packages

ICS91305I is a zero delay buffer that provides

synchronization between the input and output. The

synchronization is established via CLKOUT feed back to

theinputofthePLL. Sincetheskewbetweentheinputand

outputislessthan+/-350pS, thepartactsasazerodelay

buffer.

•

3.3V 10ꢀ operation

Supports industrial temperature range -40°C to

85°C

The ICS91305I comes in an eight pin 150 mil SOIC

package. It has five output clocks. In the absence of REF

input, will be in the power down mode. In this mode, the

PLL is turned off and the output buffers are pulled low.

Powerdownmodeprovidesthelowestpowerconsumption

for a standby condition.

Pin Configuration

Block Diagram

REF

CLK2

CLK1

GND

CLKOUT

CLK4

VDD

CLK3

8 pin SOIC & TSSOP

0691F—06/03/05

12 3 4 5 6 7 8

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与91305YGI-T相关器件

型号	品牌	获取价格	描述	数据表
91305YGLFT	IDT	获取价格	PLL Based Clock Driver, 91305 Series, 5 True Output(s), 0 Inverted Output(s), PDSO8, 4.40
91305YGT	IDT	获取价格	PLL Based Clock Driver, 91305 Series, 4 True Output(s), 0 Inverted Output(s), PDSO8, 4.40
91305YMILF-T	IDT	获取价格	PLL Based Clock Driver, 91305 Series, 4 True Output(s), 0 Inverted Output(s), PDSO8, 0.150
91305YMI-T	IDT	获取价格	PLL Based Clock Driver, 91305 Series, 4 True Output(s), 0 Inverted Output(s), PDSO8, 0.150
91305YMLFT	IDT	获取价格	PLL Based Clock Driver, 91305 Series, 5 True Output(s), 0 Inverted Output(s), PDSO8, 0.150
913-060	LITTELFUSE	获取价格	Littelfuse标准汽车电缆端子可提供多种电线尺寸的解决方案。请联系您当地的销售代表
9130-60	BOURNS	获取价格	General Purpose Inductor, 47uH, 10%, 1 Element, Ferrite-Core, AXIAL LEADED
9130-60-RC	BOURNS	获取价格	General Purpose Inductor, 47uH, 10%, Ferrite-Core,
9130-62-RC	BOURNS	获取价格	General Purpose Inductor, 56uH, 10%, Ferrite-Core,
913-063	LITTELFUSE	获取价格	Littelfuse标准汽车电缆端子可提供多种电线尺寸的解决方案。请联系您当地的销售代表

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