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89H12T3BG2ZBBCG

更新时间： 2024-02-23 17:06:19
品牌 Logo 应用领域
艾迪悌 - IDT 时钟PC驱动外围集成电路驱动器
页数 文件大小 规格书
30页 290K
描述
PCI Bus Controller, PBGA324, 19 X 19 MM, 1 MM PITCH, GREEN, MS-034AAG-1, CABGA-324

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89H12T3BG2ZBBCG 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：BGA
包装说明：BGA, BGA324,18X18,40针数：324
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.32
地址总线宽度：总线兼容性：PCI
最大时钟频率：125 MHz驱动器接口标准：IEEE 1149.6AC; IEEE 1149.1
外部数据总线宽度：JESD-30 代码：S-PBGA-B324
JESD-609代码：e1长度：19 mm
湿度敏感等级：3端子数量：324
最高工作温度：70 °C最低工作温度：
封装主体材料：PLASTIC/EPOXY封装代码：BGA
封装等效代码：BGA324,18X18,40封装形状：SQUARE
封装形式：GRID ARRAY峰值回流温度（摄氏度）：260
电源：1,2.5,3.3 V认证状态：Not Qualified
座面最大高度：1.72 mm子类别：Bus Controllers
最大供电电压：1.1 V最小供电电压：0.9 V
标称供电电压：1 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Tin/Silver/Copper (Sn/Ag/Cu)端子形式：BALL
端子节距：1 mm端子位置：BOTTOM
处于峰值回流温度下的最长时间：30宽度：19 mm
uPs/uCs/外围集成电路类型：BUS CONTROLLER, PCIBase Number Matches：1

89H12T3BG2ZBBCG 数据手册

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89HPES12T3BG2  
Data Sheet  
12-Lane 3-Port  
Gen2 PCI Express® Switch  
®
• Power Budgeting Enhanced Capability  
Device Overview  
• Device Serial Number Enhanced Capability  
• Sub-System ID and Sub-System Vendor ID Capability  
• VGA and ISA enable  
• L0s and L1 ASPM  
• ARI ECN  
The 89HPES12T3BG2 is a member of IDT’s PRECISE™ family of  
PCI Express® switching solutions. The PES12T3BG2 is a 12-lane, 3-  
port Gen2 peripheral chip that performs PCI Express Base switching  
with a feature set optimized for high performance applications such as  
servers, storage, and communications/networking. It provides connec-  
tivity and switching functions between a PCI Express upstream port and  
two downstream ports and supports switching between downstream  
ports.  
◆
Flexible Architecture with Numerous Configuration Options  
–
Automatic per port link width negotiation to x4, x2 or x1  
Automatic lane reversal on all ports  
Automatic polarity inversion  
–
–
–
Features  
◆
High Performance PCI Express Switch  
Ability to load device configuration from serial EEPROM  
◆
On-Die Temperature Sensor  
–
–
Twelve 5 Gbps Gen2 PCI Express lanes  
Three switch ports  
–
Range of 0 to 127.5 degrees Celsius  
• One x4 upstream port  
• Two x4 downstream ports  
–
Three programmable temperature thresholds with over and  
under temperature threshold alarms  
–
Automatic recording of maximum high or minimum low  
temperature  
–
–
–
–
–
–
Low latency cut-through switch architecture  
Support for Max Payload Size up to 2048 bytes  
One virtual channel  
◆
◆
Legacy Support  
–
–
PCI compatible INTx emulation  
Bus locking  
Eight traffic classes  
PCI Express Base Specification Revision 2.0 compliant  
Implements the following optional PCI Express features  
• Advanced Error Reporting (AER) on all ports  
• End-to-End CRC (ECRC)  
Highly Integrated Solution  
–
Incorporates on-chip internal memory for packet buffering and  
queueing  
• Access Control Services (ACS)  
Block Diagram  
3-Port Switch Core / 12 PCI Express Lanes  
Port  
Frame Buffer  
Route Table  
Arbitration  
Scheduler  
Transaction Layer  
Transaction Layer  
Data Link Layer  
Transaction Layer  
Data Link Layer  
Data Link Layer  
Multiplexer / Demultiplexer  
Multiplexer / Demultiplexer  
Multiplexer / Demultiplexer  
Phy  
Phy  
Phy  
Logical  
Layer  
Logical  
Layer  
Logical  
Layer  
SerDes  
SerDes  
SerDes  
(Port 2)  
(Port 0)  
(Port 4)  
Figure 1 Internal Block Diagram  
IDT and the IDT logo are registered trademarks of Integrated Device Technology, Inc.  
1 of 30  
September 13, 2010  
© 2010 Integrated Device Technology, Inc.  
1234567...30

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型号 品牌 描述 获取价格 数据表
89H16T4BG2ZABX8 IDT 暂无描述

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