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873991AY-147LF

更新时间： 2024-09-30 01:03:51
品牌 Logo 应用领域
艾迪悌 - IDT 驱动逻辑集成电路
页数 文件大小 规格书
20页 315K
描述
Low Voltage, LVCMOS/LVPECL-to-LVPECL/ECL Clock Generator

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873991AY-147LF 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：TQFP
包装说明：LQFP-52针数：52
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.82
系列：873991输入调节：DIFFERENTIAL MUX
JESD-30 代码：S-PQFP-G52JESD-609代码：e3
长度：10 mm逻辑集成电路类型：PLL BASED CLOCK DRIVER
湿度敏感等级：3功能数量：1
反相输出次数：端子数量：52
实输出次数：14最高工作温度：50 °C
最低工作温度：输出特性：OPEN-COLLECTOR
封装主体材料：PLASTIC/EPOXY封装代码：LQFP
封装等效代码：QFP52,.47SQ封装形状：SQUARE
封装形式：FLATPACK, LOW PROFILE峰值回流温度（摄氏度）：260
电源：3.3 V认证状态：Not Qualified
Same Edge Skew-Max（tskwd）：0.25 ns座面最大高度：1.6 mm
子类别：Clock Drivers最大供电电压 (Vsup)：3.465 V
最小供电电压 (Vsup)：3.135 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES温度等级：COMMERCIAL
端子面层：Matte Tin (Sn) - annealed端子形式：GULL WING
端子节距：0.65 mm端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：10 mm
Base Number Matches：1

873991AY-147LF 数据手册

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Low Voltage, LVCMOS/LVPECL-to-LVPECL/ECL  
Clock Generator  
843N001I  
DATASHEET  
GENERAL DESCRIPTION  
FEATURES  
• Fourteen differential 3.3V LVPECL/ECL outputs  
• Selectable differential or REF_CLK inputs  
The 873991-147 is a low voltage, low skew, 3.3V LVPECL or ECL  
Clock Generator and a member of the family of High Performance  
Clock Solutions from IDT.The 873991-147 has two selectable clock  
inputs. The CLK, nCLK pair can accept LVPECL, LVDS, LVHSTL,  
SSTL and HCSL input levels and, the REF_CLK pin can accept a  
LVCMOS or LVTTL input levels. This device has a fully integrated  
PLL along with frequency configurable outputs.An external feedback  
input and output regenerates clocks with “zero delay”.  
• CLK, nCLK can accept the following input levels:  
LVPECL, LVDS, LVHSTL, SSTL, HCSL  
• REF_CLK accepts the following input levels: LVCMOS, LVTTL  
• Input clock frequency range: 6.25MHz to 120MHz  
• Maximum output frequency: 480MHz  
The four independent banks of outputs each have their own output  
dividers, which allow the device to generate a multitude of differ-  
ent bank frequency ratios and output-to-input frequency ratios.  
The output frequency range is 25MHz to 480MHz and the input  
frequency range is 6.25MHz to 120MHz. The PLL_EN input can  
be used to bypass the PLL for test and system debug purposes.  
In bypass mode, the input clock is routed around the PLL and into  
the internal output dividers.  
• VCO range: 200MHz to 960MHz  
• Output skew: 250ps (maximum), outputs at the same frequency  
• Cycle-to-cycle jitter: 55ps (maximum)  
• LVPECL mode operating voltage supply range:  
V
= 3.135V to 3.465V, V = 0V  
CC  
EE  
• ECL mode operating voltage supply range:  
= 0V, V = -3.465V to -3.135V  
V
CC  
EE  
The 873991-147 also has a SYNC output which can be used for  
system synchronization purposes. It monitors Bank A and Bank  
C outputs for coincident rising edges and signals a pulse per the  
timing diagrams in this data sheet. This feature is used primarily  
in applications where Bank A and Bank C are running at different  
frequencies, and is particularly useful when they are running at  
non-integer multiples of each other.  
• 0°C to 50°C ambient operating temperature  
• Available in lead-free (RoHS 6) package  
• Use replacement part 873996AYLF  
Example Applications:  
1. Line Card Multiplier: Multiply 19.44MHz from a back-plane  
to 77.76MHz on the line card ASIC and Serdes.  
PIN ASSIGNMENT  
2. Zero Delay Buffer: Fan out up to thirteen 100MHz copies  
from a reference clock to multiple processing units on an  
embedded system.  
873991-147 REVISION B 8/25/15  
1
©2015 Integrated Device Technology, Inc.  
1234567...20

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873991AY-147LF 替代型号

型号 品牌 替代类型 描述 数据表
873991AY-147LFT IDT

完全替代

 Low Voltage, LVCMOS/LVPECL-to-LVPECL/ECL Clock Generator
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 		暂无描述
873995 IDT

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 		Differential-to-3.3V LVPECL Zero Delay/Multiplier/Divider
873995AY IDT

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873995AYLF IDT

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