8735AM-21LFT

更新时间： 2024-01-29 23:21:09

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艾迪悌 - IDT		时钟驱动器时钟发生器逻辑集成电路光电二极管
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20页	837K
描述
700MHz, DIFFERENTIAL-TO-3.3V LVPECL ZERO DELAY CLOCK GENERATOR

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8735AM-21LFT 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	SOIC
包装说明：	SOP, SOP20,.4	针数：	20
Reach Compliance Code：	not_compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.81
系列：	8735	输入调节：	DIFFERENTIAL MUX
JESD-30 代码：	R-PDSO-G20	JESD-609代码：	e0
长度：	12.8 mm	逻辑集成电路类型：	PLL BASED CLOCK DRIVER
湿度敏感等级：	1	功能数量：	1
反相输出次数：		端子数量：	20
实输出次数：	1	最高工作温度：	70 °C
最低工作温度：		封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装等效代码：	SOP20,.4
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
峰值回流温度（摄氏度）：	225	电源：	3.3 V
Prop。Delay @ Nom-Sup：	4.2 ns	传播延迟（tpd）：	4.2 ns
认证状态：	Not Qualified	Same Edge Skew-Max（tskwd）：	0.02 ns
座面最大高度：	2.65 mm	子类别：	Clock Drivers
最大供电电压 (Vsup)：	3.465 V	最小供电电压 (Vsup)：	3.135 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	Tin/Lead (Sn85Pb15)	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	宽度：	7.5 mm
最小 fmax：	700 MHz	Base Number Matches：	1

8735AM-21LFT 数据手册

ICS8735-21

700MHZ, DIFFERENTIAL-TO-3.3V LVPECL ZERO DELAY CLOCK GENERATOR

Parameter Measurement Information, continued

nQ, nQFB

nCLK

Q, QFB

t_PW

CLK

t_PERIOD

nQ, nQFB

Q, QFB

t_PW

odc =

x 100%

t_PERIOD

t_PD

Output Duty Cycle/Pulse Width/Period

Propagation Delay

Application Information

Recommendations for Unused Input and Output Pins

Inputs:

Outputs:

LVCMOS Control Pins

LVPECL Outputs

All control pins have internal pull-ups or pull-downs; additional

resistance is not required but can be added for additional

protection. A 1kΩ resistor can be used.

All unused LVPECL outputs can be left floating. We recommend

that there is no trace attached. Both sides of the differential output

pair should either be left floating or terminated.

CLK/nCLK Inputs

For applications not requiring the use of the differential input, both

CLK and nCLK can be left floating. Though not required, but for

additional protection, a 1kΩ resistor can be tied from CLK to

ground.

FB_IN/nFB_IN Inputs

For applications not requiring the use of the differential input, both

FB_IN and nFB_IN can be left floating. Though not required, but for

additional protection, a 1kΩ resistor can be tied from FB_IN to

ground.

IDT™ / ICS™ 3.3V LVPECL ZERO DELAY CLOCK GENERATOR

ICS8735AM-21 REV. A JULY 31, 2008

1...6 7 8910 11 12...20

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与8735AM-21LFT相关器件

型号	品牌	描述	获取价格	数据表
8735AM-21T	IDT	700MHz, DIFFERENTIAL-TO-3.3V LVPECL ZERO DELAY CLOCK GENERATOR	获取价格
8735AMI-21	IDT	PLL Based Clock Driver, 8735 Series, 1 True Output(s), 0 Inverted Output(s), PDSO20, 7.50	获取价格
8735AMI-21LF	IDT	PLL Based Clock Driver, 8735 Series, 1 True Output(s), 0 Inverted Output(s), PDSO20, 7.50	获取价格
8735AMI-21LFT	IDT	PLL Based Clock Driver, 8735 Series, 1 True Output(s), 0 Inverted Output(s), PDSO20, 7.50	获取价格
8735AMI-21T	IDT	PLL Based Clock Driver, 8735 Series, 1 True Output(s), 0 Inverted Output(s), PDSO20, 7.50	获取价格
8735AY-01	IDT	PLL Based Clock Driver, 8735 Series, 5 True Output(s), 0 Inverted Output(s), PQFP32, 7 X 7	获取价格

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