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Datasheet > 微控制器和处理器 > 时钟发生器> 844002AGI-01
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844002AGI-01

更新时间： 2024-01-09 17:06:24
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艾迪悌 - IDT /
页数 文件大小 规格书
14页 743K
描述
FEMTOCLOCKS CRYSTAL-TOLVDS FREQUENCY SYNTHESIZER

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844002AGI-01 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Transferred零件包装代码：TSSOP
包装说明：TSSOP, TSSOP20,.25针数：20
Reach Compliance Code：not_compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.27
其他特性：ALSO OPERATES AT 3.3V SUPPLYJESD-30 代码：R-PDSO-G20
JESD-609代码：e0长度：6.5 mm
湿度敏感等级：1端子数量：20
最高工作温度：85 °C最低工作温度：-40 °C
最大输出时钟频率：170 MHz封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP20,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：225电源：2.5 V
主时钟/晶体标称频率：27.2 MHz认证状态：Not Qualified
座面最大高度：1.2 mm子类别：Clock Generators
最大压摆率：98 mA最大供电电压：2.625 V
最小供电电压：2.375 V标称供电电压：2.5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Tin/Lead (Sn85Pb15)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
宽度：4.4 mmuPs/uCs/外围集成电路类型：CLOCK GENERATOR, OTHER

844002AGI-01 数据手册

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ICS844002I-01  
FEMTOCLOCKS™ CRYSTAL-TO-LVDS FREQUENCY SYNTHESIZER  
Table 1. Pin Descriptions  
Number  
1, 7  
Name  
nc  
Type  
Description  
Unused  
Power  
No connect.  
2, 20  
3, 4  
VDDO  
Q0, Q0  
Output supply pins.  
Output  
Differential output pair. LVDS interface levels.  
Active HIGH Master Reset. When logic HIGH, the internal dividers are reset  
causing the true outputs Qx to go low and the inverted outputs Qx to go high.  
When logic LOW, the internal dividers and the outputs are enabled.  
LVCMOS/LVTTL interface levels.  
5
MR  
Input  
Pulldown  
Selects between the PLL and REF_CLK as input to the dividers. When LOW,  
6
8
PLL_SEL  
VDDA  
Input  
Pulldown selects PLL (PLL Enable). When HIGH, deselects the reference clock (PLL  
Bypass). LVCMOS/LVTTL interface levels.  
Power  
Input  
Analog supply pin.  
9,  
11  
FSEL0,  
F_SEL1  
Pulldown Frequency select pins. LVCMOS/LVTTL interface levels.  
Core supply pins.  
10  
VDD  
Power  
Input  
12,  
13  
XTAL_OUT  
XTAL_IN  
Parallel resonant crystal interface. XTAL_OUT is the output,  
XTAL_IN is the input.  
,
14  
REF_CLK  
Input  
Input  
Pulldown Non-inverting differential clock input.  
Selects between crystal or REF_CLK inputs as the PLL Reference source.  
Pulldown Selects XTAL inputs when LOW. Selects REF_CLK when HIGH.  
LVCMOS/LVTTL interface levels.  
15  
XTAL_SEL  
16  
17  
nc  
Unused  
Power  
No connect.  
GND  
Power supply ground.  
18, 19  
Q1, Q1  
Output  
Differential output pair. LVDS interface levels.  
NOTE: Pulldown refers to internal input resistors. See Table 2, Pin Characteristics, for typical values.  
Table 2. Pin Characteristics  
Symbol  
Parameter  
Test Conditions  
Minimum  
Typical  
Maximum  
Units  
pF  
CIN  
Input Capacitance  
4
RPULLDOWN Input Pulldown Resistor  
51  
kΩ  
IDT™ / ICS™ LVDS FREQUENCY SYNTHESIZER  
2
ICS844002AGI-01 REV. C SEPTEMBER 28, 2007  
1234567...14

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