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74LVC273BQ

更新时间： 2023-09-03 20:32:52
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安世 - NEXPERIA 逻辑集成电路触发器
页数 文件大小 规格书
14页 254K
描述
Octal D-type flip-flop with reset; positive-edge triggerProduction

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74LVC273BQ 技术参数

是否Rohs认证： 符合生命周期：Active
包装说明：HVQCCN,Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.55
系列：LVC/LCX/ZJESD-30 代码：R-PQCC-N20
JESD-609代码：e4长度：4.5 mm
逻辑集成电路类型：D FLIP-FLOP湿度敏感等级：1
位数：8功能数量：1
端子数量：20最高工作温度：125 °C
最低工作温度：-40 °C输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：HVQCCN
封装形状：RECTANGULAR封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：260传播延迟（tpd）：22.2 ns
座面最大高度：1 mm最大供电电压 (Vsup)：3.6 V
最小供电电压 (Vsup)：1.2 V标称供电电压 (Vsup)：1.8 V
表面贴装：YES技术：CMOS
温度等级：AUTOMOTIVE端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：NO LEAD端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：30
触发器类型：POSITIVE EDGE宽度：2.5 mm
Base Number Matches：1

74LVC273BQ 数据手册

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74LVC273  
Octal D-type flip-flop with reset; positive-edge trigger  
Rev. 8 — 31 August 2021  
Product data sheet  
1. General description  
The 74LVC273 is an octal positive-edge triggered D-type flip-flop. The device features clock (CP)  
and master reset (MR) inputs. The outputs Qn will assume the state of their corresponding D inputs  
that meet the set-up and hold time requirements on the LOW-to-HIGH clock (CP) transition. A LOW  
on MR forces the outputs LOW independently of clock and data inputs. Inputs can be driven from  
either 3.3 V or 5 V devices. This feature allows the use of these devices as translators in mixed  
3.3 V and 5 V environments.  
Schmitt-trigger action at all inputs makes the circuit tolerant of slower input rise and fall times.  
2. Features and benefits  
•
Wide supply voltage range from 1.2 V to 3.6 V  
•
•
•
•
•
Overvoltage tolerant inputs to 5.5 V  
CMOS low power consumption  
Direct interface with TTL levels  
Output drive capability 50 Ω transmission lines at +85 °C  
Complies with JEDEC standard:  
•
•
•
JESD8-7A (1.65 V to 1.95 V)  
JESD8-5A (2.3 V to 2.7 V)  
JESD8-C/JESD36 (2.7 V to 3.6 V)  
•
•
ESD protection:  
•
•
•
HBM JESD22-A114F exceeds 2000 V  
MM JESD22-A115-B exceeds 200 V  
CDM JESD22-C101E exceeds 1000 V  
Specified from -40 °C to +85 °C and -40 °C to +125 °C  
3. Ordering information  
Table 1. Ordering information  
Type number  
Package  
Temperature range Name  
Description  
Version  
74LVC273D  
74LVC273PW  
74LVC273BQ  
-40 °C to +125 °C  
-40 °C to +125 °C  
-40 °C to +125 °C  
SO20  
plastic small outline package; 20 leads;  
body width 7.5 mm  
SOT163-1  
TSSOP20  
plastic thin shrink small outline package; 20 leads;  
body width 4.4 mm  
SOT360-1  
SOT764-1  
DHVQFN20 plastic dual in-line compatible thermal enhanced  
very thin quad flat package; no leads; 20 terminals;  
body 2.5 × 4.5 × 0.85 mm  
 
 
 
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型号 品牌 获取价格 描述 数据表
74LVC273BQ-Q100 NEXPERIA

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 		Octal D-type flip-flop with reset; positive-edge trigger
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