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74LVC273DB,112

更新时间： 2024-01-03 08:58:35

品牌	Logo	应用领域
恩智浦 - NXP		光电二极管逻辑集成电路触发器
页数	文件大小	规格书
17页	127K
描述
74LVC273 - Octal D-type flip-flop with reset; positive-edge trigger SSOP2 20-Pin

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74LVC273DB,112 技术参数

生命周期：	Active	零件包装代码：	SSOP2
包装说明：	SSOP,	针数：	20
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	1.71	系列：	LVC/LCX/Z
JESD-30 代码：	R-PDSO-G20	JESD-609代码：	e4
长度：	7.2 mm	逻辑集成电路类型：	D FLIP-FLOP
湿度敏感等级：	1	位数：	8
功能数量：	1	端子数量：	20
最高工作温度：	125 °C	最低工作温度：	-40 °C
输出极性：	TRUE	封装主体材料：	PLASTIC/EPOXY
封装代码：	SSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, SHRINK PITCH	峰值回流温度（摄氏度）：	260
传播延迟（tpd）：	22.2 ns	座面最大高度：	2 mm
最大供电电压 (Vsup)：	3.6 V	最小供电电压 (Vsup)：	1.2 V
标称供电电压 (Vsup)：	1.8 V	表面贴装：	YES
技术：	CMOS	温度等级：	AUTOMOTIVE
端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	触发器类型：	POSITIVE EDGE
宽度：	5.3 mm	最小 fmax：	150 MHz
Base Number Matches：	1

74LVC273DB,112 数据手册

74LVC273

Octal D-type flip-flop with reset; positive-edge trigger

Rev. 6 — 31 December 2012

Product data sheet

1. General description

The 74LVC273 has eight edge-triggered, D-type flip-flops with individual Dn inputs and

Qn outputs. The common clock (CP) and master reset (MR) inputs load and reset (clear)

all flip-flops simultaneously. The state of each Dn input, one set-up time before the

LOW-to-HIGH clock transition, is transferred to the corresponding output (Qn) of the

flip-flop. All outputs will be forced LOW independently of clock or data inputs by a LOW

voltage level on the MR input.

The device is useful for applications where the true output only is required and the clock

and master reset are common to all storage elements.

2. Features and benefits

 Wide supply voltage range from 1.2 V to 3.6 V

 Inputs accept voltages up to 5.5 V

 CMOS low power consumption

 Direct interface with TTL levels

 Output drive capability 50  transmission lines at +85 C

 Complies with JEDEC standard:

 JESD8-7A (1.65 V to 1.95 V)

 JESD8-5A (2.3 V to 2.7 V)

 JESD8-C/JESD36 (2.7 V to 3.6 V)

 ESD protection:

 HBM JESD22-A114F exceeds 2000 V

 MM JESD22-A115-B exceeds 200 V

 CDM JESD22-C101E exceeds 1000 V

 Specified from 40 C to +85 C and 40 C to +125 C

12 3 4 5 6 7...17

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型号	品牌	替代类型	描述	数据表
74LVC273DB,118	NXP	完全替代	74LVC273 - Octal D-type flip-flop with reset; positive-edge trigger SSOP2 20-Pin
74LVC273DB	NXP	完全替代	Octal D-type flip-flop with reset; positive-edge trigger

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型号	品牌	获取价格	描述	数据表
74LVC273DB,118	NXP	获取价格	74LVC273 - Octal D-type flip-flop with reset; positive-edge trigger SSOP2 20-Pin
74LVC273DB-T	NXP	获取价格	IC LVC/LCX/Z SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO20, PLASTIC, SO
74LVC273D-Q100	NEXPERIA	获取价格	Octal D-type flip-flop with reset; positive-edge trigger
74LVC273D-T	NXP	获取价格	IC LVC/LCX/Z SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO20, 7.50 MM, PL
74LVC273PW	NXP	获取价格	Octal D-type flip-flop with reset; positive-edge trigger
74LVC273PW	NEXPERIA	获取价格	Octal D-type flip-flop with reset; positive-edge triggerProduction
74LVC273PW,112	NXP	获取价格	74LVC273 - Octal D-type flip-flop with reset; positive-edge trigger TSSOP2 20-Pin
74LVC273PW,118	NXP	获取价格	74LVC273 - Octal D-type flip-flop with reset; positive-edge trigger TSSOP2 20-Pin
74LVC273PWDH	NXP	获取价格	Octal D-type flip-flop with reset; positive-edge trigger
74LVC273PWDH-T	NXP	获取价格	IC LVC/LCX/Z SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO20, FF/Latch

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