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74HC390D

更新时间： 2024-11-29 11:11:51
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安世 - NEXPERIA 光电二极管逻辑集成电路触发器
页数 文件大小 规格书
15页 253K
描述
Dual decade ripple counterProduction

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74HC390D 技术参数

是否Rohs认证： 符合生命周期：Active
包装说明：SOP,Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：2.19
Is Samacsys：N其他特性：DIVIDE BY 2 AND DIVIDE BY 5 FUNCTIONS
计数方向：UP系列：HC/UH
JESD-30 代码：R-PDSO-G16JESD-609代码：e4
长度：9.9 mm负载/预设输入：YES
逻辑集成电路类型：DECADE COUNTER工作模式：ASYNCHRONOUS
湿度敏感等级：1位数：3
功能数量：4端子数量：16
最高工作温度：125 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：260传播延迟（tpd）：63 ns
座面最大高度：1.75 mm最大供电电压 (Vsup)：6 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：AUTOMOTIVE端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
触发器类型：NEGATIVE EDGE宽度：3.9 mm
最小 fmax：20 MHzBase Number Matches：1

74HC390D 数据手册

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74HC390; 74HCT390  
Dual decade ripple counter  
Rev. 5 — 18 October 2021  
Product data sheet  
1. General description  
The 74HC390; 74HCT390 is a dual 4-bit decade ripple counter divided into four separately clocked  
sections. The counters have two divide-by-2 sections and two divide-by-5 sections. These sections  
share an asynchronous master reset input (nMR) and can be used in a BCD decade or bi-quinary  
configuration. If master reset inputs (1MR and 2MR) are used to simultaneously clear all 8 bits of  
the counter, a number of counting configurations are possible within one package. The separate  
clocks (nCP0 and nCP1) of each section allow ripple counter or frequency division applications of  
divide-by-2, 4, 5, 10, 20, 25, 50 or 100. Each section is triggered by the HIGH-to-LOW transition  
of the clock inputs (nCP0 and nCP1). For BCD decade operation, the nQ0 output is connected  
to the nCP1 input of the divide-by-5 section. For bi-quinary decade operation, the nQ3 output is  
connected to the nCP0 input and nQ0 becomes the decade output. A HIGH on the nMR input  
overrides the clocks and sets the four outputs LOW. This device features reduced input threshold  
levels to allow interfacing to TTL logic levels. Inputs also include clamp diodes, this enables the use  
of current limiting resistors to interface inputs to voltages in excess of VCC  
.
2. Features and benefits  
•
Input levels:  
•
•
For 74HC390: CMOS level  
For 74HCT390: TTL level  
•
•
•
•
•
•
•
•
Two BCD decade or bi-quinary counters  
One device can be configured to divide-by-2, 4, 5, 10, 20, 25, 50 or 100  
Two master reset inputs to clear each decade counter individually  
Supply voltage range from 4.5 V to 5.5 V  
High noise immunity  
Latch-up performance exceeds 100 mA per JESD 78 Class II Level B  
Complies with JEDEC standard JESD7A (4.5 V to 5.5 V)  
ESD protection:  
•
•
HBM JESD22-A114F exceeds 2000 V  
MM JESD22-A115-A exceeds 200 V  
•
Specified from -40 °C to +85 °C and from -40 °C to +125 °C  
3. Ordering information  
Table 1. Ordering information  
Type number  
Package  
Temperature range Name  
Description  
Version  
74HC390D  
-40 °C to +125 °C  
-40 °C to +125 °C  
SO16  
plastic small outline package; 16 leads;  
body width 3.9 mm  
SOT109-1  
74HCT390D  
74HC390PW  
74HCT390PW  
TSSOP16 plastic thin shrink small outline package; 16 leads;  
body width 4.4 mm  
SOT403-1  
 
 
 
 
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74HC390D 替代型号

型号 品牌 替代类型 描述 数据表
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