5秒后页面跳转
捷配首页

Datasheet > 72235LB15PFG8
72235LB15PFG8 PDF预览

72235LB15PFG8

更新时间： 2024-10-31 18:56:03
品牌 Logo 应用领域
艾迪悌 - IDT 先进先出芯片内存集成电路
页数 文件大小 规格书
16页 333K
描述
FIFO, 2KX18, 10ns, Synchronous, CMOS, PQFP64, GREEN, PLASTIC, TQFP-64

阅读下载

中文翻译

获取价格

72235LB15PFG8 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：QFP
包装说明：TQFP-64针数：64
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.32.00.71风险等级：5.36
最长访问时间：10 ns周期时间：15 ns
JESD-30 代码：R-PQFP-G64JESD-609代码：e3
内存密度：36864 bit内存集成电路类型：OTHER FIFO
内存宽度：18湿度敏感等级：3
功能数量：1端子数量：64
字数：2048 words字数代码：2000
工作模式：SYNCHRONOUS最高工作温度：70 °C
最低工作温度：组织：2KX18
可输出：YES封装主体材料：PLASTIC/EPOXY
封装形状：RECTANGULAR并行/串行：PARALLEL
峰值回流温度（摄氏度）：260认证状态：Not Qualified
最大待机电流：0.005 A最大压摆率：0.06 mA
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Matte Tin (Sn)端子形式：GULL WING
端子位置：QUAD处于峰值回流温度下的最长时间：30
Base Number Matches：1

72235LB15PFG8 数据手册

 浏览型号72235LB15PFG8的Datasheet PDF文件第2页浏览型号72235LB15PFG8的Datasheet PDF文件第3页浏览型号72235LB15PFG8的Datasheet PDF文件第4页浏览型号72235LB15PFG8的Datasheet PDF文件第5页浏览型号72235LB15PFG8的Datasheet PDF文件第6页浏览型号72235LB15PFG8的Datasheet PDF文件第7页 
CMOS SyncFIFOTM  
256 x 18, 512 x 18, 1,024 x 18,  
2,048 x 18, and 4,096 x 18  
IDT72205LB, IDT72215LB,  
IDT72225LB, IDT72235LB,  
IDT72245LB  
writecontrols.TheseFIFOsareapplicableforawidevarietyofdatabuffering  
needs, such as optical disk controllers, Local Area Networks (LANs), and  
interprocessorcommunication.  
FEATURES:  
• 256 x 18-bit organization array (IDT72205LB)  
• 512 x 18-bit organization array (IDT72215LB)  
• 1,024 x 18-bit organization array (IDT72225LB)  
• 2,048 x 18-bit organization array (IDT72235LB)  
• 4,096 x 18-bit organization array (IDT72245LB)  
• 10 ns read/write cycle time  
TheseFIFOshave18-bitinputandoutputports.Theinputportiscontrolled  
byafree-runningclock(WCLK),andaninputenablepin(WEN).Dataisread  
intothesynchronousFIFOoneveryclockwhenWENisasserted.Theoutput  
portiscontrolledbyanotherclockpin(RCLK)andanotherenablepin(REN).  
Thereadclockcanbetiedtothewriteclockforsingleclockoperationorthe  
twoclockscanrunasynchronousofoneanotherfordual-clockoperation. An  
OutputEnablepin(OE)isprovidedonthereadportforthree-statecontrolof  
theoutput.  
ThesynchronousFIFOshavetwofixedflags, Empty (EF)andFull(FF),  
andtwoprogrammableflags,Almost-Empty(PAE)andAlmost-Full(PAF).The  
offsetloadingoftheprogrammableflagsiscontrolledbyasimplestatemachine,  
andisinitiatedbyassertingtheLoadpin(LD). AHalf-Fullflag(HF)isavailable  
when the FIFO is used in a single device configuration.  
ThesedevicesaredepthexpandableusingaDaisy-Chaintechnique.The  
XI and XO pins are used to expand the FIFOs. In depth expansion configu-  
ration, First Load (FL) is grounded on the first device and set to HIGH for all  
other devices in the Daisy Chain.  
The IDT72205LB/72215LB/72225LB/72235LB/72245LB is fabricated  
usinghigh-speedsubmicronCMOStechnology.  
• Empy and Full flags signal FIFO status  
• Easy expandable in depth and width  
• Asynchronous or coincident read and write clocks  
• Programmable Almost-Empty and Almost-Full flags with  
default settings  
• Half-Full flag capability  
• Dual-Port zero fall-through time architecture  
• Output enable puts output data bus in high-impedence state  
• High-performance submicron CMOS technology  
• Available in a 64-lead thin quad flatpack (TQFP/STQFP)  
and plastic leaded chip carrier (PLCC)  
• Industrial temperature range (–40°C to +85°C) is available  
• Green parts available, see ordering information  
DESCRIPTION:  
The IDT72205LB/72215LB/72225LB/72235LB/72245LB are very high  
speed,low-powerFirst-In,First-Out(FIFO)memorieswithclockedreadand  
FUNCTIONAL BLOCK DIAGRAM  
WCLK  
D0-D17  
INPUT REGISTER  
OFFSET REGISTER  
FLAG  
WRITE CONTROL  
LOGIC  
•
•
LOGIC  
RAM ARRAY  
256 x 18, 512 x 18  
1,024 x 18, 2,048 x 18  
4,096 x 18  
)
READ POINTER  
WRITE POINTER  
•
•
READ CONTROL  
LOGIC  
EXPANSION LOGIC  
OUTPUT REGISTER  
RESET LOGIC  
2766 drw 01  
RCLK  
Q0-Q17  
IDTandtheIDTlogoareregisteredtrademarksofIntegratedDeviceTechnology, Inc. SyncFIFOisatrademarkofIntegratedDeviceTechnology, Inc.  
MARCH 2013  
COMMERCIAL AND INDUSTRIAL TEMPERATURE RANGES  
1
©2013 Integrated Device Technology, Inc. All rights reserved. Product specifications subject to change without notice.  
DSC-2766/3  
1234567...16

中文翻译

下载PDF

与72235LB15PFG8相关器件

型号 品牌 获取价格 描述 数据表
72235LB15PFGI IDT

获取价格

 		CMOS SyncFIFO
72235LB15PFGI8 IDT

获取价格

 		CMOS SyncFIFO
72235LB15PFI9 IDT

获取价格

 		FIFO, 2KX18, 10ns, Synchronous, CMOS, PQFP64, PLASTIC, TQFP-64
72235LB15TF9 IDT

获取价格

 		FIFO, 2KX18, 10ns, Synchronous, CMOS, PQFP64, PLASTIC, STQFP-64
72235LB15TFG IDT

获取价格

 		FIFO, 2KX18, 10ns, Synchronous, CMOS, PQFP64, GREEN, PLASTIC, STQFP-64
72235LB15TFG8 IDT

获取价格

 		FIFO, 2KX18, 10ns, Synchronous, CMOS, PQFP64, GREEN, PLASTIC, STQFP-64
72235LB15TFGI IDT

获取价格

 		CMOS SyncFIFO
72235LB15TFGI8 IDT

获取价格

 		CMOS SyncFIFO
72235LB15TFI9 IDT

获取价格

 		FIFO, 2KX18, 10ns, Synchronous, CMOS, PQFP64, PLASTIC, STQFP-64
72235LB25J IDT

获取价格

 		PLCC-68, Tube

与72235LB15PFG8相关文章

您还可以找


热门产品
PCB打样/小批量
铝基板
BOM智能配单
PCBA制造
钣金
精密CNC
模具注塑
薄膜开关
精选活动
PCBA打样特惠
四六层板品质升级
铝基板品质升级
一体化电子制造
DFM下载
服务支持
企业认证
产品展示
工厂展示
工艺能力
积分商城
关于捷配
捷配简介
企业文化
公司动态
人才招聘
联系我们
帮助中心
下单流程
付款流程
开票流程
常见问题
全球PCB制造服务专线 400-613-0088

工作时间：9:00-21:00

CEO邮箱：ceo@jiepei.com

投诉邮箱：tousu@jiepei.com

捷配网-微信公众号 微信公众号
捷配网-微信公众号 抖音公众号
资质认证：
合作快递：
支付方式：
Copyright © 2024 Jiepei.com Inc. All Rights Reserved. 版权所有:杭州捷配信息科技有限公司 浙公网安备 33010502006866号 浙ICP备10014259号-119 营业执照ICP证