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7015S17PFG

更新时间： 2024-10-30 18:20:47

品牌	Logo	应用领域
艾迪悌 - IDT		静态存储器内存集成电路
页数	文件大小	规格书
20页	178K
描述
Dual-Port SRAM, 8KX9, 17ns, CMOS, PQFP80, 14 X 14 MM, 1.40 MM HEIGHT, GREEN, TQFP-80

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7015S17PFG 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	LQFP, QFP80,.64SQ	针数：	80
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.32.00.41	风险等级：	5.77
最长访问时间：	17 ns	其他特性：	INTERRUPT FLAG; SEMAPHORE; AUTOMATIC POWER-DOWN
I/O 类型：	COMMON	JESD-30 代码：	S-PQFP-G80
JESD-609代码：	e3	长度：	14 mm
内存密度：	73728 bit	内存集成电路类型：	DUAL-PORT SRAM
内存宽度：	9	湿度敏感等级：	3
功能数量：	1	端口数量：	2
端子数量：	80	字数：	8192 words
字数代码：	8000	工作模式：	ASYNCHRONOUS
最高工作温度：	70 °C	最低工作温度：
组织：	8KX9	输出特性：	3-STATE
封装主体材料：	PLASTIC/EPOXY	封装代码：	LQFP
封装等效代码：	QFP80,.64SQ	封装形状：	SQUARE
封装形式：	FLATPACK, LOW PROFILE	并行/串行：	PARALLEL
峰值回流温度（摄氏度）：	260	电源：	5 V
认证状态：	Not Qualified	座面最大高度：	1.6 mm
最大待机电流：	0.015 A	最小待机电流：	4.5 V
子类别：	SRAMs	最大压摆率：	0.31 mA
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	Matte Tin (Sn) - annealed	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	30	宽度：	14 mm
Base Number Matches：	1

7015S17PFG 数据手册

IDT7015S/L

HIGH-SPEED

8K x 9 DUAL-PORT

STATIC RAM

Features:

◆

M/S = VIH for BUSY output flag on Master

M/S = VIL for BUSY input on Slave

Busy and Interrupt Flag

On-chip port arbitration logic

Full on-chip hardware support of semaphore signaling

between ports

Fully asynchronous operation from either port

TTL-compatible, single 5V (±10%) power supply

Available in ceramic 68-pin PGA, 68-pin PLCC, and an 80-

pin TQFP

Industrial temperature range (–40°C to +85°C) is available

for selected speeds

True Dual-Ported memory cells which allow simultaneous

reads of the same memory location

High-speed access

◆

– Commercial:12/15/17/20/25/35ns(max.)

– Industrial:20ns (max.)

– Military:20/25/35ns(max.)

Low-power operation

◆

– IDT7015S

Active:750mW(typ.)

Standby: 5mW (typ.)

– IDT7015L

◆

Active:750mW(typ.)

Standby: 1mW (typ.)

Green parts available, see ordering information

◆

IDT7015 easily expands data bus width to 18 bits or more

using the Master/Slave select when cascading more than

one device

FunctionalBlockDiagram

OEL

OER

CER

CEL

R/WR

R/W

I/O0L- I/O8L

I/O0R-I/O8R

I/O

Control

BUSY_L^(1,2)

(1,2)

BUSY

12L

12R

Address

Decoder

MEMORY

ARRAY

Address

Decoder

ARBITRATION

INTERRUPT

SEMAPHORE

LOGIC

R/W

SEM

M/S

(2)

INTL

INTR

2954 drw 01

NOTES:

1. In MASTER mode: BUSY is an output and is a push-pull driver

In SLAVE mode: BUSY is input.

2. BUSY outputs and INT outputs are non-tri-stated push-pull drivers.

OCTOBER 2008

DSC 2954/8

12 3 4 5 6 7...20

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型号	品牌	获取价格	描述	数据表
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7015S20GG	IDT	获取价格	Dual-Port SRAM, 8KX9, 20ns, CMOS, CPGA68, 1.18 X 1.18 INCH, 0.16 INCH HEIGHT, GREEN, CERAM
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