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5962-01-159-2685

更新时间： 2024-09-17 19:48:07
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD 驱动光电二极管逻辑集成电路
页数 文件大小 规格书
4页 46K
描述
Bus Driver, 2-Func, 4-Bit, True Output, TTL, PDIP20,

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5962-01-159-2685 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：ObsoleteReach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.46
控制类型：ENABLE LOW/HIGHJESD-30 代码：R-PDIP-T20
逻辑集成电路类型：BUS DRIVER最大I（ol）：0.064 A
湿度敏感等级：1位数：4
功能数量：2端子数量：20
最高工作温度：70 °C最低工作温度：
输出特性：3-STATE输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：DIP
封装等效代码：DIP20,.3封装形状：RECTANGULAR
封装形式：IN-LINE峰值回流温度（摄氏度）：225
电源：5 V最大电源电流（ICC）：180 mA
Prop。Delay @ Nom-Sup：9 ns认证状态：Not Qualified
子类别：Bus Driver/Transceivers标称供电电压 (Vsup)：5 V
表面贴装：NO技术：TTL
温度等级：COMMERCIAL端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIEDBase Number Matches：1

5962-01-159-2685 数据手册

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August 1986  
Revised May 2000  
DM74S240 • DM74S241 • DM74S244  
Octal 3-STATE Buffer/Line Driver/Line Receiver  
General Description  
Features  
These buffers/line drivers are designed to improve both the  
performance and PC board density of 3-STATE buffers/  
drivers employed as memory-address drivers, clock driv-  
ers, and bus-oriented transmitters/receivers. Featuring 400  
mV of hysteresis at each low current PNP data line input,  
they provide improved noise rejection and high fanout out-  
puts, and can be used to drive terminated lines down to  
133Ω.  
■ 3-STATE outputs drive bus lines directly  
■ PNP inputs reduce DC loading on bus lines  
■ Hysteresis at data inputs improves noise margins  
■ Typical IOL (sink current)  
64 mA  
■ Typical IOH (source current) −15 mA  
■ Typical propagation delay times  
Inverting  
4.5 ns  
Noninverting 6 ns  
■ Typical enable/disable times 9 ns  
■ Typical power dissipation (enabled)  
Inverting  
450 mW  
Noninverting 538 mW  
Ordering Code:  
Order Number Package Number  
Package Description  
DM74S240N  
DM74S241N  
DM74S244N  
N20A  
N20A  
N20A  
20-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300 Wide  
20-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300 Wide  
20-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300 Wide  
Connection Diagrams  
DM74S241N  
DM74S240N  
DM74S244N  
© 2000 Fairchild Semiconductor Corporation  
DS006478  
www.fairchildsemi.com  
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