5秒后页面跳转
捷配首页

Datasheet > 3D7105H-1.5
3D7105H-1.5 PDF预览

3D7105H-1.5

更新时间： 2024-11-06 03:03:55
品牌 Logo 应用领域
DATADELAY /
页数 文件大小 规格书
4页 36K
描述
MONOLITHIC 5-TAP FIXED DELAY LINE (SERIES 3D7105)

阅读下载

中文翻译

获取价格

3D7105H-1.5 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Not Recommended零件包装代码：SOIC
包装说明：SOP,针数：8
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.64系列：3D
输入频率最大值（fmax）：30.3 MHzJESD-30 代码：R-PDSO-G8
长度：9.46 mm逻辑集成电路类型：SILICON DELAY LINE
功能数量：1抽头/阶步数：5
端子数量：8最高工作温度：70 °C
最低工作温度：输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：NOT SPECIFIED可编程延迟线：NO
认证状态：Not Qualified座面最大高度：4.59 mm
最大供电电压 (Vsup)：5.25 V最小供电电压 (Vsup)：4.75 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子形式：GULL WING端子节距：2.54 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
总延迟标称（td）：11 ns宽度：6.35 mm
Base Number Matches：1

3D7105H-1.5 数据手册

 浏览型号3D7105H-1.5的Datasheet PDF文件第2页浏览型号3D7105H-1.5的Datasheet PDF文件第3页浏览型号3D7105H-1.5的Datasheet PDF文件第4页 
3D7105  
Ò
MONOLITHIC 5-TAP  
FIXED DELAY LINE  
(SERIES 3D7105)  
data  
delay  
3
devices, inc.  
FEATURES  
PACKAGES  
IN  
O2  
O4  
1
2
3
4
8
7
6
5
VDD  
O1  
O3  
·
·
·
All-silicon, low-power CMOS  
technology  
TTL/CMOS compatible  
inputs and outputs  
Vapor phase, IR and wave  
solderable  
Auto-insertable (DIP pkg.)  
Low ground bounce noise  
IN  
O2  
VDD  
IN  
N/C  
N/C  
O2  
VDD  
N/C  
O1  
1
2
3
4
8
7
6
5
1
2
3
4
5
6
7
14  
13  
12  
11  
10  
9
O1  
O3  
O5  
GND  
O5  
O4  
3D7105Z  
SOIC  
(150 Mil)  
GND  
N/C  
O3  
N/C  
O4  
3D7105M DIP  
3D7105H Gull-Wing  
(300 Mil)  
·
·
·
·
·
·
·
·
·
N/C  
O5  
GND  
8
Leading- and trailing-edge accuracy  
Delay range: .75 through 80ns  
Delay tolerance: 5% or 1ns  
Temperature stability: ±3% typical (0C-70C)  
Vdd stability: ±1% typical (4.75V-5.25V)  
Minimum input pulse width: 30% of total delay  
14-pin DIP and 16-pin SOIC available as drop-in  
replacements for hybrid delay lines  
3D7105 DIP  
IN  
N/C  
N/C  
O2  
N/C  
O4  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
11  
10  
9
VDD  
N/C  
N/C  
O1  
N/C  
O3  
3D7105G Gull-Wing  
3D7105K Unused pins  
removed  
(300 Mil)  
N/C  
GND  
N/C  
O5  
3D7105S SOIC  
(300 Mil)  
PIN DESCRIPTIONS  
FUNCTIONAL DESCRIPTION  
IN  
Delay Line Input  
The 3D7105 5-Tap Delay Line product family consists of fixed-delay  
CMOS integrated circuits. Each package contains a single delay line,  
tapped and buffered at 5 points spaced uniformly in time. Tap-to-tap  
(incremental) delay values can range from 0.75ns through 8.0ns. The  
input is reproduced at the outputs without inversion, shifted in time as per  
the user-specified dash number. The 3D7105 is TTL- and CMOS-  
compatible, capable of driving ten 74LS-type loads, and features both  
rising- and falling-edge accuracy.  
O1  
O2  
O3  
O4  
O5  
Tap 1 Output (20%)  
Tap 2 Output (40%)  
Tap 3 Output (60%)  
Tap 4 Output (80%)  
Tap 5 Output (100%)  
VCC +5 Volts  
GND Ground  
N/C No Connection  
The all-CMOS 3D7105 integrated circuit has been designed as a reliable,  
economic alternative to hybrid TTL fixed delay lines. It is offered in a standard 8-pin auto-insertable DIP  
and a space saving surface mount 8-pin SOIC.  
TABLE 1: PART NUMBER SPECIFICATIONS  
PART NUMBER  
TOLERANCES  
INPUT RESTRICTIONS  
DIP-8  
3D7105M  
3D7105H  
SOIC-8  
3D7105Z  
DIP-14  
3D7105  
3D7105G  
3D7105K  
SOIC-16  
3D7105S  
TOTAL  
DELAY (ns)  
TAP-TAP  
DELAY  
(ns)  
Max  
Operating  
Frequency  
Absolute  
Max  
Oper. Freq.  
Min  
Operating  
Pulse Width  
Absolute  
Min  
Oper. P.W.  
-.75  
-1  
-1.5  
-2  
-2.5  
-4  
-5  
-.75  
-1  
-1.5  
-2  
-2.5  
-4  
-5  
-.75  
-1  
-1.5  
-2  
-2.5  
-4  
-5  
-.75  
-1  
-1.5  
-2  
-2.5  
-4  
-5  
41.7 MHz  
37.0 MHz  
30.3 MHz  
25.6 MHz  
22.2 MHz  
15.9 MHz  
13.3 MHz  
9.52 MHz  
166.7 MHz  
166.7 MHz  
166.7 MHz  
166.7 MHz  
133.3 MHz  
83.3 MHz  
66.7 MHz  
41.7 MHz  
12.0 ns  
13.5 ns  
16.5 ns  
19.5 ns  
22.5 ns  
31.5 ns  
37.5 ns  
52.5 ns  
3.00 ns  
3.00 ns  
3.00 ns  
3.00 ns  
3.75 ns  
6.00 ns  
7.50 ns  
12.0 ns  
3.0 ± 1.0*  
4.0 ± 1.0*  
6.0 ± 1.0*  
8.0 ± 1.0*  
10.0 ± 1.0*  
16.0 ± 1.0*  
25.0 ± 1.3  
40.0 ± 2.0  
0.75 ± 0.4  
1.0 ± 0.5  
1.5 ± 0.7  
2.0 ± 0.8  
2.5 ± 1.0  
4.0 ± 1.3  
5.0 ± 1.5  
8.0 ± 1.5  
-8  
-8  
-8  
-8  
* Total delay referenced to Tap1 output; Input-to-Tap1 = 5.0ns ± 1.0ns  
NOTE: Any dash number between .75 and 8 not shown is also available.  
Ó1996 Data Delay Devices  
Doc #96006  
12/2/96  
DATA DELAY DEVICES, INC.  
3 Mt. Prospect Ave. Clifton, NJ 07013  
1
1234

中文翻译

下载PDF

与3D7105H-1.5相关器件

型号 品牌 获取价格 描述 数据表
3D7105H2 ETC

获取价格

 		Logic IC
3D7105H-2 DATADELAY

获取价格

 		MONOLITHIC 5-TAP FIXED DELAY LINE (SERIES 3D7105)
3D7105H2.5 ETC

获取价格

 		Logic IC
3D7105H-2.5 DATADELAY

获取价格

 		MONOLITHIC 5-TAP FIXED DELAY LINE (SERIES 3D7105)
3D7105H4 ETC

获取价格

 		Logic IC
3D7105H-4 DATADELAY

获取价格

 		MONOLITHIC 5-TAP FIXED DELAY LINE (SERIES 3D7105)
3D7105H5 ETC

获取价格

 		Logic IC
3D7105H-5 DATADELAY

获取价格

 		MONOLITHIC 5-TAP FIXED DELAY LINE (SERIES 3D7105)
3D7105H8 ETC

获取价格

 		Logic IC
3D7105H-8 DATADELAY

获取价格

 		MONOLITHIC 5-TAP FIXED DELAY LINE (SERIES 3D7105)

与3D7105H-1.5相关文章

您还可以找


热门产品
PCB打样/小批量
铝基板
BOM智能配单
PCBA制造
钣金
精密CNC
模具注塑
薄膜开关
精选活动
PCBA打样特惠
四六层板品质升级
铝基板品质升级
一体化电子制造
DFM下载
服务支持
企业认证
产品展示
工厂展示
工艺能力
积分商城
关于捷配
捷配简介
企业文化
公司动态
人才招聘
联系我们
帮助中心
下单流程
付款流程
开票流程
常见问题
全球PCB制造服务专线 400-613-0088

工作时间：9:00-21:00

CEO邮箱：ceo@jiepei.com

投诉邮箱：tousu@jiepei.com

捷配网-微信公众号 微信公众号
捷配网-微信公众号 抖音公众号
资质认证：
合作快递：
支付方式：
Copyright © 2024 Jiepei.com Inc. All Rights Reserved. 版权所有:杭州捷配信息科技有限公司 浙公网安备 33010502006866号 浙ICP备10014259号-119 营业执照ICP证