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23S08E-2DCI8

更新时间： 2024-09-17 14:46:15

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艾迪悌 - IDT		驱动光电二极管逻辑集成电路
页数	文件大小	规格书
11页	78K
描述
PLL Based Clock Driver, 23S Series, 8 True Output(s), 0 Inverted Output(s), PDSO16, SOIC-16

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23S08E-2DCI8 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	SOIC	包装说明：	SOP, SOP16,.25
针数：	16	Reach Compliance Code：	not_compliant
HTS代码：	8542.39.00.01	风险等级：	5.73
Is Samacsys：	N	系列：	23S
输入调节：	STANDARD	JESD-30 代码：	R-PDSO-G16
JESD-609代码：	e0	逻辑集成电路类型：	PLL BASED CLOCK DRIVER
最大I（ol）：	0.008 A	湿度敏感等级：	1
功能数量：	1	反相输出次数：
端子数量：	16	实输出次数：	8
最高工作温度：	85 °C	最低工作温度：	-40 °C
输出特性：	3-STATE	封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装等效代码：	SOP16,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
峰值回流温度（摄氏度）：	240	电源：	3.3 V
认证状态：	Not Qualified	Same Edge Skew-Max（tskwd）：	0.4 ns
子类别：	Clock Drivers	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	3 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	Tin/Lead (Sn85Pb15)	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	20	最小 fmax：	200 MHz
Base Number Matches：	1

23S08E-2DCI8 数据手册

IDT23S08E

3.3VZERODELAYCLOCKMULTIPLIER

COMMERCIALANDINDUSTRIALTEMPERATURERANGES

ZERO DELAY AND SKEW CONTROL

To close the feedback loop of the IDT23S08E, the FBK pin can be driven from any of the eight available output pins. The output driving the FBK pin

willbedrivingatotalloadof7pFplusanyadditionalloadthatitdrives. Therelativeloadingofthisoutput(withrespecttotheremainingoutputs)canadjust

theinput-outputdelay.

Forapplicationsrequiringzeroinput-outputdelay, alloutputsincludingtheoneprovidingfeedbackshouldbeequallyloaded. Ensuretheoutputsare

loaded equally, for zero output-output skew.

OPERATINGCONDITIONS-COMMERCIAL

Symbol

Parameter

Test Conditions

Min.

Max.

3.6

Unit

VDD

SupplyVoltage

OperatingTemperature(AmbientTemperature)

LoadCapacitancebelow100MHz

LoadCapacitancefrom100MHzto200MHz

InputCapacitance⁽¹⁾

°C

—

CIN

NOTE:

1. Applies to both REF and FBK.

DCELECTRICALCHARACTERISTICS-COMMERCIAL

Symbol

VIL

Parameter

Conditions

Min.

—

Typ.⁽¹⁾

—

Max.

0.8

—

Unit

InputLOWVoltageLevel

Input HIGH Voltage Level

InputLOWCurrent

Input HIGH Current

OutputLOWVoltage

VIH

—

IIL

VIN = 0V

—

µA

IIH

VIN = VDD

—

100

0.4

VOL

IOL = 8mA (-1, -2, -3, -4)

—

IOL = 12mA (-1H, -2H, -5H)

IOH = -8mA (-1, -2, -3, -4)

IOH = -12mA (-1H, -2H, -5H)

REF = 0MHz (S2 = S1 = H)

VOH

Output HIGH Voltage

Power Down Current

2.4

—

IDD_PD

—

µA

100MHz CLKA (-1, -2, -3, -4)

100MHz CLKA (-1H, -2H, -5H)

66MHz CLKA (-1, -2, -3, -4)

66MHz CLKA (-1H, -2H, -5H)

33MHz CLKA (-1, -2, -3, -4)

33MHz CLKA (-1H, -2H, -5H)

IDD

SupplyCurrent

UnloadedOutputs

Select Inputs at VDD or GND

1 2 345 6 7...11

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