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XC56F827FG80 PDF预览

XC56F827FG80

更新时间： 2024-11-07 19:53:47
品牌 Logo 应用领域
摩托罗拉 - MOTOROLA 时钟外围集成电路
页数 文件大小 规格书
52页 879K
描述
16-BIT, 80MHz, OTHER DSP, PQFP128, LQFP-128

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XC56F827FG80 技术参数

生命周期：Obsolete包装说明：LFQFP,
Reach Compliance Code：unknownECCN代码：3A001.A.3
HTS代码：8542.31.00.01风险等级：5.84
其他特性：ALSO REQUIRES 3.3V SUPPLY地址总线宽度：16
桶式移位器：YES边界扫描：YES
最大时钟频率：80 MHz外部数据总线宽度：16
格式：FIXED POINT内部总线架构：MULTIPLE
JESD-30 代码：R-PQFP-G128长度：20 mm
低功率模式：YES端子数量：128
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：LFQFP
封装形状：RECTANGULAR封装形式：FLATPACK, LOW PROFILE, FINE PITCH
认证状态：Not Qualified座面最大高度：1.6 mm
最大供电电压：2.75 V最小供电电压：2.25 V
标称供电电压：2.5 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD宽度：14 mm
uPs/uCs/外围集成电路类型：DIGITAL SIGNAL PROCESSOR, OTHERBase Number Matches：1

XC56F827FG80 数据手册

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DSP56F827/D  
Rev. 3.0, 1/2002  
DSP56F827  
Preliminary Technical Data  
DSP56F827 16-bit Digital Signal Processor  
•
Up to 40 MIPS at 80 MHz core frequency  
•
MCU-friendly instruction set supports both DSP and  
controller functions: MAC, bit manipulation unit, 14  
addressing modes  
•
DSP and MCU functionality in a unified,  
C-efficient architecture  
•
•
•
•
•
•
•
•
8-channel Programmable Chip Select  
10-channel, 12-bit ADC  
•
•
•
•
•
•
Hardware DO and REP loops  
64K × 16-bit words Program Flash  
1K × 16-bit words Program RAM  
4K × 16-bit words Data Flash  
4K × 16-bit words Data RAM  
Synchronous Serial Interface (SSI)  
Serial Port Interface (SPI)  
Serial Communications Interface (SCI)  
Time-of-Day (TOD) Timer  
Up to 64K × 16-bit words external memory  
expansion each for Program and Data memory  
128-pin LQFP Package  
•
•
JTAG/OnCE™ for debugging  
General Purpose Quad Timer  
16-dedicated and 48 shared GPIO  
EXTBOOT  
DEBUG  
IRQB  
IRQA  
RESET  
V
5
V
5
V
V
2
V
SSA  
V
DDIO  
SSIO  
DD  
SS  
DDA  
6
3
2
4
inputs  
10  
JTAG/  
OnCE  
Port  
Low Voltage Supervisor  
Analog Reg  
ADC  
V
, V  
,
REFP REFMID  
V
REFIN  
3
Interrupt  
Data ALU  
Bit  
Manipulation  
Unit  
Controller  
Program Controller  
and Hardware  
Looping Unit  
Address  
Generation  
Unit  
V
REFLO  
16 x 16 + 36 → 36-Bit MAC  
Three 16-bit Input Registers  
Two 36-bit Accumulators  
V
REFHI  
Program and Boot  
Memory  
64512 x 16 Flash  
1024 x 16 SRAM  
PAB  
PDB  
16-Bit  
DSP56800  
Core  
CLKO  
PLL  
Quad Timer A/  
or GPIO  
4
VPP  
XDB2  
CGDB  
XAB1  
XAB2  
Clock  
Gen  
XTAL  
Data Memory  
4096 x 16 Flash  
4096 x 16 SRAM  
SCI 2 or  
GPIO  
EXTAL  
2
6
INTERRUPT  
IPBB  
CONTROLS  
CONTROLS  
SSI 0 or  
GPI0  
16  
16  
External  
Address Bus  
Switch  
A[00:15]  
or  
GPIOA16[00:16]  
COP  
RESET  
SCI 0 &1 or  
SPI 0  
External  
Bus  
Interface  
Unit  
COP/  
Watchdog  
16  
16  
4
MODULE  
CONTROLS  
SPI 1 or  
GPIO  
IPBus Bridge  
(IPBB)  
Application-  
Specific  
Memory &  
Peripherals  
D[00:15]  
or  
GPIOG16[00:16]  
External  
Data Bus  
Switch  
4
6
ADDRESS  
BUS [8:0]  
PCS [2:7}  
Programmable  
Chip Select  
PS or PCS[0]  
DS or PCS[1]  
WR  
Bus  
Control  
Dedicated  
GPIO  
DATA  
BUS [15:0]  
TOD  
Timer  
16  
RD  
Figure 1. DSP56F827 Block Diagram  
© Motorola, Inc., 2002. All rights reserved.  
1234567...52

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型号 品牌 获取价格 描述 数据表
XC56L307VF160 FREESCALE

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 		Board Euro Connector
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