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XA95144XL-15CSG144I

更新时间： 2024-01-20 08:16:22
品牌 Logo 应用领域
赛灵思 - XILINX 输入元件可编程逻辑
页数 文件大小 规格书
11页 234K
描述
Flash PLD, 15.5ns, CMOS, PBGA144, CSP-144

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XA95144XL-15CSG144I 技术参数

是否Rohs认证： 符合生命周期：Active
零件包装代码：BGA包装说明：BGA,
针数：144Reach Compliance Code：compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.55JESD-30 代码：S-PBGA-B144
JESD-609代码：e1长度：12 mm
湿度敏感等级：3专用输入次数：
I/O 线路数量：117端子数量：144
最高工作温度：85 °C最低工作温度：-40 °C
组织：0 DEDICATED INPUTS, 117 I/O输出函数：MACROCELL
封装主体材料：PLASTIC/EPOXY封装代码：BGA
封装形状：SQUARE封装形式：GRID ARRAY
峰值回流温度（摄氏度）：260可编程逻辑类型：FLASH PLD
传播延迟：15.5 ns认证状态：Not Qualified
座面最大高度：1.2 mm最大供电电压：3.6 V
最小供电电压：3 V标称供电电压：3.3 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Tin/Silver/Copper (Sn95.5Ag4.0Cu0.5)
端子形式：BALL端子节距：0.8 mm
端子位置：BOTTOM处于峰值回流温度下的最长时间：30
宽度：12 mmBase Number Matches：1

XA95144XL-15CSG144I 数据手册

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R
XA95144XL Automotive CPLD  
Symbol  
Parameter  
Test Conditions  
Min  
Max  
Units  
I/O high-Z leakage current  
VCC = Max; VCCIO = Max;  
-
±10  
μA  
VIN = GND or 3.6V  
IIH  
V
CC Min < VIN < 5.5V  
-
-
±50  
10  
μA  
pF  
CIN  
ICC  
I/O capacitance  
VIN = GND; f = 1.0 MHz  
Operating supply current  
(low power mode, active)  
VIN = GND, No load; f = 1.0 MHz  
45 (Typical)  
mA  
AC Characteristics  
XA95144XL-15  
Symbol  
Parameter  
Min  
Max  
Units  
TPD  
TSU  
I/O to output valid  
I/O setup time before GCK  
-
15.5  
ns  
ns  
ns  
ns  
MHz  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
12.0  
-
TH  
I/O hold time after GCK  
GCK to output valid  
0
-
-
5.8  
64.5  
-
TCO  
fSYSTEM  
TPSU  
TPH  
Multiple FB internal operating frequency  
I/O setup time before p-term clock input  
I/O hold time after p-term clock input  
P-term clock output valid  
-
7.6  
0.0  
-
-
TPCO  
TOE  
10.2  
7.0  
7.0  
11.0  
11.0  
14.5  
15.3  
-
GTS to output valid  
-
TOD  
GTS to output disable  
-
TPOE  
TPOD  
TAO  
Product term OE to output enabled  
Product term OE to output disabled  
GSR to output valid  
-
-
-
TPAO  
TWLH  
TAPRPW  
TPLH  
TSUEC  
THEC  
P-term S/R to output valid  
-
GCK pulse width (High or Low)  
Asynchronous preset/reset pulse width (High or Low)  
P-term clock pulse width (High or Low)  
Clock enable setup  
4.5  
7.0  
7.0  
6.5  
0
-
-
-
Clock enable hold  
-
V
TEST  
R
1
2
Output Type  
V
V
R
R
C
L
CCIO  
TEST  
1
2
Device Output  
3.3V  
2.5V  
3.3V  
2.5V  
320 Ω  
250 Ω  
360 Ω  
660 Ω  
35 pF  
35 pF  
C
L
R
DS058_03_081500  
Figure 3: AC Load Circuit  
4
www.xilinx.com  
DS600 (v1.1) April 3, 2007  
Product Specification  
1234567...11

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型号 品牌 描述 获取价格 数据表
XA9572XL-10TQG100I XILINX Flash PLD, 10ns, 72-Cell, CMOS, PQFP100, TQFP-100

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XA9572XL-10TQG100Q XILINX Flash PLD, 10ns, 72-Cell, CMOS, PQFP100, TQFP-100

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