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W83194R-81

更新时间: 2024-01-09 18:44:47
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华邦 - WINBOND 晶体时钟发生器微控制器和处理器外围集成电路光电二极管
页数 文件大小 规格书
18页 230K
描述
100MHZ CLOCK FOR SIS CHIPSET

W83194R-81 技术参数

生命周期:Obsolete零件包装代码:SSOP
包装说明:SSOP, SSOP48,.4针数:48
Reach Compliance Code:compliant风险等级:5.8
JESD-30 代码:R-PDSO-G48端子数量:48
最高工作温度:70 °C最低工作温度:
封装主体材料:PLASTIC/EPOXY封装代码:SSOP
封装等效代码:SSOP48,.4封装形状:RECTANGULAR
封装形式:SMALL OUTLINE, SHRINK PITCH电源:2.5,3.3 V
认证状态:Not Qualified子类别:Clock Generators
表面贴装:YES温度等级:COMMERCIAL
端子形式:GULL WING端子节距:0.635 mm
端子位置:DUALBase Number Matches:1

W83194R-81 数据手册

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W83194R-81  
PRELIMINARY  
3.0 BLOCK DIAGRAM  
48MHz  
SIO  
PLL2  
¡ Ò  
2
SEL24_14#  
Xin  
Xout  
XTAL  
OSC  
REF(0:2)  
IOAPIC  
3
PLL1  
Spread  
STOP  
CPU_STOP#  
CPUCLK(0:2)  
SDRAM(0:12)  
Spectrum  
3
3
*FS(0:2)  
*MODE  
LATCH  
13  
CPU3.3_2.5#  
*SD_SEL#  
5
PCI  
PCICLK(0:4)  
PCICLK_F  
clock  
STOP  
POR  
5
Divder  
SDRAM_STOP#  
CPU_STOP#  
Contro  
l Logic  
PCI_STOP#  
PCI_STOP#  
PD#  
Config  
. Reg.  
*SDAT  
*SCLK  
4.0 PIN CONFIGURATION  
Vddq2  
1
2
3
4
5
6
7
8
9
Vdd  
REF0/ *MODE  
48  
47  
46  
IOAPIC  
Vss  
Xin  
Xout  
REF1/ *SD_SEL#  
Vss  
REF2/CPU3.3_2.5#  
CPUCLK0  
Vddq2b  
CPUCLK1  
CPUCLK  
2
Vss  
45  
44  
43  
42  
41  
40  
39  
38  
Vddq4  
PCICLK_F/ *FS1  
PCICLK0/ *FS2  
Vss  
10  
11  
12  
PCICLK1  
PCICLK2  
PCICLK3  
PCICLK4  
Vddq4  
SDRAM 0  
37  
SDRAM 1  
Vddq3  
SDRAM 2  
SDRAM 3  
Vss  
SDRAM 4  
SDRAM 5  
Vddq3  
SDRAM 6  
SDRAM 7  
Vss  
48MHz/*FS0  
SIO/*SEL24_14#  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
36  
35  
34  
33  
32  
31  
30  
29  
28  
27  
26  
25  
SDRAM12  
Vss  
*CPU_STOP#/SDRAM11  
*PCI_STOP#/SDRAM10  
Vddq3  
*SDRAM_STOP#/SDRAM 9  
*PD#/SDRAM 8  
Vss  
*SDATA  
*SDCLK  
Publication Release Date: Dec. 1998  
Revision 0.20  
- 2 -  

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