W180-01G

更新时间： 2024-11-20 03:18:03

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赛普拉斯 - CYPRESS		晶体时钟发生器微控制器和处理器外围集成电路光电二极管
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Peak Reducing EMI Solution

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W180-01G 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	SOIC	包装说明：	0.150 INCH, PLASTIC, SOIC-8
针数：	8	Reach Compliance Code：	not_compliant
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.26	Is Samacsys：	N
其他特性：	ALSO OPERATES AT 5V SUPPLY	JESD-30 代码：	R-PDSO-G8
JESD-609代码：	e0	长度：	4.889 mm
湿度敏感等级：	1	端子数量：	8
最高工作温度：	70 °C	最低工作温度：
最大输出时钟频率：	28 MHz	封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装等效代码：	SOP8,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
峰值回流温度（摄氏度）：	220	电源：	3.3/5 V
主时钟/晶体标称频率：	28 MHz	认证状态：	Not Qualified
座面最大高度：	1.727 mm	子类别：	Clock Generators
最大压摆率：	50 mA	最大供电电压：	3.465 V
最小供电电压：	3.135 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	3.8985 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER
Base Number Matches：	1

W180-01G 数据手册

W180

Peak Reducing EMI Solution

Features

Table 1. Modulation Width Selection

• Cypress PREMIS™ family offering

W180-01, 02, 03

Output

W180-51, 52, 53

Output

SS%

• Generates an EMI optimized clocking signal at the

output

F_in> F_out> F_in– 1.25% F_in+ 0.625% > F_in> – 0.625%

F_in> F_out> F_in– 3.75% F_in+ 1.875% > F_in> –1.875%

• Selectable output frequency range

• Single 1.25% or 3.75% down or center spread output

• Integrated loop filter components

• Operates with a 3.3V or 5V supply

• Low power CMOS design

Table 2. Frequency Range Selection

W180 Option#

-01, 51

(MHz)

-02, 52

(MHz)

-03, 53

(MHz)

• Available in 8-pin SOIC (Small Outline Integrated

Circuit)

FS2 FS1

8 < F_IN< 10

N/A

Key Specifications

10 < F_IN< 15 10 < F_IN< 15

N/A

Supply Voltages:............................................V_DD= 3.3V±5%

or V_DD= 5V±10%

15 < F_IN< 18

18 < F_IN< 28

N/A

15 < F_IN< 18

18 < F_IN< 28

Frequency Range:...............................8 MHz < F_in< 28 MHz

Cycle to Cycle Jitter: ........................................300 ps (max.)

Selectable Spread Percentage:.................... 1.25% or 3.75%

Output Duty Cycle: ...............................40/60% (worst case)

Output Rise and Fall Time:...................................5 ns (max.)

Simplified Block Diagram

Pin Configurations

3.3V or 5.0V

SOIC

CLKIN or X1

NC or X2

GND

FS2

FS1

VDD

XTAL

SS%

CLKOUT

Input

Spread Spectrum

Output

W180

(EMI suppressed)

CLKIN or X1

NC or X2

GND

SSON#

FS1

VDD

SS%

CLKOUT

3.3V or 5.0V

Oscillator or

Reference Input

Spread Spectrum

W180

Output

(EMI suppressed)

Cypress Semiconductor Corporation

Document #: 38-07156 Rev. *B

•

198 Champion Court

•

San Jose, CA 95134-1709

•

408-943-2600

Revised October 5, 2005

12 3 4 5 6 7...10

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型号	品牌	获取价格	描述	数据表
W180-01GT	CYPRESS	获取价格	Peak Reducing EMI Solution
W18002G	ROCHESTER	获取价格	15MHz, OTHER CLOCK GENERATOR, PDSO8, 0.150 INCH, PLASTIC, SOIC-8
W180-02G	CYPRESS	获取价格	Peak Reducing EMI Solution
W180-02GT	CYPRESS	获取价格	Peak Reducing EMI Solution
W18003G	CYPRESS	获取价格	28MHz, OTHER CLOCK GENERATOR, PDSO8, 0.150 INCH, PLASTIC, SOIC-8
W180-03G	CYPRESS	获取价格	Peak Reducing EMI Solution
W180-03GI	CYPRESS	获取价格	Clock Generator, 28MHz, CMOS, PDSO8, 0.150 INCH, PLASTIC, SOIC-8
W180-03GT	CYPRESS	获取价格	Peak Reducing EMI Solution
W180-51G	CYPRESS	获取价格	Peak Reducing EMI Solution
W180-51GT	CYPRESS	获取价格	Peak Reducing EMI Solution

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