UPSD3253BV-40T6T

更新时间： 2024-10-13 23:06:31

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意法半导体 - STMICROELECTRONICS		闪存微控制器和处理器
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Flash Programmable System Devices with 8032 Microcontroller Core

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UPSD3253BV-40T6T 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
Reach Compliance Code：	compliant	风险等级：	5.84
Is Samacsys：	N	位大小：	8
CPU系列：	8051	JESD-30 代码：	S-PQFP-G52
端子数量：	52	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	QFP	封装等效代码：	QFP52,.47SQ
封装形状：	SQUARE	封装形式：	FLATPACK
电源：	3.3 V	认证状态：	Not Qualified
RAM（字节）：	32768	ROM（单词）：	131072
ROM可编程性：	FLASH	速度：	40 MHz
子类别：	Microcontrollers	最大压摆率：	25 mA
标称供电电压：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子形式：	GULL WING	端子节距：	0.635 mm
端子位置：	QUAD	Base Number Matches：	1

UPSD3253BV-40T6T 数据手册

UPSD3254A, UPSD3254BV

UPSD3253B, UPSD3253BV

Flash Programmable System Devices

with 8032 Microcontroller Core

FEATURES SUMMARY

■ The uPSD325X devices combine a Flash PSD

Figure 1. 52-lead, Thin, Quad, Flat Package

architecture with an 8032 microcontroller core.

The uPSD325X devices of Flash PSDs feature

dual banks of Flash memory, SRAM, general

purpose I/O and programmable logic, supervi-

sory functions and access via USB, I C, ADC,

DDC and PWM channels, and an on-board

8032 microcontroller core, with two UARTs,

three 16-bit Timer/Counters and two External

Interrupts. As with other Flash PSD families, the

uPSD325X devices are also in-system pro-

grammable (ISP) via a JTAG ISP interface.

TQFP52 (T)

■ Large 32KByte SRAM with battery back-up

option

■ Dual bank Flash memories

– 128KByte or 256KByte main Flash memory

– 32KByte secondary Flash memory

■ Content Security

Figure 2. 80-lead, Thin, Quad, Flat Package

– Block access to Flash memory

■ Programmable Decode PLD for flexible address

mapping of all memories within 8032 space.

■ High-speed clock standard 8032 core (12-cycle)

■ USB Interface (some devices only)

■ I C interface for peripheral connections

■ 5 Pulse Width Modulator (PWM) channels

■ Analog-to-Digital Converter (ADC)

■ Standalone Display Data Channel (DDC)

■ Six I/O ports with up to 46 I/O pins

■ 3000 gate PLD with 16 macrocells

■ Supervisor functions with Watchdog Timer

■ In-System Programming (ISP) via JTAG

■ Zero-Power Technology

TQFP80 (U)

■ Single Supply Voltage

– 4.5 to 5.5V

– 3.0 to 3.6V

September 2003

1/175

Rev. 1.2

12 3 4 5 6 7...175

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