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UPD77018GC

更新时间： 2024-02-15 11:24:10

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日电电子 - NEC		数字信号处理器
页数	文件大小	规格书
60页	418K
描述
16 bits, Fixed-point Digital Signal Processor

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UPD77018GC 技术参数

是否Rohs认证：	不符合	生命周期：	Transferred
零件包装代码：	QFP	包装说明：	LFQFP,
针数：	100	Reach Compliance Code：	compliant
ECCN代码：	3A991.A.2	HTS代码：	8542.31.00.01
风险等级：	5.59	地址总线宽度：	14
桶式移位器：	YES	边界扫描：	NO
最大时钟频率：	33 MHz	外部数据总线宽度：	16
格式：	FIXED POINT	内部总线架构：	MULTIPLE
JESD-30 代码：	S-PQFP-G100	JESD-609代码：	e0
长度：	14 mm	低功率模式：	NO
端子数量：	100	封装主体材料：	PLASTIC/EPOXY
封装代码：	LFQFP	封装形状：	SQUARE
封装形式：	FLATPACK, LOW PROFILE, FINE PITCH	峰值回流温度（摄氏度）：	NOT SPECIFIED
认证状态：	Not Qualified	座面最大高度：	1.27 mm
最大供电电压：	3.6 V	最小供电电压：	2.7 V
标称供电电压：	3 V	表面贴装：	YES
技术：	CMOS	端子面层：	TIN LEAD
端子形式：	GULL WING	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	14 mm	uPs/uCs/外围集成电路类型：	DIGITAL SIGNAL PROCESSOR, OTHER
Base Number Matches：	1

UPD77018GC 数据手册

DATA SHEET

MOS INTEGRATED CIRCUIT

µPD77015,77017,77018

16 bits, Fixed-point Digital Signal Processor

µPD77015, 77017, 77018 are 16 bits fixed-point DSPs (Digital Signal Processors) developed for digital signal

processing with its demand for high speed and precision.

FEATURES

• FUNCTIONS

• Instruction cycle: 30 ns (MIN.)

Operation clock: 33 MHz

External clock: 33, 16.5, 8.25, 4.125 MHz

Crystal: 33 MHz

• On-chip PLL to provide higher operation clock than the external clock

• Dual load/store

• Hardware loop function

• Conditional execution

• Executes product-sum operation in one instruction cycle

• PROGRAMMING

• 16 bits × 16 bits + 40 bits → 40 bits multiply accumulator

• 8 general registers (40 bits each)

• 8 ROM/RAM data pointer: each data memory area has 4 registers

• 10 source interrupts (external: 4, internal: 6)

• 3 operand instructions (example: R0 = R0 +R1L R2L)

• Nonpipeline on execution stage

• MEMORY AREAS

• Instruction memory area : 64K words × 32 bits

• Data memory areas : 64K words × 16 bits × 2 (X memory, Y memory)

• CLOCK GENERATOR

• Mask option for CLKOUT pin:

Fixed to the low level.

Does not output the internal system clock.

• Selectable source clock: external clock input and crystal resonator

[External clock]

On-chip PLL to provide higher operation clock (33 MHz MAX.) than the external clock.

Variable multiple rates (1, 2, 4, 8) by mask option.

[Crystal resonator]

Oscillation frequency corresponds directly to the system clock frequency (Sure to specify the mask option

frequency multiple as "1").

In this document, all descriptions of the µPD77017 also apply to the µPD77015 and µPD77018, unless

otherwise specified.

The information in this document is subject to change without notice.

Document No. U10902EJ3V0DS00 (3rd edition)

Date Published June 1997 N

Printed in Japan

The mark

shows major revised points.

1993, 1994

12 3 4 5 6 7...60

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