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SN75LBC174ANE4

更新时间： 2024-11-23 04:00:55
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德州仪器 - TI 驱动器
页数 文件大小 规格书
19页 480K
描述
QUADRUPLE RS-485 DIFFERENTIAL LINE DRIVERS

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SN75LBC174ANE4 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：DIP
包装说明：DIP, DIP16,.3针数：16
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.47
差分输出：YES驱动器位数：4
输入特性：STANDARD接口集成电路类型：LINE DRIVER
接口标准：EIA-422; TIA-422; EIA-485; TIA-485; ISO 8482JESD-30 代码：R-PDIP-T16
JESD-609代码：e4长度：19.305 mm
功能数量：4端子数量：16
最高工作温度：70 °C最低工作温度：
最小输出摆幅：1 V输出特性：3-STATE
封装主体材料：PLASTIC/EPOXY封装代码：DIP
封装等效代码：DIP16,.3封装形状：RECTANGULAR
封装形式：IN-LINE峰值回流温度（摄氏度）：NOT SPECIFIED
电源：5 V认证状态：Not Qualified
最大接收延迟：座面最大高度：5.08 mm
子类别：Line Driver or Receivers最大供电电压：5.25 V
最小供电电压：4.75 V标称供电电压：5 V
表面贴装：NO技术：BICMOS
温度等级：COMMERCIAL端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
最大传输延迟：11 ns宽度：7.62 mm
Base Number Matches：1

SN75LBC174ANE4 数据手册

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SLLS446C − OCTOBER 2000 − REVISED MAY 2003  
D
D
D
D
Designed for TIA/EIA-485, TIA/EIA-422 and  
ISO 8482 Applications  
D
D
Driver Positive- and Negative-Current  
Limiting  
†
Signaling Rates up to 30 Mbps  
Power-Up and Power-Down Glitch-Free for  
Line Insertion Applications  
Propagation Delay Times < 11 ns  
D
Thermal Shutdown Protection  
Low Standby Power Consumption  
1.5 mA Max  
D
Industry Standard Pin-Out, Compatible  
With SN75174, MC3487, DS96174, LTC487,  
and MAX3042  
D
Output ESD Protection Exceeds 13 kV  
description  
The SN65LBC174A and SN75LBC174A are quadruple differential line drivers with 3-state outputs, designed  
for TIA/EIA-485 (RS-485), TIA/EIA-422 (RS-422), and ISO 8482 applications.  
These devices are optimized for balanced multipoint bus transmission at signalling rates up to 30 million bits  
per second. The transmission media may be printed-circuit board traces, backplanes, or cables. The ultimate  
rate and distance of data transfer is dependent upon the attenuation characteristics of the media and the noise  
coupling to the environment.  
N PACKAGE  
(TOP VIEW)  
16-DW PACKAGE  
(TOP VIEW)  
logic diagram (positive logic)  
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1
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V
CC  
4A  
1
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1Z  
1Z  
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6
5
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2Z  
1,2EN  
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GND  
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10 3Y  
10  
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3Y  
3Z  
9
2A  
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3,4EN  
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GND  
9
3A  
12  
15  
14  
13  
4Y  
4Z  
20-DW PACKAGE  
(TOP VIEW)  
logic diagram (positive logic)  
2
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NC  
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V
CC  
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NC  
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3,4EN  
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NC  
3Y  
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1
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4
1Z  
5
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8
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9
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1,2EN  
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NC  
2Y  
2A  
GND  
6
2Z  
12  
3Y  
11  
3A  
14  
3Z  
15  
3,4EN  
3A  
18  
4Y  
19  
4A  
16  
4Z  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
†
The signaling rate of a line is the number of voltage transitions that are made per second expressed in the units bps (bits per second).  
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Copyright 2001 − 20003, Texas Instruments Incorporated  
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1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
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SN75LBC174ANE4 替代型号

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