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SN74SSTVF16859SRG3 PDF预览

SN74SSTVF16859SRG3

更新时间： 2024-11-23 20:08:47
品牌 Logo 应用领域
德州仪器 - TI 逻辑集成电路触发器电视
页数 文件大小 规格书
15页 580K
描述
13-Bit to 26-Bit Registered Buffer with SSTL_2 Inputs and Outputs 56-VQFN 0 to 70

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SN74SSTVF16859SRG3 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：QFN
包装说明：HVQCCN, LCC56,.31SQ,20针数：56
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.1系列：SSTV
JESD-30 代码：S-PQCC-N56JESD-609代码：e0
长度：8 mm逻辑集成电路类型：D FLIP-FLOP
湿度敏感等级：3位数：13
功能数量：1端子数量：56
最高工作温度：70 °C最低工作温度：
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：HVQCCN封装等效代码：LCC56,.31SQ,20
封装形状：SQUARE封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：235电源：2.5 V
传播延迟（tpd）：2.5 ns认证状态：Not Qualified
座面最大高度：1 mm子类别：Other Logic ICs
最大供电电压 (Vsup)：2.7 V最小供电电压 (Vsup)：2.5 V
标称供电电压 (Vsup)：2.6 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：TIN LEAD端子形式：NO LEAD
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIED触发器类型：POSITIVE EDGE
宽度：8 mm最小 fmax：500 MHz
Base Number Matches：1

SN74SSTVF16859SRG3 数据手册

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SCES429B − MARCH 2003 − REVISED FEBRUARY 2004  
DGG PACKAGE  
(TOP VIEW)  
D
D
D
D
D
Member of the Texas Instruments  
WidebusFamily  
Operates at 2.3 V to 2.7 V for PC1600,  
PC2100, and PC2700  
1
64  
63  
62  
61  
60  
59  
58  
57  
56  
55  
54  
53  
52  
51  
50  
49  
48  
47  
46  
45  
44  
43  
42  
41  
40  
39  
38  
37  
36  
35  
34  
33  
Q13A  
Q12A  
Q11A  
Q10A  
Q9A  
V
DDQ  
2
GND  
D13  
D12  
Operates at 2.5 V to 2.7 V for PC3200 (QFN  
Package)  
3
4
Pinout and Functionality Compatible With  
JEDEC Standard SSTV16859  
5
V
V
CC  
6
V
DDQ  
DDQ  
7
GND  
Q8A  
Q7A  
Q6A  
Q5A  
Q4A  
Q3A  
Q2A  
GND  
Q1A  
Q13B  
GND  
D11  
D10  
D9  
GND  
D8  
600 ps Faster (Simultaneous Switching)  
Than the JEDEC Standard SSTV16859 in  
PC2700 DIMM Applications  
8
9
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
25  
26  
27  
28  
29  
30  
31  
32  
D
D
D
D
D
D
1-to-2 Outputs to Support Stacked DDR  
DIMMs  
Output Edge-Control Circuitry Minimizes  
Switching Noise in an Unterminated Line  
D7  
RESET  
GND  
CLK  
CLK  
V
V
V
D6  
GND  
D5  
D4  
D3  
GND  
V
V
D2  
D1  
Outputs Meet SSTL_2 Class I  
Specifications  
Supports SSTL_2 Data Inputs  
V
Differential Clock (CLK and CLK) Inputs  
DDQ  
DDQ  
Q12B  
Q11B  
Q10B  
Q9B  
Q8B  
Q7B  
CC  
Supports LVCMOS Switching Levels on the  
RESET Input  
REF  
D
RESET Input Disables Differential Input  
Receivers, Resets All Registers, and  
Forces All Outputs Low  
D
D
D
Pinout Optimizes DIMM PCB Layout  
Q6B  
GND  
Latch-Up Performance Exceeds 100 mA Per  
JESD 78, Class II  
V
DDQ  
Q5B  
DDQ  
CC  
ESD Protection Exceeds JESD 22  
− 2000-V Human-Body Model (A114-A)  
− 200-V Machine Model (A115-A)  
Q4B  
Q3B  
Q2B  
Q1B  
− 1000-V Charged-Device Model (C101)  
GND  
V
DDQ  
description/ordering information  
This 13-bit to 26-bit registered buffer is designed for 2.3-V to 2.7-V V  
operation.  
CC  
ORDERING INFORMATION  
ORDERABLE  
PART NUMBER  
TOP-SIDE  
MARKING  
†
T
PACKAGE  
QFN − RGQ  
A
SN74SSTVF16859SR  
SN74SSTVF16859S8  
(Tin-Pb Finish)  
Tape and reel  
SSF859  
0°C to 70°C  
QFN − RGQ  
(Matte-Tin Finish)  
TSSOP − DGG  
Tape and reel SN74SSTVF16859GR  
SSTVF16859  
†
Package drawings, standard packing quantities, thermal data, symbolization, and PCB design guidelines  
are available at www.ti.com/sc/package.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
Widebus is a trademark of Texas Instruments.  
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Copyright 2004, Texas Instruments Incorporated  
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1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
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与SN74SSTVF16859SRG3相关器件

型号 品牌 获取价格 描述 数据表
SN74SSTVF32852 TI

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 		24-BIT TO 48-BIT REGISTERED BUFFER WITH SSTL_2 INPUTS AND OUTPUTS
SN74SSTVF32852KR TI

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SN74TVC16222 TI

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