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SN74LV573ATNSRE4 PDF预览

SN74LV573ATNSRE4

更新时间： 2024-11-15 15:52:19
品牌 Logo 应用领域
德州仪器 - TI 驱动光电二极管输出元件逻辑集成电路
页数 文件大小 规格书
15页 586K
描述
LV/LV-A/LVX/H SERIES, 8-BIT DRIVER, TRUE OUTPUT, PDSO20, GREEN, PLASTIC, SOP-20

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SN74LV573ATNSRE4 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：SOP, SOP20,.3针数：20
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.77系列：LV/LV-A/LVX/H
JESD-30 代码：R-PDSO-G20长度：12.6 mm
负载电容（CL）：50 pF逻辑集成电路类型：BUS DRIVER
最大I（ol）：0.016 A位数：8
功能数量：1端口数量：2
端子数量：20最高工作温度：85 °C
最低工作温度：-40 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP20,.3
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
包装方法：TAPE AND REEL峰值回流温度（摄氏度）：NOT SPECIFIED
电源：5 VProp。Delay @ Nom-Sup：10.5 ns
传播延迟（tpd）：14.5 ns认证状态：Not Qualified
座面最大高度：2 mm子类别：FF/Latches
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：5.3 mmBase Number Matches：1

SN74LV573ATNSRE4 数据手册

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SN74LV573AT  
OCTAL TRANSPARENT D-TYPE LATCH  
WITH 3-STATE OUTPUTS  
www.ti.com  
SCES574C–JUNE 2004–REVISED AUGUST 2005  
FEATURES  
•
•
•
•
Inputs Are TTL-Voltage Compatible  
4.5-V to 5.5-V VCC Operation  
Typical tpd = 5.1 ns at 5 V  
•
•
•
Ioff Supports Partial-Power-Down Mode  
Operation  
Latch-Up Performance Exceeds 250 mA Per  
JESD 17  
Typical VOLP (Output Ground Bounce)  
<0.8 V at VCC = 5 V, TA = 25°C  
ESD Protection Exceeds JESD 22  
– 2000-V Human-Body Model (A114-A)  
– 200-V Machine Model (A115-A)  
•
•
Typical VOHV (Output VOH Undershoot)  
>2.3 V at VCC = 5 V, TA = 25°C  
Supports Mixed-Mode Voltage Operation on  
All Ports  
– 1000-V Charged-Device Model (C101)  
xxxxx  
RGY PACKAGE  
(TOP VIEW)  
DB, DGV, DW, NS, OR PW PACKAGE  
(TOP VIEW)  
1
2
3
4
5
6
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11  
OE  
1D  
V
CC  
1Q  
2Q  
3Q  
4Q  
5Q  
6Q  
7Q  
8Q  
LE  
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1D  
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4D  
5D  
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7D  
8D  
1Q  
2Q  
3Q  
4Q  
5Q  
6Q  
7Q  
8Q  
6D  
7D  
8D  
GND  
10  
11  
DESCRIPTION/ORDERING INFORMATION  
The SN74LV573AT is an octal transparent D-type latch. When the latch-enable (LE) input is high, the Q outputs  
follow the data (D) inputs. When LE is low, the Q outputs are latched at the logic levels of the D inputs.  
ORDERING INFORMATION  
TA  
PACKAGE(1)  
ORDERABLE PART NUMBER  
SN74LV573ATRGYR  
SN74LV573ATDW  
TOP-SIDE MARKING  
VV573  
QFN – RGY  
SOIC – DW  
Tape and reel  
Tube  
LV573AT  
Tape and reel  
Tape and reel  
Tape and reel  
Tube  
SN74LV573ATDWR  
SN74LV573ATNSR  
SN74LV573ATDBR  
SN74LV573ATPW  
SOP – NS  
74LV573AT  
LV573AT  
–40°C to 85°C  
SSOP – DB  
TSSOP – PW  
TVSOP – DGV  
LV573AT  
LV573AT  
Tape and reel  
Tape and reel  
SN74LV573ATPWR  
SN74LV573ATDGVR  
(1) Package drawings, standard packing quantities, thermal data, symbolization, and PCB design guidelines are available at  
www.ti.com/sc/package.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of Texas  
Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
PRODUCTION DATA information is current as of publication date.  
Copyright © 2004–2005, Texas Instruments Incorporated  
Products conform to specifications per the terms of the Texas  
Instruments standard warranty. Production processing does not  
necessarily include testing of all parameters.  
1234567...15

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与SN74LV573ATNSRE4相关器件

型号 品牌 获取价格 描述 数据表
SN74LV573ATPW TI

获取价格

 		OCTAL TRANSPARENT D-TYPE LATCH WITH 3-STATE OUTPUTS
SN74LV573ATPWE4 TI

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 		LV/LV-A/LVX/H SERIES, 8-BIT DRIVER, TRUE OUTPUT, PDSO20, GREEN, PLASTIC, TSSOP-20
SN74LV573ATPWG4 TI

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SN74LV573AZQNR TI

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