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SN74ALS165N-10 PDF预览

SN74ALS165N-10

更新时间： 2024-09-30 15:52:07
品牌 Logo 应用领域
德州仪器 - TI 光电二极管输出元件逻辑集成电路触发器
页数 文件大小 规格书
15页 586K
描述
ALS SERIES, 8-BIT RIGHT PARALLEL IN SERIAL OUT SHIFT REGISTER, COMPLEMENTARY OUTPUT, PDIP16

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SN74ALS165N-10 技术参数

生命周期：Obsolete包装说明：DIP,
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.51Is Samacsys：N
其他特性：CLOCK INHIBIT计数方向：RIGHT
系列：ALSJESD-30 代码：R-PDIP-T16
长度：19.305 mm逻辑集成电路类型：PARALLEL IN SERIAL OUT
位数：8功能数量：1
端子数量：16最高工作温度：70 °C
最低工作温度：输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：DIP
封装形状：RECTANGULAR封装形式：IN-LINE
认证状态：Not Qualified座面最大高度：5.08 mm
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：NO
技术：TTL温度等级：COMMERCIAL
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL触发器类型：POSITIVE EDGE
宽度：7.62 mmBase Number Matches：1

SN74ALS165N-10 数据手册

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SDAS157B − JUNE 1982 − REVISED DECEMBER 1994  
SN54ALS165 . . . J PACKAGE  
SN74ALS165 . . . D OR N PACKAGE  
(TOP VIEW)  
• Complementary Outputs  
• Direct Overriding Load (Data) Inputs  
• Gated Clock Inputs  
SH/LD  
CLK  
E
V
CC  
CLK INH  
• Parallel-to-Serial Data Conversion  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
11  
10  
9
• Package Options Include Plastic  
Small-Outline (D) Packages, Ceramic Chip  
Carriers (FK), and Standard Plastic (N) and  
Ceramic (J) 300-mil DIPs  
D
C
B
A
F
G
H
Q
SER  
description  
H
GND  
Q
H
The ′ALS165 are parallel-load 8-bit serial shift  
registers that, when clocked, shift the data toward  
SN54ALS165 . . . FK PACKAGE  
(TOP VIEW)  
serial (Q and Q ) outputs. Parallel-in access to  
H
H
each stage is provided by eight individual direct  
data (A−H) inputs that are enabled by a low level  
at the shift/load (SH/LD) input. The ′ALS165 have  
a clock-inhibit function and complemented serial  
outputs.  
3
2
1
20 19  
18  
E
F
D
4
5
6
7
8
Clocking is accomplished by a low-to-high  
transition of the clock (CLK) input while SH/LD is  
held high and the clock inhibit (CLK INH) input is  
held low. The functions of CLK and CLK INH are  
interchangeable. Since a low CLK and a  
low-to-high transition of CLK INH also  
accomplishes clocking, CLK INH should be  
changed to the high level only while CLK is high.  
Parallel loading is inhibited when SH/LD is held  
high. The parallel inputs to the register are  
enabled while SH/LD is low independently of the  
levels of the CLK, CLK INH, or serial (SER) inputs.  
17  
16  
15  
14  
C
NC  
G
NC  
B
H
A
9 10 11 12 13  
NC − No internal connection  
The SN54ALS165 is characterized for operation over the full military temperature range of −55°C to 125°C. The  
SN74ALS165 is characterized for operation from 0°C to 70°C.  
FUNCTION TABLE  
INPUTS  
FUNCTION  
CLK CLK INH  
SH/LD  
L
X
H
X
L
X
X
H
↑
L
Parallel load  
No change  
No change  
H
H
H
H
†
Shift  
†
Shift  
↑
†
Shift = content of each internal register shifts  
toward serial outputs. Data at SER is shifted  
into first register.  
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Copyright 1994, Texas Instruments Incorporated  
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1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
POST OFFICE BOX 1443 • HOUSTON, TEXAS 77251−1443  
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型号 品牌 获取价格 描述 数据表
SN74ALS165N3 TI

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 		PARALLEL-LOAD 8-BIT REGISTERS
SN74ALS165NE4 TI

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 		PARALLEL-LOAD 8-BIT REGISTERS
SN74ALS165NP1 ROCHESTER

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 		Parallel In Serial Out
SN74ALS165NP3 TI

获取价格

 		IC IC,SHIFT REGISTER,ALS-TTL,DIP,16PIN,PLASTIC, Shift Register
SN74ALS166 TI

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 		PARALLEL-LOAD 8-BIT SHIFT REGISTER
SN74ALS166_07 TI

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 		PARALLEL-LOAD 8-BIT SHIFT REGISTER
SN74ALS166_08 TI

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 		PARALLEL-LOAD 8-BIT SHIFT REGISTER
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 		PARALLEL-LOAD 8-BIT SHIFT REGISTER
SN74ALS166D3 TI

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 		IC IC,SHIFT REGISTER,ALS-TTL,SOP,16PIN,PLASTIC, Shift Register
SN74ALS166DBLE TI

获取价格

 		ALS SERIES, 8-BIT RIGHT PARALLEL IN SERIAL OUT SHIFT REGISTER, TRUE OUTPUT, PDSO16, PLASTI

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