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SN54HC138FK PDF预览

SN54HC138FK

更新时间： 2024-10-31 22:34:35
品牌 Logo 应用领域
德州仪器 - TI 解码器驱动器解复用器逻辑集成电路输入元件
页数 文件大小 规格书
16页 537K
描述
3-LINE TO 8-LINE DECODERS/DEMULTIPLEXERS

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SN54HC138FK 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：QFN包装说明：QCCN, LCC20,.35SQ
针数：20Reach Compliance Code：not_compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.29Is Samacsys：N
其他特性：3 ENABLE INPUTS系列：HC/UH
JESD-30 代码：S-CQCC-N20长度：8.89 mm
负载电容（CL）：50 pF逻辑集成电路类型：OTHER DECODER/DRIVER
最大I（ol）：0.0052 A功能数量：1
端子数量：20最高工作温度：125 °C
最低工作温度：-55 °C输出极性：INVERTED
封装主体材料：CERAMIC, METAL-SEALED COFIRED封装代码：QCCN
封装等效代码：LCC20,.35SQ封装形状：SQUARE
封装形式：CHIP CARRIER峰值回流温度（摄氏度）：NOT SPECIFIED
电源：2/6 VProp。Delay @ Nom-Sup：54 ns
传播延迟（tpd）：270 ns认证状态：Not Qualified
座面最大高度：2.03 mm子类别：Decoder/Drivers
最大供电电压 (Vsup)：6 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子形式：NO LEAD端子节距：1.27 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：8.89 mmBase Number Matches：1

SN54HC138FK 数据手册

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SCLS107E − DECEMBER 1982 − REVISED SEPTEMBER 2003  
SN54HC138 . . . J OR W PACKAGE  
SN74HC138 . . . D, DB, N, NS, OR PW PACKAGE  
(TOP VIEW)  
D
Targeted Specifically for High-Speed  
Memory Decoders and Data-Transmission  
Systems  
D
D
D
D
D
D
D
Wide Operating Voltage Range of 2 V to 6 V  
Outputs Can Drive Up To 10 LSTTL Loads  
A
B
V
CC  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
Y0  
Y1  
Y2  
C
Low Power Consumption, 80-µA Max I  
CC  
G2A  
G2B  
G1  
Typical t = 15 ns  
pd  
4-mA Output Drive at 5 V  
12 Y3  
11  
10  
9
Y4  
Y5  
Y6  
Low Input Current of 1 µA Max  
Incorporate Three Enable Inputs to Simplify  
Cascading and/or Data Reception  
Y7  
GND  
SN54HC138 . . . FK PACKAGE  
(TOP VIEW)  
description/ordering information  
The ’HC138 devices are designed to be used in  
high-performance memory-decoding or data-  
routing applications requiring very short  
propagation delay times. In high-performance  
memory systems, these decoders can be used to  
minimize the effects of system decoding. When  
employed with high-speed memories utilizing a  
fast enable circuit, the delay times of these  
decoders and the enable time of the memory are  
usually less than the typical access time of the  
memory. This means that the effective system  
delay introduced by the decoders is negligible.  
3
2
1
20 19  
18  
Y1  
Y2  
NC  
C
G2A  
NC  
4
5
6
7
8
17  
16  
15 Y3  
14  
9 10 11 12 13  
G2B  
G1  
Y4  
NC − No internal connection  
ORDERING INFORMATION  
ORDERABLE  
PART NUMBER  
TOP-SIDE  
MARKING  
†
PACKAGE  
T
A
PDIP − N  
SOIC − D  
Tube of 25  
Tube of 40  
Reel of 2500  
Reel of 250  
Reel of 2000  
Reel of 2000  
Tube of 90  
Reel of 2000  
Reel of 250  
Tube of 25  
Tube of 150  
Tube of 55  
SN74HC138N  
SN74HC138N  
SN74HC138D  
SN74HC138DR  
SN74HC138DT  
SN74HC138NSR  
SN74HC138DBR  
SN74HC138PW  
SN74HC138PWR  
SN74HC138PWT  
SNJ54HC138J  
HC138  
SOP − NS  
HC138  
HC138  
−40°C to 85°C  
SSOP − DB  
TSSOP − PW  
HC138  
CDIP − J  
CFP − W  
LCCC − FK  
SNJ54HC138J  
SNJ54HC138W  
SNJ54HC138FK  
SNJ54HC138W  
SNJ54HC138FK  
−55°C to 125°C  
†
Package drawings, standard packing quantities, thermal data, symbolization, and PCB design guidelines are  
available at www.ti.com/sc/package.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
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Copyright 2003, Texas Instruments Incorporated  
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POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
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型号 品牌 获取价格 描述 数据表
SN54HC138FKR TI

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SN54HC138J TI

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