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PCD50922

更新时间： 2024-02-14 22:20:13
品牌 Logo 应用领域
恩智浦 - NXP 控制器
页数 文件大小 规格书
16页 93K
描述
Low cost; low power DECT baseband controllers ABC-PRO

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PCD50922 技术参数

生命周期：Obsolete零件包装代码：QFP
包装说明：LFQFP, QFP80,.55SQ,20针数：80
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.84JESD-30 代码：S-PQFP-G80
JESD-609代码：e3长度：12 mm
功能数量：1端子数量：80
封装主体材料：PLASTIC/EPOXY封装代码：LFQFP
封装等效代码：QFP80,.55SQ,20封装形状：SQUARE
封装形式：FLATPACK, LOW PROFILE, FINE PITCH电源：3/3.3 V
认证状态：Not Qualified座面最大高度：1.6 mm
子类别：Other Telecom ICs表面贴装：YES
技术：CMOS电信集成电路类型：CORDLESS TELEPHONE BASEBAND CIRCUIT
端子面层：TIN端子形式：GULL WING
端子节距：0.5 mm端子位置：QUAD
宽度：12 mm

PCD50922 数据手册

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(1)  
P1  
(1)  
P3  
P0  
P2  
ALE  
A16  
EA  
PSEN  
8
8
8
8
V
digital pins  
analog pins  
supply pins  
V
DD(P0, P2)  
DD(P1, P3)  
V
DDD  
LEVEL SHIFTER  
PORT 0  
LEVEL SHIFTER  
PORT 2  
LEVEL SHIFTER  
PORT 1  
LEVEL SHIFTER  
PORT 3  
LEVEL  
SHIFTER  
V
DDD  
PCD509x2  
V
V
V
V
V
V
V
V
V
V
V
V
V
V
IB BUS  
DDD  
80CL51 CORE  
SPEECH  
INTERFACE  
IOM ADPCM  
(SPI)  
SSD  
DD(P1, P3)  
DD(P0, P2)  
SS(P0, P2)  
DD(BZ)  
SS(BZ)  
AUX-RAM  
(3 kBYTES)  
MICROCONTROLLER-RAM  
(256 BYTES)  
ROM  
(64 kBYTES)  
2
I
C-BUS  
UART  
DD(RF)  
SS(RF)  
DDA  
MICROCONTROLLER  
AB-MICROCONTROLLER  
INTERFACE (ABCIF)  
SSA  
DD(OSC)  
SS(OSC)  
DD(BAT)  
V
V
DD(RF)  
DDD  
V
V
V
DDD  
DDD  
DD(BZ)  
ANT_SW0  
ANT_SW1  
T_ENABLE  
T_PWR  
V
DIGITAL  
DDD  
LEVEL  
BUZZER BUFFER  
(ABB)  
BZP  
BZM  
PULSE  
SHAPER  
(DPS)  
GPP  
SHIFTER  
S_ENABLE  
S_DATA  
S_CLK  
DIGITAL  
RECEIVE  
FILTER  
(DRF)  
DIGITAL  
SIGNAL  
S_PWR  
BURST  
MODE  
LOGIC  
(BML)  
R_ENABLE  
R_PWR  
PROCESSOR  
(DSP)  
DIGITAL  
NOISE  
SHAPER  
(DNS)  
LEVEL  
SHIFTER  
EARP  
EARM  
1-BIT DAC (ARD)  
CODEC  
Σ ∆  
SYSTEM  
DATA  
SLICE_CTR  
REF_CLK  
RAM  
(SDR)  
(1 kBYTE)  
LEVEL  
SHIFTER  
R_DATAP  
R_DATAM  
DIGITAL  
DECIMATING  
FILTER  
MICP/LIFM  
MICM/LIFP  
1-BIT ADC  
MEMORY  
AMP  
(DDF)  
T_GSMK/  
T_DATA  
ATS  
AGM  
V
DDA  
ISB  
V
V
V
DD(OSC)  
DDD  
DDA  
V
CLOCK  
GENERATOR  
(CLG)  
V
ANALOG SWITCH (ASW)  
ref  
ref  
LEVEL  
SHIFTER  
DIGITAL  
CONTROL  
OF  
ANALOG  
(DCA)  
ISB BUS  
CONTROLLER  
(IBC)  
XTAL1  
XTAL2  
V
ANALOG SUBTRACTOR (ASU)  
ANALOG RSSI TREATMENT (ART)  
ADJUSTABLE CURRENT SOURCE (ACS)  
DD(BAT)  
V
ANALOG  
DD(BAT)  
TIMING  
CONTROL  
BLOCK  
VOLTAGE  
SOURCE  
(AVS)  
LEVEL  
SHIFTER  
AUXILIARY  
ADC  
(AAD)  
RSSI_AN  
ANALOG VOLTAGE  
(TICB)  
REFERENCE  
(AVR)  
LEVEL  
SHIFTER  
RESET  
WATCHDOG  
TIMER  
(WDT)  
VANLI  
GENERATOR  
(RGE)  
POWER-ON-RESET  
(POR)  
MGM858  
M_RESET  
VBGP  
VANLO  
(1) Ports 1 and 3 are shared with alternative functions.  
Fig.1 Block diagram.  
12345678...16

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型号 品牌 获取价格 描述 数据表
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