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NS32381-15

更新时间： 2024-02-23 15:14:56
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32页 376K
描述

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NS32381-15 技术参数

生命周期：Obsolete零件包装代码：PGA
包装说明：PGA,针数：68
Reach Compliance Code：unknown风险等级：5.84
边界扫描：NO总线兼容性：NS32016; NS32008; NS32032; NS32C016; NS32C032; NS32332; NS32532; NS32CG16; NS32GX32
最大时钟频率：15.15 MHz外部数据总线宽度：32
JESD-30 代码：S-PPGA-P68端子数量：68
最高工作温度：70 °C最低工作温度：
封装主体材料：PLASTIC/EPOXY封装代码：PGA
封装形状：SQUARE封装形式：GRID ARRAY
认证状态：Not Qualified座面最大高度：4.826 mm
最大供电电压：5.25 V最小供电电压：4.75 V
标称供电电压：5 V表面贴装：NO
技术：CMOS温度等级：COMMERCIAL
端子形式：PIN/PEG端子节距：2.54 mm
端子位置：PERPENDICULARuPs/uCs/外围集成电路类型：MATH PROCESSOR, FLOATING POINT ACCELERATOR

NS32381-15 数据手册

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PRELIMINARY  
April 1991  
NS32381-15/NS32381-20/NS32381-25/NS32381-30  
Floating-Point Unit  
General Description  
The NS32381 is a second generation, CMOS, floating-point  
slave processor that is fully software compatible with its  
forerunner, the NS32081 FPU. The NS32381 FPU functions  
The FPU is fabricated with National’s advanced double-met-  
al CMOS process.  
with all Series 32000 and Series 32000/EP CPUs in a  
É
Features  
Y
tightly coupled slave configuration. The performance of the  
NS32381 has been increased over the NS32081 by archi-  
tecture improvements, hardware enhancements, and higher  
clock frequencies. Key improvements include the addition of  
a 32-bit slave protocol, an early done algorithm to increase  
CPU/FPU parallelism, an expanded register set, an auto-  
matic power down feature, expanded math hardware, and  
additional instructions.  
Compatible with all Series 32000 and Series 32000/EP  
CPUs  
Y
Selectable 16-bit or 32-bit Slave Protocol  
Y
Compatible with IEEE Standard 754-1985 for binary  
floating point arithmetic  
Y
Early done algorithm  
Y
Single (32-bit) and double (64-bit) precision operations  
Y
Eight on-chip (64-bit) data registers  
The NS32381 FPU contains eight 64-bit data registers and  
a Floating-Point Status Register (FSR). The FPU executes  
20 instructions, and operates on both single and double-  
precision operands. Three separate processors in the  
NS32381 manipulate the mantissa, sign, and exponent.  
Y
Automatic power down mode  
Y
Full upward compatibility with existing 32000 software  
Y
High speed double-metal CMOS design  
Y
68-pin PGA package  
Y
The CPU and NS32381 FPU form a tightly coupled comput-  
er cluster, which appears to the user as a single processing  
unit. The CPU and FPU communication is handled automati-  
cally, and is user transparent.  
68-pin plastic package  
FPU Block Diagram  
TL/EE/9157–1  
FIGURE 1-1  
Series 32000É and TRI-STATEÉ are registered trademarks of National Semiconductor Corporation.  
C
1995 National Semiconductor Corporation  
TL/EE/9157  
RRD-B30M115/Printed in U. S. A.  
1234567...32

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