是否Rohs认证: | 符合 | 生命周期: | Obsolete |
零件包装代码: | SOIC | 包装说明: | PLASTIC, SO-14 |
针数: | 14 | Reach Compliance Code: | unknown |
HTS代码: | 8542.39.00.01 | 风险等级: | 5.84 |
系列: | F/FAST | JESD-30 代码: | R-PDSO-G14 |
长度: | 8.65 mm | 负载电容(CL): | 50 pF |
逻辑集成电路类型: | J-K FLIP-FLOP | 位数: | 2 |
功能数量: | 2 | 端子数量: | 14 |
最高工作温度: | 70 °C | 最低工作温度: | |
输出极性: | COMPLEMENTARY | 封装主体材料: | PLASTIC/EPOXY |
封装代码: | SOP | 封装形状: | RECTANGULAR |
封装形式: | SMALL OUTLINE | 峰值回流温度(摄氏度): | 260 |
最大电源电流(ICC): | 21 mA | 传播延迟(tpd): | 7 ns |
认证状态: | Not Qualified | 座面最大高度: | 1.75 mm |
最大供电电压 (Vsup): | 5.5 V | 最小供电电压 (Vsup): | 4.5 V |
标称供电电压 (Vsup): | 5 V | 表面贴装: | YES |
技术: | TTL | 温度等级: | COMMERCIAL |
端子形式: | GULL WING | 端子节距: | 1.27 mm |
端子位置: | DUAL | 处于峰值回流温度下的最长时间: | 40 |
触发器类型: | NEGATIVE EDGE | 宽度: | 3.9 mm |
最小 fmax: | 80 MHz | Base Number Matches: | 1 |
型号 | 品牌 | 获取价格 | 描述 | 数据表 |
N74F113N | NXP |
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Dual J-K negative edge-triggered flip-flops without reset | |
N74F113N,602 | NXP |
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N74F113N | |
N74F113N-B | ETC |
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J-K-Type Flip-Flop | |
N74F114D | NXP |
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Dual J-K negative edge-triggered flip-flop with common clock and reset | |
N74F114DB | PHILIPS |
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J-K Flip-Flop, 2-Func, Negative Edge Triggered, TTL, PDSO14 | |
N74F114D-T | PHILIPS |
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J-K Flip-Flop, 2-Func, Negative Edge Triggered, TTL, PDSO14, | |
N74F114N | NXP |
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Dual J-K negative edge-triggered flip-flop with common clock and reset | |
N74F114N-B | PHILIPS |
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J-K Flip-Flop, 2-Func, Negative Edge Triggered, TTL, PDIP14 | |
N74F11D | NXP |
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Triple 3-input NAND gate | |
N74F11D,602 | NXP |
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74F11 - Triple 3-input AND gate SOIC 14-Pin |