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| 是否Rohs认证： | 不符合 | 生命周期： | Obsolete |
| 包装说明： | DIP, DIP14,.3 | Reach Compliance Code： | unknown |
| 风险等级： | 5.92 | JESD-30 代码： | R-PDIP-T14 |
| JESD-609代码： | e0 | 逻辑集成电路类型： | J-K FLIP-FLOP |
| 最大频率@ Nom-Sup： | 80000000 Hz | 最大I（ol）： | 0.02 A |
| 功能数量： | 2 | 端子数量： | 14 |
| 最高工作温度： | 70 °C | 最低工作温度： | |
| 封装主体材料： | PLASTIC/EPOXY | 封装代码： | DIP |
| 封装等效代码： | DIP14,.3 | 封装形状： | RECTANGULAR |
| 封装形式： | IN-LINE | 电源： | 5 V |
| 最大电源电流（ICC）： | 21 mA | 子类别： | FF/Latches |
| 标称供电电压 (Vsup)： | 5 V | 表面贴装： | NO |
| 技术： | TTL | 温度等级： | COMMERCIAL |
| 端子面层： | Tin/Lead (Sn/Pb) | 端子形式： | THROUGH-HOLE |
| 端子节距： | 2.54 mm | 端子位置： | DUAL |
| 触发器类型： | NEGATIVE EDGE | Base Number Matches： | 1 |
| 型号 | 品牌 | 获取价格 | 描述 | 数据表 |
| N74F114D | NXP |
获取价格 |
Dual J-K negative edge-triggered flip-flop with common clock and reset |
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| N74F114DB | PHILIPS |
获取价格 |
J-K Flip-Flop, 2-Func, Negative Edge Triggered, TTL, PDSO14 |
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| N74F114D-T | PHILIPS |
获取价格 |
J-K Flip-Flop, 2-Func, Negative Edge Triggered, TTL, PDSO14, |
|
| N74F114N | NXP |
获取价格 |
Dual J-K negative edge-triggered flip-flop with common clock and reset |
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| N74F114N-B | PHILIPS |
获取价格 |
J-K Flip-Flop, 2-Func, Negative Edge Triggered, TTL, PDIP14 |
|
| N74F11D | NXP |
获取价格 |
Triple 3-input NAND gate |
|
| N74F11D,602 | NXP |
获取价格 |
74F11 - Triple 3-input AND gate SOIC 14-Pin |
|
| N74F11D-T | ETC |
获取价格 |
Triple 3-input AND Gate |
|
| N74F11N | NXP |
获取价格 |
Triple 3-input NAND gate |
|
| N74F11N,602 | NXP |
获取价格 |
74F11 - Triple 3-input AND gate DIP 14-Pin |
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