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MM74HCA393J PDF预览

MM74HCA393J

更新时间： 2024-11-20 15:43:31
品牌 Logo 应用领域
美国国家半导体 - NSC 逻辑集成电路触发器
页数 文件大小 规格书
8页 153K
描述
IC HCA SERIES, ASYN NEGATIVE EDGE TRIGGERED 4-BIT UP BINARY COUNTER, CDIP14, DIP-14, Counter

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MM74HCA393J 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
包装说明：DIP, DIP14,.3Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.92
计数方向：UP系列：HCA
JESD-30 代码：R-GDIP-T14JESD-609代码：e0
长度：19.43 mm负载电容（CL）：50 pF
负载/预设输入：NO逻辑集成电路类型：BINARY COUNTER
最大频率@ Nom-Sup：27000000 Hz最大I（ol）：0.004 A
工作模式：ASYNCHRONOUS位数：4
功能数量：2端子数量：14
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：CERAMIC, GLASS-SEALED封装代码：DIP
封装等效代码：DIP14,.3封装形状：RECTANGULAR
封装形式：IN-LINE峰值回流温度（摄氏度）：NOT SPECIFIED
电源：2/6 V传播延迟（tpd）：325 ns
认证状态：Not Qualified座面最大高度：5.08 mm
子类别：Counters最大供电电压 (Vsup)：6 V
最小供电电压 (Vsup)：2 V表面贴装：NO
技术：CMOS温度等级：INDUSTRIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED触发器类型：NEGATIVE EDGE
宽度：7.62 mm最小 fmax：50 MHz
Base Number Matches：1

MM74HCA393J 数据手册

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October 1990  
MM74HCA390 Dual 4-Bit Decade Counter/  
MM74HCA393 Dual 4-Bit Binary Counter  
General Description  
These counter circuits contain independent ripple carry  
counters and utilize advanced silicon-gate CMOS technolo-  
gy. The MM74HCA390 incorporates dual decade counters,  
tionally as well as pin equivalent to the 74LS390/74LS393.  
All inputs are protected from damage due to static dis-  
charge by diodes to V  
and ground.  
CC  
each composed of  
a divide-by-two and a divide-by-five  
counter. The divide-by-two and divide-by-five counters can  
be cascaded to form dual decade, dual bi-quinary, or vari-  
ous combinations up to a single divide-by-100 counter. The  
MM74HCA393 contains two 4-bit ripple carry binary coun-  
ters, which can be cascaded to create a single divide-by-  
256 counter.  
Features  
Y
Typical operating frequency: 50 MHz  
Y
Y
Y
Y
Typical propagation delay: 15 ns (Ck to Q )  
A
Wide operating supply voltage range: 2–6V  
k
Low input current: 1 mA  
Low quiescent supply current: 40 mA maximum  
(74HC Series)  
Each of the two 4-bit counters is incremented on the high to  
low transition (negative edge) of the clock input, and each  
has an independent clear input. When clear is set high all  
four bits of each counter are set to a low level. This enables  
count truncation and allows the implementation of divide-by-  
N counter configurations.  
Y
Y
Y
Y
Y
Fanout of 10 LS-TTL loads  
Low output noise generation  
QOS specifications V  
, V  
OLV OLP  
Identical pinout to HC  
Speed upgrade of HC  
Each of the counters outputs can drive 10 low power  
Schottky TTL equivalent loads. These counters are func-  
Connection Diagrams  
Dual-In-Line Package  
Dual-In-Line Package  
TL/F/10886–3  
Top View  
TL/F/10886–1  
Order Number MM74HCA390  
Top View  
Order Number MM74HCA393  
C
1995 National Semiconductor Corporation  
TL/F/10886  
RRD-B30M105/Printed in U. S. A.  
12345678

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型号 品牌 获取价格 描述 数据表
MM74HCA393N TI

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