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MC74HCT74ADG

更新时间： 2024-02-08 11:22:06
品牌 Logo 应用领域
安森美 - ONSEMI 触发器
页数 文件大小 规格书
6页 135K
描述
Dual D Flip−Flop with Set and Reset with LSTTL Compatible Inputs

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MC74HCT74ADG 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：DIP
包装说明：DIP, DIP14,.3针数：14
Reach Compliance Code：unknownHTS代码：8542.39.00.01
Factory Lead Time：1 week风险等级：5.21
系列：HCTJESD-30 代码：R-PDIP-T14
JESD-609代码：e3长度：18.86 mm
负载电容（CL）：50 pF逻辑集成电路类型：D FLIP-FLOP
最大频率@ Nom-Sup：20000000 Hz最大I（ol）：0.004 A
位数：1功能数量：2
端子数量：14最高工作温度：125 °C
最低工作温度：-55 °C输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：DIP
封装等效代码：DIP14,.3封装形状：RECTANGULAR
封装形式：IN-LINE包装方法：RAIL
峰值回流温度（摄氏度）：260电源：5 V
传播延迟（tpd）：36 ns认证状态：Not Qualified
座面最大高度：4.69 mm子类别：FF/Latches
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：NO
技术：CMOS温度等级：MILITARY
端子面层：Matte Tin (Sn) - annealed端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
处于峰值回流温度下的最长时间：40触发器类型：POSITIVE EDGE
宽度：7.62 mm最小 fmax：20 MHz

MC74HCT74ADG 数据手册

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MC74HCT74A  
Dual D Flip−Flop with Set  
and Reset with LSTTL  
Compatible Inputs  
High−Performance Silicon−Gate CMOS  
The MC74HCT74A is identical in pinout to the LS74. This device  
may be used as a level converter for interfacing TTL or NMOS outputs  
to High Speed CMOS inputs.  
http://onsemi.com  
MARKING  
DIAGRAMS  
This device consists of two D flip−flops with individual Set, Reset,  
and Clock inputs. Information at a D−input is transferred to the  
corresponding Q output on the next positive going edge of the clock  
input. Both Q and Q outputs are available from each flip−flop. The Set  
and Reset inputs are asynchronous.  
14  
PDIP−14  
N SUFFIX  
CASE 646  
MC74HCT74AN  
AWLYYWWG  
14  
1
1
Features  
14  
• Output Drive Capability: 10 LSTTL Loads  
• TTL NMOS Compatible Input Levels  
• Outputs Directly Interface to CMOS, NMOS, and TTL  
• Operating Voltage Range: 4.5 to 5.5 V  
• Low Input Current: 1.0 mA  
• In Compliance With the JEDEC Standard No. 7.0 A Requirements  
• Chip Complexity: 136 FETs or 34 Equivalent Gates  
• Pb−Free Packages are Available  
SOIC−14  
D SUFFIX  
CASE 751A  
HCT74AG  
AWLYWW  
14  
1
1
A
= Assembly Location  
L, WL = Wafer Lot  
Y, YY = Year  
W, WW = Work Week  
= Pb−Free Package  
G
PIN ASSIGNMENT  
LOGIC DIAGRAM  
RESET 1  
DATA 1  
1
2
14  
13 RESET 2  
12  
V
CC  
1
RESET 1  
3
4
CLOCK 1  
SET 1  
DATA 2  
5
6
2
3
DATA 1  
Q1  
Q1  
11 CLOCK 2  
10 SET 2  
Q1  
Q1  
5
6
7
CLOCK 1  
9
8
Q2  
Q2  
4
SET 1  
GND  
PIN 14 = V  
CC  
PIN 7 = GND  
13  
RESET 2  
FUNCTION TABLE  
9
12  
11  
Inputs  
Outputs  
DATA 2  
Q2  
8
Set Reset Clock Data  
Q
Q
CLOCK 2  
Q2  
L
H
L
H
H
H
H
H
H
L
L
H
H
H
H
H
X
X
X
X
X
X
H
L
X
X
X
H
L
H*  
H
L
L
H
H*  
L
10  
SET 2  
Design Criteria  
Internal Gate Count†  
Value  
34  
Units  
ea.  
ns  
H
L
H
No Change  
No Change  
No Change  
Internal Gate Propagation Delay  
Internal Gate Power Dissipation  
Speed Power Product  
1.5  
5.0  
mW  
pJ  
*Both outputs will remain high as long as Set and  
Reset are low, but the output states are unpredict-  
able if Set and Reset go high simultaneously.  
.0075  
†Equivalent to a two−input NAND gate.  
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 3 of this data sheet.  
©
Semiconductor Components Industries, LLC, 2006  
1
Publication Order Number:  
October, 2006 − Rev. 10  
MC74HCT74A/D  
123456

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MC74HCT74ADG 替代型号

型号 品牌 替代类型 描述 数据表
MC74HCT74ADR2G ONSEMI

完全替代

 Dual D Flip−Flop with Set and Reset with LSTTL Compatible Inputs
MC74HCT74ANG ONSEMI

类似代替

 Dual D Flip−Flop with Set and Reset with LSTTL Compatible Inputs
MC74HCT74AD ONSEMI

类似代替

 Dual D Flip-Flop with Set and Reset with LSTTL Compatible Inputs

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型号 品牌 获取价格 描述 数据表
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