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MC74ACT74DTEL

更新时间： 2024-11-15 15:41:03
品牌 Logo 应用领域
安森美 - ONSEMI 光电二极管逻辑集成电路触发器
页数 文件大小 规格书
6页 187K
描述
IC,FLIP-FLOP,DUAL,D TYPE,ACT-CMOS,TSSOP,14PIN,PLASTIC

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MC74ACT74DTEL 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
包装说明：SOP, TSSOP14,.25Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5.92
系列：ACTJESD-30 代码：R-PDSO-G14
JESD-609代码：e0负载电容（CL）：50 pF
逻辑集成电路类型：D FLIP-FLOP最大频率@ Nom-Sup：125000000 Hz
最大I（ol）：0.024 A位数：1
功能数量：2端子数量：14
最高工作温度：85 °C最低工作温度：-40 °C
输出极性：COMPLEMENTARY封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：TSSOP14,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
包装方法：TAPE AND REEL电源：5 V
传播延迟（tpd）：13 ns认证状态：Not Qualified
子类别：FF/Latches最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Tin/Lead (Sn/Pb)
端子形式：GULL WING端子节距：0.635 mm
端子位置：DUAL触发器类型：POSITIVE EDGE
最小 fmax：125 MHzBase Number Matches：1

MC74ACT74DTEL 数据手册

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DUAL D-TYPE POSITIVE  
EDGE-TRIGGERED  
FLIP-FLOP  
The MC74AC74/74ACT74 is a dual D-type flip-flop with Asynchronous Clear  
and Set inputs and complementary (Q,Q) outputs. Information at the input is  
transferred to the outputs on the positive edge of the clock pulse. Clock triggering  
occurs at a voltage level of the clock pulse and is not directly related to the transition  
time of the positive-going pulse. After the Clock Pulse input threshold voltage has  
been passed, the Data input is locked out and information present will not be  
transferred to the outputs until the next rising edge of the Clock Pulse input.  
Asynchronous Inputs:  
LOW input to S (Set) sets Q to HIGH level  
D
LOW input to C (Clear) sets Q to LOW level  
D
Clear and Set are independent of clock  
Simultaneous LOW on C and S makes both Q and Q HIGH  
D
D
N SUFFIX  
CASE 646-06  
PLASTIC  
• Outputs Source/Sink 24 mA  
• ′ACT74 Has TTL Compatible Inputs  
V
C
D
CP  
S
Q
Q
2
CC  
14  
D2  
13  
2
2
D2  
10  
2
12  
11  
9
8
C
S
D1  
D2  
D
Q
CP  
Q
1
1
2
2
2
PIN NAMES  
CP  
Q
D
Q
S
C
1
1
2
D SUFFIX  
CASE 751A-03  
PLASTIC  
D1  
D2  
D , D  
Data Inputs  
1
2
CP , CP  
Clock Pulse Inputs  
Direct Clear Inputs  
Direct Set Inputs  
Outputs  
1
2
C
S
, C  
D1 D2  
1
2
3
CP  
4
5
6
7
, S  
D1 D2  
Q , Q , Q , Q  
C
D
S
Q
Q
1
GND  
1
1
2
2
D1  
1
1
D1  
1
LOGIC SYMBOL  
TRUTH TABLE (Each Half)  
Inputs  
CP  
Outputs  
Q
Q
1
1
S
C
D
Q
Q
S
C
D
D
D1  
D1  
D
CP  
1
1
L
H
L
H
H
H
H
L
L
X
X
X
X
X
X
H
L
H
L
H
H
L
L
H
H
L
H
H
H
H
L
X
Q
Q
0
0
Q
Q
2
CD  
2
S
D2  
H = HIGH Voltage Level  
L = LOW Voltage Level  
X = Immaterial  
2
D
CP  
2
2
= LOW-to-HIGH Clock Transition  
Q (Q ) = Previous Q(Q) before  
0
0
LOW-to-HIGH Transition of Clock  
FACT DATA  
5-1  
123456

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型号 品牌 获取价格 描述 数据表
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 		IC ACT SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO14, EIA
MC74ACT74MEL ONSEMI

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 		Dual D−Type Positive Edge−Triggered Flip−Flop
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 		Dual D−Type Positive Edge−Triggered Flip−Flop
MC74ACT74MELG ROCHESTER

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 		D Flip-Flop, ACT Series, 2-Func, Positive Edge Triggered, 1-Bit, Complementary Output, CMO
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 		IC,FLIP-FLOP,DUAL,D TYPE,ACT-CMOS,SOP,14PIN,PLASTIC
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