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MC10H681FN

更新时间： 2024-11-22 22:33:11
品牌 Logo 应用领域
摩托罗拉 - MOTOROLA 锁存器
页数 文件大小 规格书
7页 116K
描述
Hex ECL/TTL Transceiver with Latches

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MC10H681FN 技术参数

生命周期：Transferred零件包装代码：QLCC
包装说明：QCCJ,针数：28
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.3
最大延迟：输入特性：STANDARD
接口集成电路类型：TTL TO ECL TRANSCEIVERJESD-30 代码：S-PQCC-J28
JESD-609代码：e0长度：11.5062 mm
位数：6功能数量：1
端子数量：28最高工作温度：75 °C
最低工作温度：输出特性：OPEN-EMITTER WITH CUT-OFF
输出锁存器或寄存器：LATCH输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装形状：SQUARE封装形式：CHIP CARRIER
认证状态：Not Qualified座面最大高度：4.57 mm
最大压摆率：63 mA最大供电电压：5.5 V
最小供电电压：4.5 V标称供电电压：5 V
电源电压1-最大：-5.46 V电源电压1-分钟：-4.94 V
电源电压1-Nom：-5.2 V表面贴装：YES
技术：BIPOLAR温度等级：COMMERCIAL EXTENDED
端子面层：Tin/Lead (Sn/Pb)端子形式：J BEND
端子节距：1.27 mm端子位置：QUAD
宽度：11.5062 mmBase Number Matches：1

MC10H681FN 数据手册

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SEMICONDUCTOR TECHNICAL DATA  
The MC10/100H681 is a dual supply Hex ECL/TTL transceiver with  
latches in both directions. ECL controlled Direction and Chip Enable Bar  
pins. There are two Latch Enable pins, one for each direction.  
The ECL outputs are single ended and drive 50 Ω. The TTL outputs are  
specified to source 15 mA and sink 48 mA, allowing the ability to drive highly  
capacitive loads. The high driving ability of the TTL outputs make the device  
ideal for bussing applications.  
The ECL output levels are standard V  
and V  
cutoff equal to –2.0 V  
OH  
OL  
(V ). When the ECL ports are disabled the outputs go to the V  
cutoff  
TT OL  
level. Multiple ECL V pins are utilized to minimize switching noise.  
CCO  
FN SUFFIX  
PLASTIC PACKAGE  
CASE 776–02  
The TTL ports have standard levels. The TTL input receivers have PNP  
input devices to significantly reduce loading. Multiple TTL power and ground  
pins are utilized to minimize switching noise.  
The 10H version is compatible with MECL 10H ECL logic levels. The  
100H version is compatible with 100K levels.  
•
•
•
•
Separate Latch Enable Controls for each Direction  
ECL Single Ended 50 Ω I/O Port  
High Drive TTL I/O Ports  
Extra TTL and ECL Power/Ground Pins to Minimize  
Switching Noise  
•
•
Dual Supply  
Direction and Chip Enable Control Pins  
Pin  
Symbol  
Description  
1
2
3
TI01  
VT  
GT  
TTL I/O BIT 1  
TTL V (5.0 V)  
TTL GND (0 V)  
CC  
4
5
6
7
8
9
TI00  
DIR  
CEB  
LEET  
LETE  
TTL I/O Bit 0  
Pinout: 28–Lead PLCC (Top View)  
Direction Control (ECL)  
Chip Enable Bar Control (ECL)  
Latch Enable ECL-TTL Control (ECL)  
Latch Enable TTL-ECL Control (ECL)  
ECL Supply (–5.2/–4.5 V)  
ECL I/O BIT 0  
V
EE  
25  
24  
23  
22  
21  
20  
19  
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
25  
26  
27  
28  
EI00  
EI01  
EI02  
26  
27  
28  
18  
EIO5  
TIO2  
VT  
ECL I/O BIT 1  
ECL I/O BIT 2  
V
17  
16  
CCO  
V
ECL V  
(0 V) — Outputs  
CCO  
EIO3  
CC  
TTL I/O BIT 3  
ECL V (0 V)  
GT  
EIO4  
V
CCE  
EIO4  
CC  
ECL I/O BIT 4  
ECL V (0 V) — Outputs  
TIO1  
VT  
15  
14  
13  
12  
V
1
2
CCE  
V
CCO  
CC  
EIO5  
TI05  
GT  
ECL I/O BIT 5  
TTL I/O BIT 5  
TTL GND (0 V)  
EIO3  
3
4
V
GT  
VT  
TI04  
GT  
TTL V  
TTL I/O BIT 4  
(5.0 V)  
CCO  
CC  
TIO0  
EIO2  
TTL GND (0 V)  
VT  
TTL V  
TTL I/O BIT 3  
TTL I/O BIT 2  
(5.0 V)  
CC  
5
6
7
8
9
10  
11  
TIO3  
TIO2  
VT  
TTL V  
TTL V  
(5.0 V)  
(0 V)  
CC  
CC  
GT  
9/96  
Motorola, Inc. 1996  
REV 2  
1234567

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型号 品牌 获取价格 描述 数据表
MC10H681FNR2 ONSEMI

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 		HEX TTL TO ECL TRANSCEIVER, TRUE OUTPUT, PQCC28, PLASTIC, LCC-28
MC10LVEL40DW ONSEMI

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