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Datasheet > 逻辑 > 触发器/锁存器> MC100E452FN
MC100E452FN PDF预览

MC100E452FN

更新时间： 2024-09-30 22:46:23
品牌 Logo 应用领域
摩托罗拉 - MOTOROLA 触发器锁存器逻辑集成电路
页数 文件大小 规格书
4页 115K
描述
5-BIT DIFFERENTIAL REGISTER

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MC100E452FN 技术参数

生命周期：Transferred零件包装代码：QLCC
包装说明：QCCJ, LDCC28,.5SQ针数：28
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.44Is Samacsys：N
其他特性：WITH DIFFERENTIAL CLOCK系列：100E
JESD-30 代码：S-PQCC-J28JESD-609代码：e0
长度：11.505 mm逻辑集成电路类型：D FLIP-FLOP
最大频率@ Nom-Sup：1100000000 Hz位数：5
功能数量：1端子数量：28
最高工作温度：85 °C最低工作温度：-40 °C
输出特性：OPEN-EMITTER输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装等效代码：LDCC28,.5SQ封装形状：SQUARE
封装形式：CHIP CARRIER电源：-4.5 V
最大电源电流（ICC）：102 mA传播延迟（tpd）：0.9 ns
认证状态：Not Qualified座面最大高度：4.57 mm
子类别：Shift Registers表面贴装：YES
技术：ECL温度等级：INDUSTRIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：J BEND
端子节距：1.27 mm端子位置：QUAD
触发器类型：POSITIVE EDGE宽度：11.505 mm
最小 fmax：1000 MHzBase Number Matches：1

MC100E452FN 数据手册

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SEMICONDUCTOR TECHNICAL DATA  
The MC10E/100E452 is a 5-bit differential register with differential data  
(inputs and outputs) and clock. The registers are triggered by a positive  
transition of the positive clock (CLK) input. A high on the Master Reset  
(MR) asynchronously resets all registers so that the Q outputs go LOW.  
The differential input structures are clamped so that the inputs of  
unused registers can be left open without upsetting the bias network of  
the device. The clamping action will assert the D and the CLK sides of the  
inputs. Because of the edge triggered flip-flop nature of the device  
simultaneously opening both the clock and data inputs will result in an  
output which reaches an unidentified but valid state. Note that the input  
5-BIT DIFFERENTIAL  
REGISTER  
clamps only operate when both inputs fall to 2.5V below V  
.
CC  
The fully differential design of the device makes it ideal for very high  
frequency applications where a registered data path is necessary.  
• Differential D, CLK and Q; V  
BB  
Reference Available  
• 1100MHz Min. Toggle Frequency  
• Asynchronous Master Reset  
• Extended 100E V  
Range of – 4.2V to – 5.46V  
Pinout: 28-Lead PLCC (Top View)  
EE  
FN SUFFIX  
PLASTIC PACKAGE  
CASE 776-02  
D
D
D
D
V
Q
Q
4
3
3
4
4
CCO  
21  
4
25  
24  
23  
22  
20  
19  
18  
17  
Q
Q
V
MR  
CLK  
CLK  
26  
3
27  
28  
1
3
LOGIC DIAGRAM  
16  
15  
CC  
D
D
0
0
D
Q
Q
Q
0
0
V
Q
EE  
2
2
V
2
3
4
14  
13  
12  
Q
BB  
R
R
D
2
Q
1
1
D
D
1
1
D
Q
Q
Q
1
1
D
2
Q
5
6
7
8
9
10  
11  
D
D
D
D
V
Q
Q
0
1
1
0
0
CCO  
0
D
D
2
2
Q
Q
Q
Q
Q
D
* All V  
and V  
CCO  
pins are tied together on the die.  
2
2
CC  
R
D
D
3
3
Q
Q
D
D
3
3
R
R
PIN NAMES  
Pin  
D
D
4
4
Q
Q
4
4
Function  
D[0:4], D[0:4]  
MR  
CLK, CLK  
VBB  
Differential Data Inputs  
Master Reset Input  
Differential Clock Input  
VBB Reference Output  
Differential Data Outputs  
CLK  
CLK  
MR  
Q[0:4], Q[0:4]  
V
BB  
12/93  
Motorola, Inc. 1996  
REV 2  
1234

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