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M4A3-192/96-6FANC

更新时间： 2024-10-29 18:38:27

品牌	Logo	应用领域
莱迪思 - LATTICE		时钟输入元件可编程逻辑
页数	文件大小	规格书
62页	1081K
描述
EE PLD, 6ns, CMOS, PBGA144, FPBGA-144

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M4A3-192/96-6FANC 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	BGA
包装说明：	FPBGA-144	针数：	144
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.76
最大时钟频率：	102 MHz	JESD-30 代码：	S-PBGA-B144
JESD-609代码：	e1	长度：	13 mm
湿度敏感等级：	3	专用输入次数：	16
I/O 线路数量：	96	端子数量：	144
最高工作温度：	70 °C	最低工作温度：
组织：	16 DEDICATED INPUTS, 96 I/O	输出函数：	MACROCELL
封装主体材料：	PLASTIC/EPOXY	封装代码：	BGA
封装形状：	SQUARE	封装形式：	GRID ARRAY
峰值回流温度（摄氏度）：	250	可编程逻辑类型：	EE PLD
传播延迟：	6 ns	认证状态：	Not Qualified
座面最大高度：	2.1 mm	最大供电电压：	3.6 V
最小供电电压：	3 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Tin/Silver/Copper (Sn/Ag/Cu)
端子形式：	BALL	端子节距：	1 mm
端子位置：	BOTTOM	处于峰值回流温度下的最长时间：	40
宽度：	13 mm	Base Number Matches：	1

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ispMACH^™4A CPLD Family

High Performance E²CMOS^®

Le a d -

e e

In-System Programmable Logic

P a c k a g e

Op t io n s

a ila b le !

FEATURES

◆ High-performance, E CMOS 3.3-V & 5-V CPLD families

◆ Flexible architecture for rapid logic designs

— Excellent First-Time-Fit and reﬁt feature

— SpeedLocking performance for guaranteed ﬁxed timing

— Central, input and output switch matrices for 100% routability and 100% pin-out retention

◆ High speed

— 5.0ns t Commercial and 7.5ns t Industrial

— 182MHz f

CNT

◆ 32 to 512 macrocells; 32 to 768 registers

◆ 44 to 388 pins in PLCC, PQFP, TQFP, BGA, fpBGA and caBGA packages

◆ Flexible architecture for a wide range of design styles

— D/T registers and latches

— Synchronous or asynchronous mode

— Dedicated input registers

— Programmable polarity

— Reset/ preset swapping

◆ Advanced capabilities for easy system integration

— 3.3-V & 5-V JEDEC-compliant operations

— JTAG (IEEE 1149.1) compliant for boundary scan testing

— 3.3-V & 5-V JTAG in-system programming

— PCI compliant (-5/-55/-6/-65/-7/-10/-12 speed grades)

— Safe for mixed supply voltage system designs

— Programmable pull-up or Bus-Friendly inputs and I/Os

— Hot-socketing

— Programmable security bit

— Individual output slew rate control

◆ Advanced E CMOS process provides high-performance, cost-effective solutions

◆ Lead-free package options

Publication# ISPM4A Rev: M

Amendment/0

Issue Date: September 2006

12 3 4 5 6 7...62

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