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LMK1D1204PRHDT

更新时间： 2023-09-03 20:31:35

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德州仪器 - TI		/
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32页	1485K
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带引脚控制的 4 通道输出 LVDS 1.8V、2.5V 和 3.3V 缓冲器 \| RHD \| 28 \| -40 to 105

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LMK1D1204PRHDT 数据手册

LMK1D1204P

ZHCSP13A –SEPTEMBER 2021 –REVISED JUNE 2023

LMK1D1204P 引脚控制型OE 低附加抖动LVDS 缓冲器

1 特性

3 说明

• 具有2 路输入和4 路输出(2:4) 的高性能LVDS 时

钟缓冲器系列

• 输出频率最高可达2GHz

• 通过硬件引脚实现启用/禁用独立输出

• 电源电压：1.8V/2.5V/3.3V ± 5%

• 低附加抖动：156.25MHz 下小于12kHz 至20MHz

范围内的60fs rms 最大值

LMK1D1204P 时钟缓冲器能够以超小的时钟分配延

迟，将两个中的任一可选时钟输入（IN0 和 IN1）分配

给 4 对差分 LVDS 时钟输出（OUT0 至 OUT3）。输

入可以为 LVDS、LVPECL、LVCMOS、HCSL 或

CML。

LMK1D1204P 专为驱动 50Ω 传输线路而设计。在单端

模式下驱动输入时，对未使用的负输入引脚施加适当的

偏置电压（请参阅图 9-6）。IN_SEL 引脚用于选择要

发送到输出的输入。该器件支持失效防护输入功能。该

器件还整合了输入迟滞，可防止在没有输入信号的情况

下输出随机振荡。

– 超低相位本底噪声：-164dBc/Hz（典型值）

• 超低传播延迟：< 575ps（最大值）

• 输出偏斜：20ps（最大值）

• 失效防护输入

• 通用输入接受LVDS、LVPECL、LVCMOS、HCSL

和CML

• LVDS 基准电压(V_{AC_REF}) 适用于容性耦合输入

• 工业温度范围：–40°C 至105°C

• 可用封装：

各个 LVDS 差分输出均可通过将对应的 OEx 引脚设置

为逻辑高电平“1”来实现。如果此引脚设置为逻辑低

电平“0”，输出将被禁用，呈现高阻态，从而降低功

耗。

– 5mm × 5mm 28 引脚VQFN (RHD) 封装

该器件可在 1.8V、2.5V 或 3.3V 电源环境下工作，额

定温度范围是–40°C 至105°C（环境温度）。

2 应用

封装信息

• 电信及网络

• 医疗成像

封装尺寸（标称值）

封装⁽¹⁾

器件型号

(2)

• 测试和测量

• 无线基础设施

• 专业音频、视频和标牌

LMK1D1204P

VQFN (28)

5.00mm × 5.00mm

(1) 如需了解所有可用封装，请参阅数据表末尾的可订购产品附

录。

(2) 封装尺寸（长× 宽）为标称值，并包括引脚（如适用）。

ADC CLOCK

500 MHz

156.25 MHz

Oscillator

LMK1D1204P

LVDS Buffer

IN_SEL

FPGA CLOCK

0Ex

应用示例

本文档旨在为方便起见，提供有关TI 产品中文版本的信息，以确认产品的概要。有关适用的官方英文版本的最新信息，请访问

www.ti.com，其内容始终优先。TI 不保证翻译的准确性和有效性。在实际设计之前，请务必参考最新版本的英文版本。

English Data Sheet: SNAS830

12 3 4 5 6 7...32

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