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LF43168JC22

更新时间： 2024-11-22 23:46:11
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逻辑 - LOGIC /
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16页 186K
描述
Digital Filter

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LF43168JC22 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Contact Manufacturer零件包装代码：LCC
包装说明：QCCJ, LDCC84,1.2SQ针数：84
Reach Compliance Code：compliantECCN代码：3A001.A.3
HTS代码：8542.39.00.01风险等级：5.24
其他特性：2 X 10 BIT DATA INPUT BUS; ICC SPECIFIED AT 20MHZ边界扫描：NO
最大时钟频率：45.45 MHz外部数据总线宽度：10
JESD-30 代码：S-PQCC-J84JESD-609代码：e0
长度：29.3116 mm低功率模式：NO
湿度敏感等级：3端子数量：84
最高工作温度：70 °C最低工作温度：
输出数据总线宽度：28封装主体材料：PLASTIC/EPOXY
封装代码：QCCJ封装等效代码：LDCC84,1.2SQ
封装形状：SQUARE封装形式：CHIP CARRIER
峰值回流温度（摄氏度）：NOT SPECIFIED电源：5 V
认证状态：Not Qualified座面最大高度：5.08 mm
子类别：DSP Peripherals最大压摆率：300 mA
最大供电电压：5.25 V最小供电电压：4.75 V
标称供电电压：5 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：J BEND
端子节距：1.27 mm端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：29.3116 mm
uPs/uCs/外围集成电路类型：DSP PERIPHERAL, DIGITAL FILTERBase Number Matches：1

LF43168JC22 数据手册

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LF43168  
Dual 8-Tap FIR Filter  
DEVICES INCORPORATED  
FEATURES  
DESCRIPTION  
The LF43168 is a high-speed dual FIR  
filter capable of filtering data at real-  
time video rates. The device contains  
two FIR filters which may be used as  
two separate filters or cascaded to  
form one filter. The input and coeffi-  
cient data are both 10-bits and can be  
in unsigned, two’s complement, or  
mixed mode format.  
be implemented. The LF43168 can  
decimate the output data by as much  
as 16:1. When the device is pro-  
grammed to decimate, the number of  
clock cycles available to calculate filter  
taps increases. When configured for  
16:1 decimation, each filter can be  
configured as a 128-tap FIR filter (if  
symmetric coefficient sets are used).  
By cascading these two filters, the  
device can be configured as a 256-tap  
FIR filter.  
❑ 66 MHz Data and Computation Rate  
❑ Two Independent 8-Tap or Single  
16-Tap FIR Filters  
❑ 10-bit Data and Coefficient Inputs  
❑ 32 Programmable Coefficient Sets  
❑ Supports Interleaved Coefficient Sets  
❑ User Programmable Decimation up  
to 16:1  
❑ Maximum of 256 FIR Filter Taps,  
16 x 16 2-D Kernels, or 10 x 20-bit  
Data and Coefficients  
The filter architecture is optimized for  
symmetric coefficient sets. When  
symmetric coefficient sets are used,  
❑ Replaces Harris HSP43168  
each filter can be configured as an 8-tap There is on-chip storage for 32  
❑ Package Styles Available:  
• 84-pin Plastic LCC, J-Lead  
• 100-pin Plastic Quad Flatpack  
FIR filter. If the two filters are cas-  
caded, a 16-tap FIR filter can be  
implemented. When asymmetric  
coefficient sets are used, each filter is  
different sets of coefficients. Each set  
consists of eight coefficients. Access  
to more than one coefficient set  
facilitates adaptive filtering opera-  
configured as a 4-tap FIR filter. If both tions. The 28-bit filter output can be  
filters are cascaded, an 8-tap filter can rounded from 8 to 19 bits.  
LF43168 BLOCK DIAGRAM  
INB9-0  
/
10  
OUT8-0  
9
10  
INA9-0  
5
10  
9
CSEL4-0  
CIN9-0  
A8-0  
WR  
COEFFICIENT  
BANK A  
FILTER  
CELL A  
COEFFICIENT  
BANK B  
FILTER  
CELL B  
CONTROL  
MUX/ADDER  
9
19  
OUT27-9  
OEL  
OEH  
Video Imaging Products  
03/28/2000–LDS.43168-H  
1
1234567...16

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