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JL82576EB/SLJBH

更新时间： 2024-01-28 10:36:18
品牌 Logo 应用领域
英特尔 - INTEL 通信时钟局域网PC外围集成电路
页数 文件大小 规格书
956页 7088K
描述
2 CHANNEL(S), LOCAL AREA NETWORK CONTROLLER, PBGA576, 25 X 25 MM, 1 MM PITCH, FCBGA-576

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JL82576EB/SLJBH 技术参数

是否Rohs认证： 符合生命周期：Lifetime Buy
零件包装代码：BGA包装说明：25 X 25 MM, 1 MM PITCH, FCBGA-576
针数：576Reach Compliance Code：compliant
风险等级：5.75地址总线宽度：
边界扫描：YES总线兼容性：PCI
最大时钟频率：25 MHz通信协议：ASYNC, BIT; I2C
外部数据总线宽度：JESD-30 代码：S-PBGA-B576
长度：25 mm低功率模式：YES
串行 I/O 数：2端子数量：576
最高工作温度：55 °C最低工作温度：
封装主体材料：PLASTIC/EPOXY封装代码：BGA
封装等效代码：BGA576,24X24,40封装形状：SQUARE
封装形式：GRID ARRAY电源：1,1.8,3.3 V
认证状态：Not Qualified子类别：Serial IO/Communication Controllers
标称供电电压：1 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子形式：BALL端子节距：1 mm
端子位置：BOTTOM宽度：25 mm
uPs/uCs/外围集成电路类型：SERIAL IO/COMMUNICATION CONTROLLER, LANBase Number Matches：1

JL82576EB/SLJBH 数据手册

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Revisions — Intel® 82576EB GbE Controller  
Revision  
Date  
Comments  
2.6  
11/5/2010  
•
•
On Title page, in feature table, under additional product features: bullet updated to  
“Memories Parity or ECC Protection”.  
Chapter 6.0, Non-Volatile Memory Map - EEPROM. Chapter now includes example  
settings for sample EEPROM and makes hardware settings clear.  
•
•
Section 7.2.2.3.11, PAYLEN (18). Note text updated.  
Section 8.12.14, Tx Descriptor Completion Write–Back Address Low - TDWBAL  
(0x0E038 + 0x40*n [n=0...15]; R/W). Description clarified; see bits 32:2.  
2.61  
2.62  
12/10/2010  
5/5/2011  
•
Indicated hardware defaults in Chapter 6.0, Non-Volatile Memory Map - EEPROM.  
Added loaded values for 82576_dev_start_No_Mgmt_Copper_A1 image, where  
applicable.  
•
•
Section 1.0, Introduction. Simple block diagram of part added.  
Section 3.5.6.1, General and Section 3.5.6.2, MAC Loopback. Information added on  
MAC Loopback. Not used on this device.  
•
•
Section 6.10.2, OEM specific (Word 0x04). Definition updated.  
Section 6.10.6.1, Main Setup Options PCI Function 0 (Word 0x30). Word updated.  
See bits 5, 2-0.  
•
•
•
•
Section 7.1.1.5, L3/L4 5-Tuple Filters. Note added to clarify the filtering of  
fragmented packets.  
Section 7.1.2.1.1, Unicast Filter. Error corrected. There are 24 host unicast  
addresses, not 16 as previously stated.  
Section 9.5.5.12, Device Control 2 Register (0xC8; RW). Note added. Expresses  
write limitation.  
Section 11-11, External Clock Oscillator Connectivity to the 82576. Figure corrected  
(font problem).  
2.63  
12/9/2011  
•
•
•
Figure 11-5 . Random line removed from drawing.  
Section 3.5.8.2.1, Transition to SerDes/SGMII Mode. Procedure updated.  
Section 6.10.1, Compatibility (Word 0x03). Bit 14, SerDes Forced Mode Enable,  
description added.  
•
•
Section 6.8.7, NC-SI Configuration (Offset 0x6). Updated.  
Section 9.4.11.1, 32-bit Mapping ,Section 9.4.11.2, 64-bit Mapping without I/O  
BAR, Section 9.4.11.3, 64-bit Mapping Without Flash BAR; Prefetch Memory, Bit 3  
description update. New text: “This bit should be set only on systems that do not  
generate prefetchable cycles.”  
Revision: 2.63  
December 2011  
Intel® 82576EB GbE Controller  
Datasheet  
7
1...45678910...956

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