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JLC1562BE/D

更新时间： 2024-01-09 23:35:30

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I2C Bus I/O Expander

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JLC1562BE/D 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	DIP
包装说明：	PLASTIC, DIP-16	针数：	16
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.73
Is Samacsys：	N	JESD-30 代码：	R-PDIP-T16
JESD-609代码：	e3	长度：	19.175 mm
I/O 线路数量：	8	端口数量：	1
端子数量：	16	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	DIP	封装形状：	RECTANGULAR
封装形式：	IN-LINE	峰值回流温度（摄氏度）：	260
认证状态：	Not Qualified	座面最大高度：	4.44 mm
最大供电电压：	6 V	最小供电电压：	4.2 V
标称供电电压：	5 V	表面贴装：	NO
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	Tin (Sn)	端子形式：	THROUGH-HOLE
端子节距：	2.54 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	40	宽度：	7.62 mm
uPs/uCs/外围集成电路类型：	PARALLEL IO PORT, GENERAL PURPOSE	Base Number Matches：	1

JLC1562BE/D 数据手册

The JLC1562B facilitates easy I2C Bus expandibility. Multiple

devices (up to 8 on the same I2C Bus) are easily added as each device

has its own selectable 3–bit address. The JLC1562B provides an 8–bit

bidirectional input/output port and 6–bit resolution Digital to Analog

Converter. The device can also be used as an Analog to Digital

Converter with 5 input signal lines each with 6–bit A/D resolution.

The voltage on pins P0–P4 is compared with a controllable threshold

voltage and the results are readable through the I2C Bus.

I2C Bus interface pins SDA, SCL and A0–A2 are; Serial Data,

Serial Clock and Device Address respectively. External interface pins

are P0–P7 and VDAC; I/O Port and D/A output.

http://onsemi.com

MARKING

DIAGRAMS

PDIP–16

N SUFFIX

CASE 648

JLC1562BN

AWLYYWW

Features

• Low Power Dissipation

• I2C–Bus Format (2–wire type; SDA, SCL) Data Transfer

• 6–bit A/D Converter

• Bus Address Selectable (3–bit)

EIAJ–16

F SUFFIX

CASE 966

JLC1562B

ALYW

• Address Input pins are pulled up to Vdd with internal resistor

• I/O pins are Open Drain Outputs

• Analog Input through Comparator

= Assembly Location

WL or L = Wafer Lot

YY or Y = Year

• Inputs Protected from External Bus Currents in Power Down mode

WW or W = Work Week

PIN ASSIGNMENT

Power–On

Reset

15 SDA

14 SCL

13 VDAC

12 P7

SDA

SCL

11 P6

8 Bit

10 P5

6 Bit

Latch

PIN LIST

A0–A2

Chip Address Input

6–Bit

DAC

P0–P4

P5–P7

SCL

Comparator Input / Open Drain Output

Serial Clock Input

1/2 V

SDA

I2C Data Output

3 Bit

Comp.

VDAC

DAC Output

(C5–C7)

ORDERING INFORMATION

5 Bit

(C0–C4)

Comp.

Device

Package

PDIP–16

EIAJ–16

Shipping

500 / Unit Pak

50 Units / Rail

2000 Units / Reel

JLC1562BN

JLC1562BF

JLC1562BFEL

NOTE: Internal Power On Reset sets P0 P7 low, sets VDAC to 1/80 V

and selects 1/2 V

for Comparator “B” threshold.

Figure 1. Block Diagram

Semiconductor Components Industries, LLC, 1999

Publication Order Number:

March, 2000 – Rev. 1

JLC1562BE/D

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