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IP4853CX24/LF,135 PDF预览

IP4853CX24/LF,135

更新时间： 2024-01-04 10:10:04
品牌 Logo 应用领域
恩智浦 - NXP 输出元件接口集成电路锁存器
页数 文件大小 规格书
21页 166K
描述
IC CMOS TO ECL TRANSLATOR, TRUE OUTPUT, PBGA24, 2.01 X 2.01 MM, 0.61 MM HEIGHT, WLCSP-24, Level Translator

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IP4853CX24/LF,135 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：BGA包装说明：VFBGA, BGA24,5X5,16
针数：24Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.75
最大延迟：10.1 ns接口集成电路类型：CMOS TO ECL TRANSLATOR
JESD-30 代码：S-PBGA-B24长度：2.01 mm
位数：1功能数量：1
端子数量：24最高工作温度：85 °C
最低工作温度：-30 °C输出锁存器或寄存器：NONE
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：VFBGA封装等效代码：BGA24,5X5,16
封装形状：SQUARE封装形式：GRID ARRAY
电源：1.8 V认证状态：Not Qualified
座面最大高度：0.66 mm子类别：Other Interface ICs
最大供电电压：2.1 V最小供电电压：1.62 V
标称供电电压：1.8 V表面贴装：YES
温度等级：OTHER端子形式：BALL
端子节距：0.4 mm端子位置：BOTTOM
宽度：2.01 mmBase Number Matches：1

IP4853CX24/LF,135 数据手册

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IP4853CX24  
NXP Semiconductors  
SD, MMC and microSD memory card integrated level shifter  
8. Static characteristics  
Table 7.  
Static characteristics  
At recommended operating conditions; Tamb = −30 °C to +85 °C; voltages are referenced to GND (ground = 0 V);  
unless otherwise specified.  
Symbol  
Parameter  
Conditions  
Min  
Typ[1] Max  
Unit  
Voltage regulator output: pin VSD  
VO(reg)  
regulator output voltage  
CL = 1 μF  
IO(reg) = 0 A  
-
2.9  
2.987  
-
V
IO(reg) = 200 mA; VBAT ≥ 2.9 V  
IO(reg) = 200 mA  
2.75  
-
-
-
V
ΔVdo(reg)  
regulator dropout  
voltage variation  
150  
mV  
IO(reg)  
IO(sc)  
regulator output current  
-
-
200  
-
-
mA  
mA  
short-circuit  
500  
output current  
Iq(reg)  
regulator quiescent  
current  
pin ENABLE = HIGH (active mode)  
-
-
-
-
200  
2
μA  
μA  
pin ENABLE = LOW  
(not active mode)  
Cext  
external capacitance  
recommended capacitor at pin VSD  
-
1.0  
-
μF  
Control and data inputs  
Host side: pins ENABLE, DIR_0, DIR_1_3, DIR_CMD, CLK_IN and DATA0_H to DATA3_H  
VIH  
VIL  
Cch  
HIGH-level input voltage  
LOW-level input voltage  
channel capacitance  
0.65 × VCC  
-
-
-
-
V
-
-
0.3  
20  
V
[2]  
[2]  
VI = 0 V; fi = 1 MHz  
pF  
Memory card side: pins CMD_SD and DATA0_SD to DATA3_SD  
VIH  
VIL  
Cch  
HIGH-level input voltage  
LOW-level input voltage  
channel capacitance  
0.65 × VO(reg)  
-
-
-
-
V
-
-
0.3  
20  
V
VI = 0 V; fi = 1 MHz  
pF  
Control and data outputs  
Host side: pins CLK_FB, CMD_H and DATA0_H to DATA3_H  
VOH  
VOL  
HIGH-level output voltage IO = −3 mA; VI = VIH  
VCC − 0.45  
-
-
-
V
V
LOW-level output voltage IO = 3 mA; VI = VIL  
-
0.45  
Memory card side: pins CLK_SD, CMD_SD and DATA0_SD to DATA3_SD, CD and WP  
VOH  
VOL  
ILRzd  
HIGH-level output voltage IO = −6 mA; VI = VIH  
VO(reg) − 0.45 -  
-
V
LOW-level output voltage IO = 6 mA; VI = VIL  
-
-
-
-
0.45  
100  
V
Zener diode reverse  
leakage current  
VI = 3 V  
nA  
Rs  
series resistance  
pull-down resistance  
pull-up resistance  
R1 to R6; tolerance ±20 %  
R7; tolerance ±30 %  
32  
40  
48  
Ω
Rpd  
Rpu  
329  
10.5  
49  
470  
15  
611  
19.5  
91  
kΩ  
kΩ  
kΩ  
kΩ  
R10; tolerance ±30 %  
R11 to R13; tolerance ±30 %  
R14 and R15; tolerance ±30 %  
70  
70  
100  
130  
[1] Typical values are measured at Tamb = 25 °C.  
[2] EMI filter line capacitance per data channel from I/O pin to driver; Cch is guaranteed by design.  
IP4853CX24  
All information provided in this document is subject to legal disclaimers.  
© NXP B.V. 2010. All rights reserved.  
Product data sheet  
Rev. 3 — 30 September 2010  
7 of 21  
 
 
 
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型号 品牌 描述 获取价格 数据表
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