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IDT74LVC163APG8

更新时间： 2024-11-21 21:19:11
品牌 Logo 应用领域
艾迪悌 - IDT 光电二极管输出元件逻辑集成电路触发器
页数 文件大小 规格书
7页 96K
描述
Binary Counter, LVC/LCX/Z Series, Synchronous, Positive Edge Triggered, 4-Bit, Up Direction, CMOS, PDSO16, TSSOP-16

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IDT74LVC163APG8 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：TSSOP
包装说明：TSSOP,针数：16
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.31其他特性：TCO OUTPUT
计数方向：UP系列：LVC/LCX/Z
JESD-30 代码：R-PDSO-G16JESD-609代码：e0
长度：5 mm负载/预设输入：YES
逻辑集成电路类型：BINARY COUNTER工作模式：SYNCHRONOUS
湿度敏感等级：1位数：4
功能数量：1端子数量：16
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：240传播延迟（tpd）：9 ns
认证状态：Not Qualified座面最大高度：1.2 mm
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：2.7 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：TIN LEAD端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：20触发器类型：POSITIVE EDGE
宽度：4.4 mm最小 fmax：68.97 MHz
Base Number Matches：1

IDT74LVC163APG8 数据手册

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3.3V CMOS PRESETTABLE  
IDT74LVC163A  
SYNCHRONOUS 4-BIT BINARY  
COUNTER WITH SYNCHRONOUS  
RESET, 5 VOLT TOLERANT I/O  
FEATURES:  
Outputs (Q0 to Q3) may be preset to a high or low level. A low level at the  
parallelenableinput(PE)disablesthecountingactionandcausesthedata  
atthedatainputs(D0 toD3)tobeloadedintothecounteronthepositive-going  
edge of the clock (provided that the set-up and hold time requirements for  
PE are met). Preset takes place regardless of the levels at count enable  
inputs (CEP and CET). A low level at the master reset input (MR) sets all  
fouroutputsoftheflip-flops(Q0 toQ3)tolowlevelafterthenextpositive-going  
transition on the clock (CP) input (provided that the set-up and hold time  
requirements for PE are met).  
• 0.5 MICRON CMOS Technology  
• ESD > 2000V per MIL-STD-883, Method 3015; > 200V using  
machine model (C = 200pF, R = 0)  
• VCC = 3.3V ± 0.3V, Normal Range  
• VCC = 2.7V to 3.6V, Extended Range  
• CMOS power levels (0.4µ W typ. static)  
• Rail-to-Rail output swing for increased noise margin  
• All inputs, outputs, and I/Os are 5V tolerant  
• Supports hot insertion  
This action occurs regardless of the levels of CP, PE, CET, and CEP  
inputs. This synchronous reset feature enables the designer to modify the  
maximum count with only one external NAND gate.  
• Available in TSSOP package  
DRIVE FEATURES:  
• High Output Drivers: ±24mA  
• Reduced system switching noise  
The look-ahead carry simplifies serial cascading of the counters. Both  
count enable inputs (CEP and CET) must be high to count. The CET input  
is fed forward to enable the terminal count output (TC). The TC output thus  
enabled will produce a high output pulse of a duration approximately equal  
to a high level output of Q0. This pulse can be used to enable the next  
cascaded stage. The maximum clock frequency for the cascaded counters  
is determined by the CP to TC propagation delay and CEP to CP set-up  
time, according to the following formula:  
APPLICATIONS:  
• 5V and 3.3V mixed voltage systems  
• Data communication and telecommunication systems  
DESCRIPTION:  
The LVC163A is a synchronous presettable binary counter, which  
features an internal look-ahead carry and can be used for high-speed  
counting. Synchronous operation is provided by having all the flip-flops  
clocked simultaniously on the positive-going edge of the clock (CP).  
1
fmax  
=
tp(max) (CP to TC) + tsu (CEP to CP)  
FUNCTIONALDIAGRAM  
STATEDIAGRAM  
5
3
4
6
0
1
2
3
4
5
6
7
8
D0  
D1  
D2  
D3  
9
PE  
PARALLEL LOAD  
CIRCUITRY  
15  
14  
13  
12  
CET  
CEP  
10  
7
15  
TC  
BINARY COUNTER  
2
1
CP  
MR  
Q0  
Q1  
13  
Q2  
12  
Q3  
11  
11  
10  
9
14  
TheIDTlogoisaregisteredtrademarkofIntegratedDeviceTechnology,Inc.  
INDUSTRIAL TEMPERATURE RANGE  
JANUARY 2004  
1
© 2004 Integrated Device Technology, Inc.  
DSC-4949/2  
1234567

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