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IDT72V10071L15TFI

更新时间： 2024-09-18 07:35:55
品牌 Logo 应用领域
艾迪悌 - IDT 先进先出芯片
页数 文件大小 规格书
10页 148K
描述
FIFO, 512X8, 10ns, Synchronous, CMOS, PQFP64, PLASTIC, TQFP-64

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IDT72V10071L15TFI 数据手册

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3.3 VOLT DUAL MULTIMEDIA FIFO  
DUAL 256 x 8, DUAL 512 x 8  
DUAL 1,024 x 8, DUAL 2,048 x 8  
DUAL 4,096 x 8  
IDT72V10071,IDT72V11071  
IDT72V12071,IDT72V13071  
IDT72V14071  
FEATURES  
DESCRIPTION  
TheIDT72V10071/72V11071/72V12071/72V13071/72V14071aredual  
Multimedia FIFOs. The device is functionallyequivalenttotwoindependent  
FIFOs in a single package with all associated control, data, and flag lines  
assignedtoseparatepins.  
Eachofthe twoFIFOs (designatedFIFOAandFIFOB)has a 8-bitinput  
data port (DA0 - DA7, DB0 - DB7) and a 8-bit output data port (QA0 - QA7,  
QB0 - QB7). Each input port is controlled by a free-running clock (WCLKA,  
WCLKB),andaWriteEnablepin(WENA,WENB).Dataiswrittenintoeachof  
thetwoarraysoneveryrisingclockedgeoftheWriteClock(WCLKA,WCLKB)  
whentheappropriateWriteEnablepinisasserted.  
TheoutputportofeachFIFObankiscontrolledbyitsassociated clockpin  
(RCLKA,RCLKB)andReadEnablepin(RENA,RENB).TheReadClockcan  
betiedtotheWriteClockforsingleclockoperationorthetwoclocks canrun  
asynchronousofoneanotherfordualclockoperation.AnOutputEnablepin  
(OEA,OEB)is providedonthe readportofeachFIFOforthree-state output  
control.  
• Memory organization:  
IDT72V10071  
IDT72V11071  
IDT72V12071  
IDT72V13071  
IDT72V14071  
Dual 256 x 8  
Dual 512 x 8  
Dual 1,024 x 8  
Dual 2,048 x 8  
Dual 4,096 x 8  
• Offers optimal combination of large capacity, high speed,  
design flexibility and small footprint  
• 15 ns read/write cycle time  
• 5V input tolerant  
• Separate control lines and data lines for each FIFO  
• Separate Empty and Full flags for each FIFO  
• Enable puts output data lines in high-impedance state  
• Space-saving 64-pin plastic Thin Quad Flat Pack (STQFP)  
• Industrial temperature range (–40°C to +85°C)  
EachofthetwoFIFOshastwofixedflags,Empty(EFA,EFB)andFull(FFA,  
FFB).  
• Green parts available, see ordering information  
This FIFOis fabricatedusingIDT's high-performancesubmicronCMOS  
technology.  
FUNCTIONAL BLOCK DIAGRAM  
WCLKA  
RCLKA  
READ  
CONTROL  
WRITE  
CONTROL  
WENA  
RENA  
OEA  
FIFO ARRAY  
256 x 8, 512 x 8  
1,024 x 8, 2,048 x 8  
4,096 x 8  
D
A0 - DA7  
Data In  
Q
A0 - QA7  
Data Out  
x8  
x8  
RESET LOGIC  
FLAG OUTPUTS  
RSA  
EFA  
FFA  
WCLKB  
RCLKB  
READ  
CONTROL  
WRITE  
CONTROL  
WENB  
RENB  
OEB  
FIFO ARRAY  
256 x 8, 512 x 8  
1,024 x 8, 2,048 x 8  
4,096 x 8  
D
B0 - DB7  
Data In  
Q
B0 - QB7  
Data Out  
x8  
x8  
RESET LOGIC  
FLAG OUTPUTS  
6360 drw01  
RSB  
EFB  
FFB  
IDT and the IDT logo are trademarks of Integrated Device Technology, Inc.  
DECEMBER 2004  
INDUSTRIAL TEMPERATURE RANGE  
1
2004 Integrated Device Technology, Inc. All rights reserved. Products specifications subject to change without notice.  
DSC-6360/3  
1234567...10

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与IDT72V10071L15TFI相关器件

型号 品牌 获取价格 描述 数据表
IDT72V10071L15TFI8 IDT

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 		FIFO, 512X8, 10ns, Synchronous, CMOS, PQFP64, PLASTIC, TQFP-64
IDT72V10081 IDT

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 		3.3 VOLT MULTIMEDIA FIFO
IDT72V10081L15PFGI IDT

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 		暂无描述
IDT72V10081L15PFGI8 IDT

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 		FIFO, 256X8, 10ns, Synchronous, CMOS, PQFP32, PLASTIC, TQFP-32
IDT72V10081L15PFI IDT

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 		FIFO, 512X8, 10ns, Synchronous, CMOS, PQFP64, GREEN, PLASTIC, TQFP-64
IDT72V11071L15TFI IDT

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 		FIFO, 1KX8, 10ns, Synchronous, CMOS, PQFP64, PLASTIC, TQFP-64

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