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IDT72275L15TFG8

更新时间： 2024-01-29 04:37:03
品牌 Logo 应用领域
艾迪悌 - IDT 先进先出芯片
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25页 301K
描述
FIFO, 32KX18, 10ns, Synchronous, CMOS, PQFP64, STQFP-64

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IDT72275L15TFG8 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：QFP
包装说明：STQFP-64针数：64
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.32.00.71风险等级：5.83
最长访问时间：10 ns其他特性：RETRANSMIT; AUTO POWER DOWN; EASY EXPANDABLE IN DEPTH AND WIDTH
周期时间：15 nsJESD-30 代码：S-PQFP-G64
JESD-609代码：e3长度：10 mm
内存密度：589824 bit内存宽度：18
湿度敏感等级：3功能数量：1
端子数量：64字数：32768 words
字数代码：32000工作模式：SYNCHRONOUS
最高工作温度：70 °C最低工作温度：
组织：32KX18可输出：YES
封装主体材料：PLASTIC/EPOXY封装代码：LFQFP
封装形状：SQUARE封装形式：FLATPACK, LOW PROFILE, FINE PITCH
并行/串行：PARALLEL峰值回流温度（摄氏度）：260
认证状态：Not Qualified座面最大高度：1.6 mm
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：MATTE TIN端子形式：GULL WING
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：30宽度：10 mm
Base Number Matches：1

IDT72275L15TFG8 数据手册

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IDT72275/72285  
CMOS SuperSync FIFO™ 32,768 x 18 and 65,536 x 18  
COMMERCIALANDINDUSTRIAL  
TEMPERATURERANGES  
arisingRCLKedge,willshiftthewordfrominternalmemorytothedataoutput  
lines.  
DESCRIPTION (CONTINUED)  
SuperSyncFIFOsareparticularlyappropriatefornetwork,video,telecom-  
munications,datacommunicationsandotherapplicationsthatneedtobuffer  
largeamountsofdata.  
The input port is controlled by a Write Clock (WCLK) input and a Write  
Enable (WEN) input. Data is written into the FIFO on every rising edge of  
WCLKwhenWENisasserted.TheoutputportiscontrolledbyaReadClock  
(RCLK) input and Read Enable (REN) input. Data is read from the FIFO on  
every rising edge of RCLK when REN is asserted. An Output Enable (OE)  
input is provided for three-state control of the outputs.  
The frequencies of both the RCLK and the WCLK signals may vary from  
0 to fMAX with complete independence. There are no restrictions on the  
frequency of the one clock input with respect to the other.  
There are two possible timing modes of operation with these devices:  
IDT Standard mode and First Word Fall Through (FWFT) mode.  
In IDT Standard mode, the first word written to an empty FIFO will not  
appear on the data output lines unless a specific read operation is  
performed.Areadoperation,whichconsistsofactivatingRENandenabling  
InFWFTmode, the firstwordwrittentoanemptyFIFOis clockeddirectly  
to the data output lines after three transitions of the RCLK signal. A REN  
does not have to be asserted for accessing the first word. However,  
subsequentwords writtentotheFIFOdorequireaLOWonRENforaccess.  
The state of the FWFT/SI input during Master Reset determines the timing  
mode in use.  
Forapplications requiringmore data storage capacitythana single FIFO  
can provide, the FWFT timing mode permits depth expansion by chaining  
FIFOs in series (i.e. the data outputs of one FIFO are connected to the  
corresponding data inputs of the next). No external logic is required.  
These FIFOs have five flag pins, EF/OR (Empty Flag or Output Ready),  
FF/IR (Full Flag or Input Ready), HF (Half-full Flag), PAE (Programmable  
Almost-Emptyflag)andPAF (ProgrammableAlmost-Fullflag). TheEFand  
FF functions are selected in IDT Standard mode. The IR and OR functions  
areselectedinFWFTmode. HF,PAEandPAFarealwaysavailableforuse,  
irrespectiveoftimingmode.  
PIN CONFIGURATIONS  
PIN 1  
64 63 62 61 60 59 58 57 56 55 54 53 52 51 50 49  
1
48  
WEN  
SEN  
DC  
Q17  
2
47  
Q16  
3
46  
GND  
4
45  
VCC  
Q15  
5
44  
GND  
D17  
D16  
D15  
D14  
D13  
D12  
D11  
D10  
D9  
Q14  
6
43  
42  
41  
40  
39  
38  
37  
36  
35  
34  
33  
VCC  
7
Q13  
Q12  
Q11  
GND  
Q10  
Q9  
8
9
10  
11  
12  
13  
14  
15  
16  
Q8  
Q7  
D8  
Q6  
D7  
GND  
17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32  
4674 drw 02  
TQFP (PN64-1, ORDER CODE: PF)  
STQFP (PP64-1, ORDER CODE: TF)  
TOP VIEW  
2
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与IDT72275L15TFG8相关器件

型号 品牌 获取价格 描述 数据表
IDT72275L15TFGI IDT

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 		FIFO, 32KX18, 10ns, Synchronous, CMOS, PQFP64, STQFP-64
IDT72275L15TFGI8 IDT

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 		FIFO, 32KX18, 10ns, Synchronous, CMOS, PQFP64, STQFP-64
IDT72275L15TFI IDT

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