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IDT54FCT273APB

更新时间： 2024-11-24 23:10:07
品牌 Logo 应用领域
艾迪悌 - IDT 触发器
页数 文件大小 规格书
7页 64K
描述
FAST CMOS OCTAL FLIP-FLOP WITH MASTER RESET

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IDT54FCT273APB 技术参数

生命周期：Obsolete零件包装代码：DIP
包装说明：DIP,针数：20
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.4系列：FCT
JESD-30 代码：R-PDIP-T20JESD-609代码：e0
长度：26.1874 mm逻辑集成电路类型：D FLIP-FLOP
位数：8功能数量：1
端子数量：20最高工作温度：125 °C
最低工作温度：-55 °C输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：DIP
封装形状：RECTANGULAR封装形式：IN-LINE
传播延迟（tpd）：8.3 ns认证状态：Not Qualified
座面最大高度：4.191 mm最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：NO技术：CMOS
温度等级：MILITARY端子面层：TIN LEAD
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL触发器类型：POSITIVE EDGE
宽度：7.62 mmBase Number Matches：1

IDT54FCT273APB 数据手册

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IDT54/74FCT273  
IDT54/74FCT273A  
IDT54/74FCT273C  
FAST CMOS  
OCTAL FLIP-FLOP  
WITH MASTER RESET  
Integrated Device Technology, Inc.  
FEATURES:  
DESCRIPTION:  
• IDT54/74FCT273 equivalent to FAST speed;  
• IDT54/74FCT273A 45% faster than FAST  
• IDT54/74FCT273C 55% faster than FAST  
• Equivalent to FAST output drive over full temperature  
and voltage supply extremes  
• IOL = 48mA (commercial) and 32mA (military)  
• CMOS power levels (1mW typ. static)  
• TTL input and output level compatible  
• CMOS output level compatible  
• Substantially lower input current levels than FAST  
(5µA max.)  
• Octal D flip-flop with Master Reset  
• JEDEC standard pinout for DIP and LCC  
• Product available in Radiation Tolerant and Radiation  
Enhanced versions  
The IDT54/74FCT273/A/C are octal D flip-flops built using  
an advanced dual metal CMOS technology. The IDT54/  
74FCT273/A/C have eight edge-triggered D-type flip-flops  
with individual D inputs and O outputs. The common buffered  
Clock (CP) and Master Reset (MR) inputs load and reset  
(clear) all flip-flops simultaneously.  
The register is fully edge-triggered. The state of each D  
input, one set-up time before the LOW-to-HIGH clock  
transition, is transferred to the corresponding flip-flop’s O  
output.  
All outputs will be forced LOW independently of Clock or  
Data inputs by a LOW voltage level on the MR input. The  
device is useful for applications where the true output only is  
required and the Clock and Master Reset are common to all  
storage elements.  
• Military product compliant to MIL-STD-883, Class B  
FUNCTIONAL BLOCK DIAGRAM  
0
1
2
3
4
5
6
7
D
D
D
D
D
D
D
D
CP  
D
Q
D
Q
D
Q
D
Q
D
Q
D
Q
D
Q
D
Q
CP  
RD  
CP  
RD  
CP  
RD  
CP  
RD  
CP  
RD  
CP  
RD  
CP  
RD  
CP  
RD  
MR  
O0  
O1  
O2  
O3  
O4  
O5  
O6  
O7  
2558 drw 01  
PIN CONFIGURATIONS  
INDEX  
1
20  
19  
18  
17  
16  
15  
MR  
O0  
D0  
D1  
O1  
O2  
D2  
D3  
O3  
Vcc  
O7  
D7  
D6  
O6  
O5  
D5  
D4  
O4  
CP  
2
3
3
2
20 19  
18  
D7  
4
5
6
7
8
P20-1  
D20-1  
SO20-2  
&
D1  
O1  
O2  
D2  
D3  
1
4
D6  
O6  
O5  
D5  
17  
16  
15  
14  
5
L20-2  
6
7
E20-1 14  
13  
12  
11  
8
10 11 12 13  
9
9
10  
GND  
2558 drw 02  
DIP/SOIC/CERPACK  
TOP VIEW  
LCC  
TOP VIEW  
The IDT logo is a registered trademark of Integrated Device Technology, Inc.  
FAST is a registered trademark of National Semiconductor Co.  
MILITARY AND COMMERCIAL TEMPERATURE RANGES  
MAY 1992  
1992 Integrated Device Technology, Inc.  
7.10  
DSC-4609/2  
1
1234567

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型号 品牌 获取价格 描述 数据表
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