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| 是否Rohs认证： | 符合 | 生命周期： | Obsolete |
| 零件包装代码： | SOIC | 包装说明： | SOP, SOP14,.25 |
| 针数： | 14 | Reach Compliance Code： | compliant |
| HTS代码： | 8542.39.00.01 | 风险等级： | 5.26 |
| 其他特性： | IOL = 64MA @ VOL = 0.55V; IOH = 0.25MA @ VOH = 4.5V | 系列： | F/FAST |
| JESD-30 代码： | R-PDSO-G14 | JESD-609代码： | e4 |
| 长度： | 8.65 mm | 负载电容（CL）： | 50 pF |
| 逻辑集成电路类型： | NAND GATE | 最大I（ol）： | 0.064 A |
| 湿度敏感等级： | 1 | 功能数量： | 4 |
| 输入次数： | 2 | 端子数量： | 14 |
| 最高工作温度： | 85 °C | 最低工作温度： | -40 °C |
| 输出特性： | OPEN-COLLECTOR | 封装主体材料： | PLASTIC/EPOXY |
| 封装代码： | SOP | 封装等效代码： | SOP14,.25 |
| 封装形状： | RECTANGULAR | 封装形式： | SMALL OUTLINE |
| 峰值回流温度（摄氏度）： | 260 | 电源： | 5 V |
| 最大电源电流（ICC）： | 30 mA | Prop。Delay @ Nom-Sup： | 14.5 ns |
| 传播延迟（tpd）： | 6 ns | 认证状态： | Not Qualified |
| 施密特触发器： | NO | 座面最大高度： | 1.75 mm |
| 子类别： | Gates | 最大供电电压 (Vsup)： | 5.5 V |
| 最小供电电压 (Vsup)： | 4.5 V | 标称供电电压 (Vsup)： | 5 V |
| 表面贴装： | YES | 技术： | TTL |
| 温度等级： | INDUSTRIAL | 端子面层： | NICKEL PALLADIUM GOLD |
| 端子形式： | GULL WING | 端子节距： | 1.27 mm |
| 端子位置： | DUAL | 处于峰值回流温度下的最长时间： | 30 |
| 宽度： | 3.9 mm | Base Number Matches： | 1 |
| 型号 | 品牌 | 替代类型 | 描述 | 数据表 |
| I74F38D,602 | NXP |
完全替代  |
74F38 - Quad 2-input NAND buffer (open collector) SOIC 14-Pin |
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| N74F3037D,512 | NXP |
类似代替 |
Quad 2-input NAND 30 Ω driver SOP 16-Pin |
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| 型号 | 品牌 | 获取价格 | 描述 | 数据表 |
| I74F38D-T | NXP |
获取价格 |
IC F/FAST SERIES, QUAD 2-INPUT NAND GATE, PDSO14, 3.90 MM, PLASTIC, SOT-108-1, SO-14, Gate |
|
| I74F38N | NXP |
获取价格 |
Quad 2-input NAND buffer open collector |
|
| I74F38N,602 | NXP |
获取价格 |
74F38 - Quad 2-input NAND buffer (open collector) DIP 14-Pin |
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| I74F38N-B | ETC |
获取价格 |
Quad 2-input NAND Gate |
|
| I74F50728D | NXP |
获取价格 |
Synchronizing cascaded dual positive edge-triggered D-type flip-flop |
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| I74F50728DB | ETC |
获取价格 |
Dual D-Type Flip-Flop |
|
| I74F50728D-T | ETC |
获取价格 |
Dual D-Type Flip-Flop |
|
| I74F50728N | NXP |
获取价格 |
Synchronizing cascaded dual positive edge-triggered D-type flip-flop |
|
| I74F50728N-B | ETC |
获取价格 |
Dual D-Type Flip-Flop |
|
| I74F50729D | NXP |
获取价格 |
Synchronizing dual D-type flip-flop with edge-triggered set and reset with metastable immu |
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