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HD74LS47P PDF预览

HD74LS47P

更新时间： 2024-11-23 05:35:15
品牌 Logo 应用领域
瑞萨 - RENESAS 解码器驱动器逻辑集成电路光电二极管
页数 文件大小 规格书
7页 101K
描述
BCD-to-Seven-Segment Decoder / Driver (with 15 V Outputs)

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HD74LS47P 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：DIP包装说明：6.30 X 19.20 MM, 2.54 MM PITCH, PLASTIC, DIP-16
针数：16Reach Compliance Code：compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.23Is Samacsys：N
系列：LS输入调节：STANDARD
JESD-30 代码：R-PDIP-T16长度：19.2 mm
逻辑集成电路类型：SEVEN SEGMENT DECODER/DRIVER湿度敏感等级：1
功能数量：1端子数量：16
最高工作温度：75 °C最低工作温度：-20 °C
输出极性：INVERTED封装主体材料：PLASTIC/EPOXY
封装代码：DIP封装等效代码：DIP16,.3
封装形状：RECTANGULAR封装形式：IN-LINE
峰值回流温度（摄氏度）：NOT SPECIFIED电源：5 V
传播延迟（tpd）：100 ns认证状态：Not Qualified
座面最大高度：5.06 mm子类别：Decoder/Drivers
最大供电电压 (Vsup)：5.25 V最小供电电压 (Vsup)：4.75 V
标称供电电压 (Vsup)：5 V表面贴装：NO
技术：TTL温度等级：COMMERCIAL EXTENDED
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7.62 mmBase Number Matches：1

HD74LS47P 数据手册

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HD74LS47  
BCD-to-Seven-Segment Decoder / Driver (with 15 V Outputs)  
REJ03D0410-0301  
Rev.3.01  
May 10, 2006  
HD74LS47 features active-low outputs designed for driving incandescent indicators directly. This device has full  
ripple-blanking input / output controls and a lamp test. Display patterns for BCD input counts above 9 are unique  
symbols to authenticate input conditions. This circuit incorporates automatic leading and / or trailing-edge zero-  
blanking control (RBI and RBO). Lamp test (LT) of these types may be performed at any time when the BI / RBO  
node is at a high level. It contains an overriding blanking input (BI) which can be used to control the lamp intensity of  
pulsing or to inhibit the outputs. Inputs and outputs are entirely compatible for use with TTL or DTL logic outputs.  
Features  
•
Ordering Information  
Package Code  
(Previous Code)  
Package  
Abbreviation  
Taping Abbreviation  
(Quantity)  
Part Name  
Package Type  
DILP-16 pin  
PRDP0016AE-B  
(DP-16FV)  
HD74LS47P  
HD74LS47FPEL  
P
—
PRSP0016DH-B  
(FP-16DAV)  
SOP-16 pin (JEITA)  
FP  
EL (2,000 pcs/reel)  
Note: Please consult the sales office for the above package availability.  
Pin Arrangement  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
11  
10  
9
B
C
VCC  
Inputs  
f
B
f
g
a
b
c
d
e
LT  
C
g
a
b
c
d
e
LT  
BI/RBO  
RBI  
BI/RBO  
Outputs  
RBI  
D
D
Inputs  
A
A
GND  
(Top view)  
Rev.3.01, May 10, 2006, page 1 of 6  
1234567

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