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GS8640FZ36T-6.5IV

更新时间： 2024-11-07 14:42:23

品牌	Logo	应用领域
GSI		静态存储器内存集成电路
页数	文件大小	规格书
19页	456K
描述
ZBT SRAM, 2MX36, 6.5ns, CMOS, PQFP100, TQFP-100

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GS8640FZ36T-6.5IV 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	QFP	包装说明：	LQFP,
针数：	100	Reach Compliance Code：	compliant
ECCN代码：	3A991.B.2.B	HTS代码：	8542.32.00.41
风险等级：	5.33	Is Samacsys：	N
最长访问时间：	6.5 ns	其他特性：	FLOW-THROUGH ARCHITECTURE; ALSO OPERATES AT 2.5V SUPPLY
JESD-30 代码：	R-PQFP-G100	长度：	20 mm
内存密度：	75497472 bit	内存集成电路类型：	ZBT SRAM
内存宽度：	36	功能数量：	1
端子数量：	100	字数：	2097152 words
字数代码：	2000000	工作模式：	SYNCHRONOUS
最高工作温度：	85 °C	最低工作温度：	-40 °C
组织：	2MX36	封装主体材料：	PLASTIC/EPOXY
封装代码：	LQFP	封装形状：	RECTANGULAR
封装形式：	FLATPACK, LOW PROFILE	并行/串行：	PARALLEL
峰值回流温度（摄氏度）：	NOT SPECIFIED	认证状态：	Not Qualified
座面最大高度：	1.6 mm	最大供电电压 (Vsup)：	2 V
最小供电电压 (Vsup)：	1.7 V	标称供电电压 (Vsup)：	1.8 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	14 mm
Base Number Matches：	1

GS8640FZ36T-6.5IV 数据手册

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GS8640FZ18/36T-xxxV

6.5 ns–8.0 ns

100-Pin TQFP

Commercial Temp

Industrial Temp

72Mb Flow Through

Synchronous NBT SRAM

1.8 V or 2.5 V V

1.8 V or 2.5 V I/O

utilization of all available bus bandwidth by eliminating the

need to insert deselect cycles when the device is switched from

read to write cycles.

Features

• NBT (No Bus Turn Around) functionality allows zero wait

read-write-read bus utilization; Fully pin-compatible with

flow through NtRAM™, NoBL™ and ZBT™ SRAMs

• 1.8 V or 2.5 V core power supply

Because it is a synchronous device, address, data inputs, and

read/ write control inputs are captured on the rising edge of the

input clock. Burst order control (LBO) must be tied to a power

rail for proper operation. Asynchronous inputs include the

Sleep mode enable (ZZ) and Output Enable. Output Enable can

be used to override the synchronous control of the output

drivers and turn the RAM's output drivers off at any time.

Write cycles are internally self-timed and initiated by the rising

edge of the clock input. This feature eliminates complex off-

chip write pulse generation required by asynchronous SRAMs

and simplifies input signal timing.

• 1.8 V or 2.5 V I/O supply

• LBO pin for Linear or Interleave Burst mode

• Pin compatible with 4Mb, 9Mb, 18Mb and 36Mb devices

• Byte write operation (9-bit Bytes)

• 3 chip enable signals for easy depth expansion

• ZZ Pin for automatic power-down

• JEDEC-standard 100-lead TQFP package

• RoHS-compliant 100-lead TQFP package available

Functional Description

The GS8640FZ18/36T-xxxV is implemented with GSI's high

performance CMOS technology and is available in a JEDEC-

standard 100-pin TQFP package.

The GS8640FZ18/36T-xxxV is a 72Mbit Synchronous Static

SRAM. GSI's NBT SRAMs, like ZBT, NtRAM, NoBL or

other flow through read/single late write SRAMs, allow

Parameter Synopsis

-6.5

-7.5

-8.0

Unit

6.5

7.5

8.0

Flow Through

2-1-1-1

tCycle

Curr (x18)

Curr (x32/x36)

245

280

220

250

210

240

Rev: 1.00a 2/2009

1/19

Specifications cited are subject to change without notice. For latest documentation see http://www.gsitechnology.com.

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GS8640FZ36T-6.5T	GSI	获取价格	ZBT SRAM, 2MX36, 6.5ns, CMOS, PQFP100, TQFP-100
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