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GAL26V12C-20LP

更新时间： 2024-09-21 20:24:51
品牌 Logo 应用领域
莱迪思 - LATTICE 时钟输入元件光电二极管可编程逻辑
页数 文件大小 规格书
16页 201K
描述
EE PLD, 20ns, PAL-Type, CMOS, PDIP28, PLASTIC, DIP-28

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GAL26V12C-20LP 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DIP包装说明：PLASTIC, DIP-28
针数：28Reach Compliance Code：not_compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.87架构：PAL-TYPE
最大时钟频率：41.6 MHzJESD-30 代码：R-PDIP-T28
JESD-609代码：e0长度：34.671 mm
专用输入次数：12I/O 线路数量：12
输入次数：26输出次数：12
产品条款数：122端子数量：28
最高工作温度：75 °C最低工作温度：
组织：12 DEDICATED INPUTS, 12 I/O输出函数：MACROCELL
封装主体材料：PLASTIC/EPOXY封装代码：DIP
封装等效代码：DIP28,.3封装形状：RECTANGULAR
封装形式：IN-LINE电源：5 V
可编程逻辑类型：EE PLD传播延迟：20 ns
认证状态：Not Qualified座面最大高度：4.57 mm
子类别：Programmable Logic Devices最大供电电压：5.25 V
最小供电电压：4.75 V标称供电电压：5 V
表面贴装：NO技术：CMOS
温度等级：COMMERCIAL EXTENDED端子面层：Tin/Lead (Sn85Pb15)
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL宽度：7.62 mm
Base Number Matches：1

GAL26V12C-20LP 数据手册

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GAL26V12  
High Performance E2CMOS PLD  
Generic Array LogicTM  
FEATURES  
FUNCTIONAL BLOCK DIAGRAM  
• HIGH PERFORMANCE E2CMOS® TECHNOLOGY  
— 7.5 ns Maximum Propagation Delay  
— Fmax = 142.8 MHz  
I/CLK 1  
INPUT  
I/O/Q  
PRESET  
— 4.5 ns Maximum from Clock Input to Data Output  
— TTL Compatible 16 mA Outputs  
8
OLMC 0  
INPUT  
— UltraMOS® Advanced CMOS Technology  
8
I/O/Q  
I/O/Q  
I/O/Q  
I/O/Q  
I/O/Q  
I/O/Q  
I/O/Q  
I/O/Q  
I/O/Q  
I/O/Q  
I/O/Q  
OLMC 1  
OLMC 2  
• LOW POWER CMOS  
— 90 mA Typical Icc  
• E2 CELL TECHNOLOGY  
— Reconfigurable Logic  
— Reprogrammable Cells  
— 100% Tested/Guaranteed 100% Yields  
— High Speed Electrical Erasure (<100ms)  
— 20 Year Data Retention  
INPUT  
INPUT/CLK 2  
INPUT  
10  
12  
14  
16  
16  
14  
12  
10  
8
OLMC 3  
OLMC 4  
OLMC 5  
INPUT  
• TWELVE OUTPUT LOGIC MACROCELLS  
— Maximum Flexibility for Complex Logic Designs  
INPUT  
OLMC 6  
OLMC 7  
OLMC 8  
OLMC 9  
OLMC 10  
OLMC 11  
• PRELOAD AND POWER-ON RESET OF REGISTERS  
— 100% Functional Testability  
INPUT  
INPUT  
• APPLICATIONS INCLUDE:  
— DMA Control  
— State Machine Control  
— High Speed Graphics Processing  
— Standard Logic Speed Upgrade  
INPUT  
INPUT  
• ELECTRONIC SIGNATURE FOR IDENTIFICATION  
INPUT  
DESCRIPTION  
8
INPUT  
The GAL26V12, at 7.5ns maximum propagation delay time, com-  
bines a high performance CMOS process with Electrically Eras-  
able (E2) floating gate technology to provide the highest perform-  
ance available of any 26V12 device on the market. E2 technol-  
ogy offers high speed (<100ms) erase times, providing the ability  
to reprogram or reconfigure the device quickly and efficiently.  
RESET  
PACKAGE DIAGRAMS  
DIP  
The generic architecture provides maximum design flexibility by  
allowing the Output Logic Macrocell (OLMC) to be configured by  
the user. The GAL26V12 is fully function/fuse map/parametric  
compatible with other 26V12 devices.  
1
28  
I
I/CLK1  
PLCC  
I/O/Q  
I
I
I/O/Q  
I/O/Q  
I/O/Q  
I/O/Q  
I/O/Q  
GND  
I/O/Q  
I/O/Q  
I/O/Q  
I/O/Q  
I/O/Q  
Unique test circuitry and reprogrammable cells allow complete  
AC, DC, and functional testing during manufacture. As a result,  
LATTICE is able to guarantee 100% field programmability and  
functionality of all GAL® products. LATTICE also guarantees 100  
erase/rewrite cycles.  
I/CLK2  
GAL  
26V12  
I
4
2
28  
26  
25  
I
5
7
I
I/O/Q  
I/O/Q  
I/O/Q  
I/O/Q  
GND  
I/O/Q  
I/O/Q  
Vcc  
7
I
I
I
I
I
21  
VCC  
23  
GAL26V12  
Top View  
I
I
I
I
9
21  
19  
11  
I
I
12  
14  
16  
18  
14  
15 I/O/Q  
I
Copyright ©2000 Lattice Semiconductor Corp. GAL, E2CMOS and UltraMOS are registered trademarks of Lattice Semiconductor Corp. Generic Array Logic is a trademark of Lattice Semiconduc-  
tor Corp. The specifications herein are subject to change without notice.  
LATTICE SEMICONDUCTOR CORP., 5555 N.E. Moore Ct., Hillsboro, Oregon 97124 U.S.A.  
Tel. (503) 268-8000 or 1-800-LATTICE; FAX (503) 268-8556  
November 2000  
1234567...16

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GAL26V12C-20LP 替代型号

型号 品牌 替代类型 描述 数据表
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