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EPM7096LI68-15

更新时间： 2024-11-01 19:10:23
品牌 Logo 应用领域
阿尔特拉 - ALTERA 时钟输入元件可编程逻辑
页数 文件大小 规格书
66页 458K
描述
EE PLD, 15ns, 96-Cell, CMOS, PQCC68, PLASTIC, LCC-68

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EPM7096LI68-15 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：LCC
包装说明：PLASTIC, LCC-68针数：68
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.21
其他特性：CONFIGURABLE I/O OPERATION WITH 3.3V OR 5V最大时钟频率：100 MHz
系统内可编程：NOJESD-30 代码：S-PQCC-J68
JESD-609代码：e0JTAG BST：NO
长度：24.2316 mm湿度敏感等级：3
专用输入次数：I/O 线路数量：52
宏单元数：96端子数量：68
最高工作温度：85 °C最低工作温度：-40 °C
组织：0 DEDICATED INPUTS, 52 I/O输出函数：MACROCELL
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装等效代码：LDCC68,1.0SQ封装形状：SQUARE
封装形式：CHIP CARRIER峰值回流温度（摄氏度）：220
电源：3.3/5,5 V可编程逻辑类型：EE PLD
传播延迟：15 ns认证状态：Not Qualified
座面最大高度：5.08 mm子类别：Programmable Logic Devices
最大供电电压：5.5 V最小供电电压：4.5 V
标称供电电压：5 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：J BEND
端子节距：1.27 mm端子位置：QUAD
处于峰值回流温度下的最长时间：30宽度：24.2316 mm
Base Number Matches：1

EPM7096LI68-15 数据手册

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MAX 7000  
Programmable Logic  
Device Family  
®
September 2005, ver. 6.7  
Data Sheet  
■
■
High-performance, EEPROM-based programmable logic devices  
(PLDs) based on second-generation MAX® architecture  
5.0-V in-system programmability (ISP) through the built-in  
IEEE Std. 1149.1 Joint Test Action Group (JTAG) interface available in  
MAX 7000S devices  
Features...  
–
ISP circuitry compatible with IEEE Std. 1532  
■
■
■
■
■
Includes 5.0-V MAX 7000 devices and 5.0-V ISP-based MAX 7000S  
devices  
Built-in JTAG boundary-scan test (BST) circuitry in MAX 7000S  
devices with 128 or more macrocells  
Complete EPLD family with logic densities ranging from 600 to  
5,000 usable gates (see Tables 1 and 2)  
5-ns pin-to-pin logic delays with up to 175.4-MHz counter  
frequencies (including interconnect)  
PCI-compliant devices available  
For information on in-system programmable 3.3-V MAX 7000A or 2.5-V  
MAX 7000B devices, see the MAX 7000A Programmable Logic Device Family  
Data Sheet or the MAX 7000B Programmable Logic Device Family Data  
Sheet.  
f
Table 1. MAX 7000 Device Features  
Feature  
EPM7032  
EPM7064  
EPM7096 EPM7128E EPM7160E EPM7192E EPM7256E  
Usable  
600  
1,250  
1,800  
2,500  
3,200  
3,750  
5,000  
gates  
Macrocells  
32  
2
64  
4
96  
6
128  
8
160  
10  
192  
12  
256  
16  
Logic array  
blocks  
Maximum  
36  
68  
76  
100  
104  
124  
164  
user I/O pins  
t
PD (ns)  
tSU (ns)  
FSU (ns)  
tCO1 (ns)  
CNT (MHz)  
6
5
6
5
7.5  
6
7.5  
6
10  
12  
7
12  
7
7
3
t
2.5  
4
2.5  
4
3
3
3
3
4.5  
125.0  
4.5  
125.0  
5
6
6
f
151.5  
151.5  
100.0  
90.9  
90.9  
Altera Corporation  
1
DS-MAX7000-6.7  
 
1234567...66

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EPM7096LI68-15 替代型号

型号 品牌 替代类型 描述 数据表
EPM7128SQI100-10N ALTERA

类似代替

 EE PLD, 10ns, 128-Cell, CMOS, PQFP100, PLASTIC, QFP-100
EPM7128SQC100-10N ALTERA

类似代替

 Programmable Logic Device Family
EPM7064LC68-15 ALTERA

类似代替

 Programmable Logic Device Family

与EPM7096LI68-15相关器件

型号 品牌 获取价格 描述 数据表
EPM7096QC100 ETC

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 		UV-Erasable/OTP Complex PLD
EPM7096QC100-12 ROCHESTER

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 		EE PLD, 12ns, PQFP100, PLASTIC, QFP-100
EPM7096QC100-12 ALTERA

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 		EE PLD, 12ns, 96-Cell, CMOS, PQFP100, PLASTIC, QFP-100
EPM7096QC100-12C ALTERA

获取价格

 		EE PLD, 12ns, CMOS, PQFP100, PLASTIC, QFP-100
EPM7096QC100-15 ALTERA

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 		EE PLD, 15ns, 96-Cell, CMOS, PQFP100, PLASTIC, QFP-100
EPM7096QC100-15 ROCHESTER

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 		EE PLD, 15 ns, PQFP100, PLASTIC, QFP-100
EPM7096QC100-2 ETC

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 		UV-Erasable/OTP Complex PLD
EPM7096QC100-6C ALTERA

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 		EE PLD, 6ns, CMOS, PQFP100, PLASTIC, QFP-100
EPM7096QC100-7 ROCHESTER

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 		EE PLD, 7.5 ns, PQFP100, PLASTIC, QFP-100

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