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EDI3DG328V10D1

更新时间： 2024-11-09 09:46:59
品牌 Logo 应用领域
WEDC 动态存储器内存集成电路
页数 文件大小 规格书
3页 97K
描述
Synchronous DRAM Module, 8MX32, CMOS, SODIMM-144

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EDI3DG328V10D1 数据手册

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EDI3DG328V  
8Mx32 Synchronous DRAM SO-DIMM, 3.3V  
FEATURES  
■ Cycle time of 10ns, 12ns and 15ns  
The EDI3DG328V are organized as 8Megx32 Synchronous high  
density DRAM Modules which are based on 4 CMOS 8Megx8bit  
DRAMs with 2 or 4 banks in a TSOP package which are mounted  
on an FR4 substrate. The module also includes a serial EEPROM  
in an 8-pin TSOP package.  
■ Packaging:  
• 144 pin SO-DIMM (Package 396)  
■ Burst Mode Operation (Sequential & Interleave)  
■ Auto & Self Refresh Capability (4096 cycles /64ms)  
■ LVTTL compatible inputs and outputs  
■ MRS cycle with address key programs  
■ Burst Length (1, 2, 4, 8 & Full Page)  
■ Data Scramble  
The module is a 144 Pin Small Outline Dual In-Line Memory  
module with gold contacts.  
■ All inputs are sampled at the positive edge of the system clock  
■ Serial Presence Detect with EEPROM  
■ Single 3.3 Volts Operation  
PIN CONFIGURATION  
Pin Symbol Pin Symbol Pin Symbol Pin Symbol  
PIN DESCRIPTION  
1
3
5
7
9
11  
13  
15  
17  
19  
21  
VSS  
DQ0  
DQ1  
DQ2  
DQ3  
VCC  
DQ4  
DQ5  
DQ6  
DQ7  
VSS  
2
4
6
8
10  
12  
14  
16  
18  
20  
22  
VSS  
DQ32  
DQ33  
DQ34  
DQ35  
VCC  
DQ36  
DQ37  
DQ38  
DQ39  
VSS  
73  
75  
77  
79  
81  
83  
85  
87  
89  
91  
93  
95  
97  
NC  
VSS  
NC  
NC  
VCC  
NC  
NC  
NC  
NC  
VSS  
NC  
NC  
NC  
NC  
VCC  
A6  
74  
76  
78  
80  
82  
84  
86  
88  
90  
92  
94  
96  
98  
100  
102  
104  
106  
108  
110  
CLK1  
VSS  
NC  
NC  
VCC  
NC  
NC  
NC  
NC  
VSS  
NC  
NC  
NC  
NC  
VCC  
A7  
A0-12  
Address lines  
Bank Select  
BA0-1  
DQ0-15,  
DQ32-47  
Data Input/Output  
CLK-CKL1  
RAS\  
CAS\  
CKE0  
DQM0,1,4,5  
CS0\  
Clock Input  
Row Address Strobe  
Column Address Strobe  
Clock Enable Input  
DQM  
23 DQM0  
25 DQM1  
24 DQM4  
26 DQM5  
27  
29  
31  
33  
35  
37  
39  
41  
43  
45  
47  
49  
51  
53  
55  
57  
59  
61  
63  
VCC  
A0  
A1  
A2  
VSS  
DQ8  
DQ9  
DQ10  
DQ11  
VCC  
DQ12  
DQ13  
DQ14  
DQ13  
DQ14  
NC  
28  
30  
32  
34  
36  
38  
40  
42  
44  
46  
48  
50  
52  
54  
56  
58  
60  
VCC  
A3  
A4  
A5  
VSS  
DQ40  
DQ41  
DQ42  
DQ43  
VCC  
DQ44  
DQ45  
DQ46  
DQ45  
DQ46  
NC  
99  
Chip Select Input  
Write Enable  
101  
103  
105  
107  
109  
WE\  
A8  
VSS  
A9  
A9  
SDA  
Serial Data I/O  
Serial Clock  
VSS  
BA1  
A11  
VCC  
NC  
NC  
VSS  
NC  
NC  
NC  
NC  
VCC  
NC  
NC  
NC  
NC  
VSS  
SCL  
VCC  
Power Supply  
Ground  
111 A10/AP 112  
113  
115  
117  
119  
121  
123  
125  
127  
129  
131  
VSS  
NC  
NC  
VSS  
NC  
NC  
NC  
NC  
VCC  
NC  
NC  
NC  
NC  
VSS  
114  
116  
118  
120  
122  
124  
126  
128  
130  
132  
134  
136  
138  
140  
VSS  
NC  
No Connection  
NOTE:  
DQMs vs Data I/Os  
DQM0 controls DQ0-7  
DQM1 controls DQ8-15  
DQM4 controls DQ32-39  
DQM5 controls DQ40-47  
NC  
CLK0  
VCC  
NC  
62 CKE0 133  
64  
66 CAS\  
68 NC  
VCC  
135  
137  
139  
65 RAS\  
67  
69  
71  
WE\  
CS0\  
NC  
70 A12/NC 141 SDA  
72 NC 143  
142 SCL  
144  
VCC  
VCC  
NOTES:  
1. A12 (Pin 70) is NC when using 4 bank devices  
2. BA1 (Pin 110) is on C when using 2 bank devices  
1
White Electronic Designs Corporation • (508) 366-5151 • www.whiteedc.com  
January 1998 Rev. 0  
123

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EDI3DG328V8D1 WEDC

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