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EBE20AE4ACWA

更新时间： 2022-12-22 00:39:56
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尔必达 - ELPIDA 动态存储器双倍数据速率
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27页 227K
描述
2GB Registered DDR2 SDRAM DIMM

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EBE20AE4ACWA 数据手册

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EBE20AE4ACWA  
Block Diagram  
VSS  
/RCS0  
RS  
RS  
RS  
RS  
DQS9  
/DQS9  
DQS0  
/DQS0  
/CS  
DM  
DQS /DQS  
DQS /DQS  
DQS /DQS  
DQS /DQS  
DQS /DQS  
DQS /DQS  
DQS /DQS  
DQS /DQS  
DQS /DQS  
/CS  
DM  
DQS /DQS  
DQS /DQS  
DQS /DQS  
DQS /DQS  
DQS /DQS  
DQS /DQS  
DQS /DQS  
DQS /DQS  
DQS /DQS  
RS  
RS  
RS  
RS  
RS  
RS  
RS  
RS  
RS  
4
RS  
RS  
RS  
RS  
RS  
RS  
RS  
RS  
RS  
4
DQ0  
to DQ3  
DQ0  
to DQ3  
DQ0 to DQ3  
DQ4 to DQ7  
D0  
D9  
RS  
RS  
RS  
RS  
DQS10  
/DQS10  
DQS1  
/DQS1  
/CS  
DM  
/CS  
DM  
4
4
DQ0  
to DQ3  
DQ0  
to DQ3  
DQ8 to DQ11  
DQ12 to DQ15  
D1  
D10  
RS  
RS  
RS  
RS  
DQS11  
/DQS11  
DQS2  
/DQS2  
/CS  
DM  
/CS  
DM  
4
4
DQ0  
to DQ3  
DQ16 to DQ19  
DQ0  
to DQ3  
DQ20 to DQ23  
D2  
D11  
RS  
RS  
RS  
RS  
DQS12  
/DQS12  
DQS3  
/DQS3  
/CS  
DM  
/CS  
DM  
4
4
DQ0  
to DQ3  
DQ24 to DQ27  
DQ28 to DQ31  
DQ0  
to DQ3  
D3  
D12  
RS  
RS  
RS  
RS  
DQS13  
/DQS13  
DQS4  
/DQS4  
/CS  
DM  
/CS  
DM  
4
4
DQ0  
to DQ3  
DQ0  
to DQ3  
DQ32 to DQ35  
DQ36 to DQ39  
D4  
D13  
RS  
RS  
RS  
RS  
DQS14  
/DQS14  
DQS5  
/DQS5  
/CS  
DM  
/CS  
DM  
4
4
DQ0  
to DQ3  
DQ0  
to DQ3  
DQ40 to DQ43  
DQ44 to DQ47  
D5  
D14  
RS  
RS  
RS  
RS  
DQS15  
/DQS15  
Serial PD  
DQS6  
/DQS6  
SCL  
SDA  
SCL  
SDA  
/CS  
DM  
/CS  
DM  
U0  
4
4
DQ0  
to DQ3  
DQ48 to DQ51  
DQ52 to DQ55  
DQ0  
to DQ3  
D6  
D15  
A1 A2  
WP A0  
RS  
RS  
RS  
RS  
SA0 SA1  
SA2  
DQS7  
DQS16  
/DQS16  
/DQS7  
/CS  
DM  
/CS  
DM  
VDDSPD  
VDD  
Serial PD  
4
4
DQ0  
to DQ3  
DQ56 to DQ59  
DQ0  
to DQ3  
D0 to D17  
DQ60 to DQ63  
D7  
D16  
D0 to D17  
D0 to D17  
VREF  
VSS  
RS  
RS  
RS  
RS  
DQS8  
DQS17  
/DQS17  
/DQS8  
/CS  
DM  
/CS  
DM  
D0 to D17: 1G bits DDR2 SDRAM  
U0: 2K bits EEPROM  
4
4
DQ0  
to DQ3  
DQ0  
to DQ3  
CB0 to CB3  
CB4 to CB7  
RS: 22Ω  
D8  
D17  
PLL: CUA877  
Register: SSTUB32866  
R
S
2
/CS*  
/RCS0 -> /CS: SDRAMs D0 to D17  
R
E
G
I
S
T
E
R
P
L
L
PCK0 to PCK6, PCK8, PCK9 -> CK: SDRAMs D0 to D17  
/PCK0 to /PCK6, /PCK8, /PCK9 -> /CK: SDRAMs D0 to D17  
R
S
R
S
R
S
CK0  
/CK0  
BA0 to BA2  
A0 to A13  
/RAS  
RBA0 to RBA2 -> BA0 to BA2: SDRAMs D0 to D17  
RA0 to RA13 -> A0 to A13: SDRAMs D0 to D17  
/RRAS -> /RAS: SDRAMs D0 to D17  
/RCAS -> /CAS: SDRAMs D0 to D17  
RCKE0 -> CKE: SDRAMs D0 to D17  
/RWE -> /WE: SDRAMs D0 to D17  
PCK7 -> CK: register  
/PCK7 -> /CK: register  
/RESET  
OE  
R
S
R
S
R
S
R
S
/CAS  
CKE0  
/WE  
ODT0  
RODT0 -> ODT0: SDRAMs D0 to D17  
Signals for Address and Command Parity Function  
/RST  
Register B  
Register A  
VDD  
VDD  
C0  
C1  
VSS  
VDD  
C0  
C1  
3
3
/RESET*  
PCK7  
/PCK7  
*
3
*
PPO  
PAR_IN  
PAR_IN  
PPO  
Par_In  
Notes:  
/QERR  
/QERR  
/Err_Out  
1. DQ wring may be changed within a nibble.  
100kΩ  
2. /CS connects to /DCS of register and /CSR of register2.  
/CSR of register1 and /DCS of register2 connects to VDD.  
3. /RESET, PCK7 and /PCK7 connect to both registers.  
Other signals to one of two registers.  
Data Sheet E1395E10 (Ver. 1.0)  
8
1...567891011...27

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